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    Systematic circuit design and analysis using generalised g m / I D functions of MOS devices
    Aminzadeh, Hamed
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-04-01), S. 432-443
    Online unknown
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    Low power radiation aware transistor level design using tri‐state inverter embedded non‐clock gating technique
    Venkatachalam, Kuppusamy ; Ramaian Subramanian Kamalakannan
    In: IET Circuits, Devices & Systems, Jg. 13 (2019-10-01), S. 1063-1070
    Online unknown
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    Exploiting uncertain timing information in time‐based SAR ADCs
    Leitner, Stefan ; Abhilash Karnatakam Nagabhushana ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-03-09), S. 390-397
    Online unknown
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    CFE: a convenient, flexible, and efficient clocking scheme for quantum‐dot cellular automata
    Zhang, Yongqiang ; Xie, Guangjun ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020), S. 88-92
    Online unknown
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    Design procedure for multifinger MOSFET two‐stage OTA with shallow trench isolation effect
    Veldandi, Harikrishna ; Shaik Rafi Aahmed
    In: IET Circuits, Devices & Systems, Jg. 12 (2018-06-26), S. 513-522
    Online unknown
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  6. Detailansicht für Treffer 6 öffnen
    Programmable CCCII: reliability analysis and design methodology
    Paul, Sajal K. ; Manoj Kumar Tiwari ; et al.
    In: IET Circuits, Devices & Systems, Jg. 13 (2019-05-31), S. 487-493
    Online unknown
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    Reliability enhancement of a steep slope tunnel transistor based ring oscillator designs with circuit interaction
    Vallabhaneni, Harshita ; Japa, Aditya ; et al.
    In: IET Circuits, Devices & Systems, Jg. 10 (2016-11-01), S. 522-527
    Online unknown
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    Wie komme ich dran?
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sm 576 - 768
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lg 992 - 1200
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