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    A 1.5-V CMOS all-N-logic true-single-phase bootstrapped dynamic-logic circuit suitable for low supply voltage and high-speed pipelined system operation
    Lou, J.H. ; Kuo, James B.
    In: IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing, Jg. 46 (1999-05-01), S. 628-631
    Online unknown
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    A CMOS K-winners-take-all circuit with O(n) complexity
    Cilingiroglu, Ugur ; Sekerkiran, B.
    In: IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing, Jg. 46 (1999), S. 1-5
    Online unknown
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    A CMOS square-law vector summation circuit
    Liu, Shen-Iuan ; Chang, Cheng-Chieh
    In: IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing, Jg. 43 (1996-07-01), S. 520-523
    Online unknown
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    An IC chip of Chua's circuit
    Cruz, J.M. ; Chua, Leon O.
    In: IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing, Jg. 40 (1993), S. 614-625
    Online unknown
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    OTA-based neural network architectures with on-chip tuning of synapses
    Jackson, S. ; Ghosh, Joydeep ; et al.
    In: IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing, Jg. 41 (1994), S. 49-58
    Online unknown
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