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    A 260ps quasi-static ALU in 90nm CMOS
    PESSOLANO, F ; MEIJER, R. I. M. P
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 372-380
    Konferenz
    Wie komme ich dran?
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    Power dissipation reduction during synthesis of two-level logic based on probability of input vectors changes
    BRZOZOWSKI, Ireneusz ; KOS, Andrzej
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2005, S. 456-465
    Konferenz
    Wie komme ich dran?
  3. Detailansicht für Treffer 3 öffnen
    Design of variable input delay gates for low dynamic power circuits
    RAJA, Tezaswi ; AGRAWAL, Vishwani D ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2005, S. 436-445
    Konferenz
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    Investigation of low-power low-voltage circuit techniques for a hybrid full-adder cell
    HASSOUNE, Ilham ; NEVE, Amaury ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 189-197
    Konferenz
    Wie komme ich dran?
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    Architecture for an external input into a molecular QCA circuit
    WALUS, Konrad ; KARIM, Faizal ; et al.
    In: Journal of computational electronics (Print), Jg. 8 (2009), Heft 1, S. 35-42
    Online academicJournal
    Zugriff:
    Full Text Finder (Volltext)
    Wie komme ich dran?
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    Power-clock gating in adiabatic logic circuits
    TEICHMANN, Philip ; FISCHER, Jurgen ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2005, S. 638-646
    Konferenz
    Wie komme ich dran?
  7. Detailansicht für Treffer 7 öffnen
    Power supply net for adiabatic circuits
    FISCHER, Jürgen ; AMIRANTE, Ettore ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 413-422
    Konferenz
    Wie komme ich dran?
  8. Detailansicht für Treffer 8 öffnen
    Delay evaluation of high speed data-path circuits based on threshold Logic
    CELINSKI, Peter ; ABBOTT, Derek ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 899-906
    Konferenz
    Wie komme ich dran?
  9. Detailansicht für Treffer 9 öffnen
    A novel mechanism for delay-insensitive data transfer based on current-mode multiple valued logic
    OH, Myeong-Hoon ; HAR, Dong-Soo
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 691-700
    Konferenz
    Wie komme ich dran?
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