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    A scalable high-voltage output driver for low-voltage CMOS technologies
    MENTZE, Erik J ; HESS, Herbert L ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 14 (2006), Heft 12, S. 1347-1353
    Online academicJournal
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    Wie komme ich dran?
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    Design of a CMOS Broadband Transimpedance Amplifier With Active Feedback
    ZHENGHAO, LU ; KIAT SENG, YEO ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 18 (2010), Heft 3, S. 461-472
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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    A minimum total power methodology for projecting limits on CMOS GSI : Special section on low-power electronics and design
    BHAVNAGARWALA, A. J ; AUSTIN, B. L ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 8 (2000), Heft 3, S. 235-251
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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    Short Pulse Generation With On-Chip Pulse-Forming Lines
    YONGTAO, GENG ; HUAN, ZOU ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 9, S. 1553-1564
    Online academicJournal
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    Wie komme ich dran?
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    A Low-Power Reconfigurable Logic Array Based on Double-Gate Transistors : Configurable Computing Design-II: Hardware Level Reconfiguration
    BECKETT, Paul
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 16 (2008), Heft 2, S. 115-123
    Online academicJournal
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    Comparative Evaluation of Layout Density in 3T, 4T, and MT FinFET Standard Cells
    ALIOTO, Massimo
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 5, S. 751-762
    Online academicJournal
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    Variable-Pipeline-Stage Router
    LEE, Chun-Yi ; JHA, Niraj K
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 21 (2013), Heft 9, S. 1669-1682
    Online academicJournal
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    Low-Power Circuit Analysis and Design Based on Heterojunction Tunneling Transistors (HETTs)
    YOONMYUNG, LEE ; DAEYEON, KIM ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 21 (2013), Heft 9, S. 1632-1643
    Online academicJournal
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    Modeling subthreshold SOI logic for static timing analysis
    VALENTIAN, Alexandre ; THOMAS, Olivier ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 12 (2004), Heft 6, S. 662-668
    Online academicJournal
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    Volltext
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  10. Detailansicht für Treffer 10 öffnen
    Design of Logic Gates and Flip-Flops in High-performance FinFET Technology
    BHOJ, Ajay N ; JHA, Niraj K
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 21 (2013), Heft 11, S. 1975-1988
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    A Framework for Layout-Dependent STI Stress Analysis and Stress-Aware Circuit Optimization
    JIYING, XUE ; YANGDONG, DENG ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 3, S. 498-511
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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