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    Design of two Low-Power full adder cells using GDI structure and hybrid CMOS logic style
    FOROUTAN, Vahid ; MOHAMMAD REZA, TAHERI ; et al.
    In: Integration (Amsterdam), Jg. 47 (2014), Heft 1, S. 48-61
    academicJournal
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    A passive UHF RF identification CMOS tag IC using ferroelectric RAM in 0.35-μm technology
    NAKAMOTO, Hiroyuki ; YAMAZAKI, Daisuke ; et al.
    In: Special issue on the 2006 IEEE International Solid-State Circuits Conference (ISSCC), Multimedia for a mobile world, February, Jg. 42 (2007), Heft 1, S. 101-110
    Online Konferenz
    Zugriff:
    Volltext
    Wie komme ich dran?
  3. Detailansicht für Treffer 3 öffnen
    A 120-dB dynamic range CMOS image sensor with programmable power responsivity
    STOPPA, David ; VATTERONI, Monica ; et al.
    In: ESSCIRC 2006, Jg. 42 (2007), Heft 7, S. 1555-1563
    Online Konferenz
    Zugriff:
    Volltext
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    A 1.9-GHz single-chip CMOS PHS cellphone
    SI, William W ; MEHTA, Srenik ; et al.
    In: 2006 IEEE International Solid-State Circuits Conference, Jg. 41 (2006), Heft 12, S. 2737-2745
    Online Konferenz
    Zugriff:
    Volltext
    Wie komme ich dran?
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    A New Linearized CCII-Based Fully Differential CMOS Transconductor Used for Gm-C Active Filters Implementation
    BOZOMITU, Radu Gabriel
    In: Wireless personal communications, Jg. 74 (2014), Heft 2, S. 615-637
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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  6. Detailansicht für Treffer 6 öffnen
    Application of high-K dielectrics in CMOS technology and emerging new technology
    LIU, Rich ; WU, Tai-Bor
    In: Advanced short-time thermal processing for Si-based CMOS devices (Paris, 27 April - 2 May 2003), 2003, S. 207-216
    Konferenz
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  7. Detailansicht für Treffer 7 öffnen
    Simulation and measurements on a 64-kbit hybrid Josephson-CMOS memory
    LIU, Q ; VAN DUZER, T ; et al.
    In: The 2004 Applied Superconductivity Conference, Jacksonville, FL, USA, October 3-8, Jg. 15 (2005), Heft 2, S. 415-418
    Online Konferenz
    Zugriff:
    Volltext
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  8. Detailansicht für Treffer 8 öffnen
    Efficiency of body biasing in 90-nm CMOS for low-power digital circuits
    VON AMIM, Klaus ; BORINSKI, Eduardo ; et al.
    In: 2004 European Solid State Circuits Conference (ESSCIRC), Jg. 40 (2005), Heft 7, S. 1549-1556
    Online Konferenz
    Zugriff:
    Volltext
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    200 mV full adder based on a reconfigurable CMOS perceptron
    AUNET, Snorre ; OELMANN, Bengt ; et al.
    In: Signals and electronic systems (proceedings), 2005, S. 237-240
    Konferenz
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    Materials and device structures for sub-32 nm CMOS nodes
    SKOTNICKI, Thomas
    In: INFOS 2007: Proceedings of the 15th Biennial Conference on Insulating Films on Semiconductors, June 20-23, Jg. 84 (2007), Heft 9-10, S. 1845-1852
    Konferenz
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    Pseudo-footless CMOS domino logic circuits for high-performance VLSI designs
    WANG, Jinn-Shyan ; SHIEH, Shang-Jyh ; et al.
    In: 2004 IEEE International Symposium on Circuits and Systems (proceedings), 2004, S. 401-404
    Konferenz
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    Estimation of delay variations due to random-dopant fluctuations in nano-scaled CMOS circuits
    MAHMOODI-MEIMAND, Hamid ; MUKHOPADHYAY, Saibal ; et al.
    In: Proceedings of the IEEE 2004 custom integrated circuits conference (Orlando, Florida, October 3-6, 2004), 2004, S. 17-20
    Konferenz
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  13. Detailansicht für Treffer 13 öffnen
    Enhanced analytic noise model for RF CMOS design
    KOEPPE, Jim ; HARJANI, Ramesh
    In: Proceedings of the IEEE 2004 custom integrated circuits conference (Orlando, Florida, October 3-6, 2004), 2004, S. 383-386
    Konferenz
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  14. Detailansicht für Treffer 14 öffnen
    Design techniques for pulsed static CMOS
    SESHADRI, Kavitha ; PONTARELLI, Adrianne ; et al.
    In: 2004 IEEE International Symposium on Circuits and Systems (proceedings), 2004, S. 929-932
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    A high performance CMOS programmable logic core
    YI, HAN ; MCMURCHIE, Larry ; et al.
    In: Proceedings of the IEEE 2004 custom integrated circuits conference (Orlando, Florida, October 3-6, 2004), 2004, S. 439-442
    Konferenz
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  16. Detailansicht für Treffer 16 öffnen
    A DFT technique for delay fault testability and diagnostics in 32-bit high performance CMOS ALUs
    CHATTERJEE, Bhaskar ; SACHDEV, Manoj ; et al.
    In: International Test Conference 2004 (October 26-October 28, 2004, S. 1108-1117
    Konferenz
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  17. Detailansicht für Treffer 17 öffnen
    A 3.9-μm pixel pitch VGA format 10-b digital output CMOS image sensor with 1.5 transistor/pixel
    TAKAHASHI, Hidekazu ; KINOSHITA, Masakuni ; et al.
    In: Special issue on the IEEE 2004 ISSCC: analog, wireline communications, wirelless and RF communications, Jg. 39 (2004), Heft 12, S. 2417-2425
    Online Konferenz
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  18. Detailansicht für Treffer 18 öffnen
    CMOS microelectrode array for bidirectional interaction with neuronal networks
    HEER, Flavio ; HAFIZOVIC, Sadik ; et al.
    In: 2005 European solid state circuits conference (ESSCIRC), Jg. 41 (2006), Heft 7, S. 1620-1629
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  19. Detailansicht für Treffer 19 öffnen
    A 3-GHz 70-Mb SRAM in 65-nm CMOS technology with integrated column-based dynamic power supply
    ZHANG, Kevin ; BHATTACHARYA, Uddalak ; et al.
    In: IEEE International Solid-State Circuits Conference (ISSCC 2005), [San Francisco, CA, USA, February 6-10, 2005], Jg. 41 (2006), Heft 1, S. 146-151
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  20. Detailansicht für Treffer 20 öffnen
    MASTAR VA: A predictive and flexible compact model for digital performances evaluation of CMOS technology with conventional CAD tools
    LACORD, Joris ; GHIBAUDO, Gérard ; et al.
    In: Solid-state electronics, Jg. 91 (2014), S. 137-146
    academicJournal
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