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    A comparative study on gate leakage and performance of high-K nano-CMOS logic gates
    KOUGIANOS, Elias ; MOHANTY, Saraju P
    In: International journal of electronics, Jg. 97 (2010), Heft 9-10, S. 985-1005
    academicJournal
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    A CMOS Analog Cell and its applications in analog signal processing
    ABUELMA'ATTI, M. T ; ALABSI, M. A
    In: International journal of electronics, Jg. 93 (2006), Heft 4, S. 251-267
    academicJournal
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    Universal and robust testing of stuck-open faults in Reed-Muller canonical CMOS circuits
    DAS, Debesh K ; CHAKRABORTY, Susanta ; et al.
    In: International journal of electronics, Jg. 90 (2003), Heft 1, S. 1-11
    academicJournal
    Wie komme ich dran?
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    Improved linearity low area CMOS multifunctional structures
    POPA, Cosmin
    In: International journal of electronics, Jg. 98 (2011), Heft 7-9, S. 995-1023
    academicJournal
    Wie komme ich dran?
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    Improved CMOS continuous programmable divider
    JIANHUI, WU ; ZUOTIAN, CHEN
    In: International journal of electronics, Jg. 96 (2009), Heft 7-8, S. 683-689
    academicJournal
    Wie komme ich dran?
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    An improved universal CMOS current-mode analogue function synthesiser
    MUHAMMAD TAHER ABUELMA'ATTI ; NAWAL MANSOUR AL-YAHIA
    In: International journal of electronics, Jg. 95 (2008), Heft 11-12, S. 1127-1148
    academicJournal
    Wie komme ich dran?
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    Single transistor primitive for timing and power modelling of CMOS gates
    CHATZIGEORGIOU, A ; NIKOLAIDIS, S
    In: International journal of electronics, Jg. 87 (2000), Heft 10, S. 1227-1238
    Online academicJournal
    Zugriff:
    Full Text Finder (Volltext)
    Wie komme ich dran?
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    An efficient self-timed adder realized using conventional CMOS standard cells
    PERRI, Stefania ; CORSONELLO, Pasquale ; et al.
    In: International journal of electronics, Jg. 90 (2003), Heft 6, S. 413-422
    academicJournal
    Wie komme ich dran?
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    Optimized transmission gate-based CMOS full adders : design and analysis
    LAM, Ringo Wai-Kit ; LI, Chi-Kwong
    In: International journal of electronics, Jg. 88 (2001), Heft 9, S. 1001-1013
    Online academicJournal
    Zugriff:
    Full Text Finder (Volltext)
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    The utility of the composite cascode in analog CMOS design
    COMER, David J ; COMER, Donald T ; et al.
    In: International journal of electronics, Jg. 91 (2004), Heft 8, S. 491-502
    academicJournal
    Wie komme ich dran?
  11. Detailansicht für Treffer 11 öffnen
    A new CMOS input buffer, both TTL and CMOS compatible, with a wide operating range
    SISKOS, S ; BAFLEUR, M ; et al.
    In: International journal of electronics, Jg. 72 (1992), Heft 1, S. 129-133
    Online academicJournal
    Zugriff:
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    Current-mode CMOS quaternary threshold logic full adder circuit
    CURRENT, K. W
    In: International journal of electronics, Jg. 74 (1993), Heft 4, S. 587-591
    Online academicJournal
    Zugriff:
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    Testing multiple-output CMOS combinational circuits
    ISMAEEL, A. A
    In: International journal of electronics, Jg. 67 (1989), Heft 4, S. 513-521
    Online academicJournal
    Zugriff:
    Full Text Finder (Volltext)
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    Test pattern generation for CMOS ternary logic
    ROZON, C ; MOUFTAH, H. T
    In: International journal of electronics, Jg. 65 (1988), Heft 2, S. 155-163
    Online academicJournal
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    Switching network logic approach for the design of CMOS VLSI circuits
    HU, C ; CHAN, S.-P
    In: International journal of electronics, Jg. 64 (1988), Heft 3, S. 421-441
    Online academicJournal
    Zugriff:
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    On the design of CMOS ternary logic circuits using T-gates
    CHEW, B. P ; MOUFTAH, H. T
    In: International journal of electronics, Jg. 63 (1987), Heft 2, S. 229-239
    Online academicJournal
    Zugriff:
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    New logical-sum and logical-product circuits using CMOS transistors and their applications to four-valued combinational circuits
    WATANABE, T ; MATSUMOTO, M ; et al.
    In: International journal of electronics, Jg. 63 (1987), Heft 2, S. 215-227
    Online academicJournal
    Zugriff:
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    Mitigation for single event coupling delay
    SAYIL, Selahattin ; AKKUR, Abhishek B
    In: International journal of electronics, Jg. 97 (2010), Heft 1-2, S. 17-29
    academicJournal
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  19. Detailansicht für Treffer 19 öffnen
    Jitter and phase noise of ADPLL due to PSN with deterministic frequency
    XIAOYING, DENG ; JUN, YANG ; et al.
    In: International journal of electronics, Jg. 98 (2011), Heft 7-9, S. 1259-1268
    academicJournal
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    Four-quadrant analogue multiplier using operational amplifier
    RIEWRUJA, Vanchai ; RERKRATN, Apinai
    In: International journal of electronics, Jg. 98 (2011), Heft 4-6, S. 459-474
    academicJournal
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