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    Highly digital 1 GS/s 7‐bit PWM ADC in 65 nm CMOS using time‐domain quantisation.
    Saha, A. ; Harjani, R.
    In: Electronics Letters (Wiley-Blackwell), Jg. 54 (2018-10-01), Heft 21, S. 1204-1206
    Online academicJournal
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    14.5 fJ/conversion‐step 9‐bit 100‐kS/s non‐binary weighted dual capacitor array based area and energy efficient SAR ADC in 90 nm CMOS.
    Narasimaiah, Jagadish Dasarahalli ; Bhat, Mujoor Shankaranarayana
    In: IET Circuits, Devices & Systems (Wiley-Blackwell), Jg. 12 (2018-11-01), Heft 6, S. 671-680
    academicJournal
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    Low‐power 10‐bit 100 MS/s pipelined ADC in digital CMOS technology.
    Singh, Anil ; Rawat, Veena ; et al.
    In: IET Circuits, Devices & Systems (Wiley-Blackwell), Jg. 11 (2017-11-01), Heft 6, S. 589-596
    academicJournal
    Wie komme ich dran?
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    Calibrated 10 b 28 nm CMOS SAR ADC based on integer‐based split capacitors.
    Lee, E.‐C. ; An, T.‐J. ; et al.
    In: Electronics Letters (Wiley-Blackwell), Jg. 54 (2018-04-01), Heft 7, S. 414-416
    Online academicJournal
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    Dual CDS scheme embedded in SAR‐based ADCs for low‐noise CMOS imagers without a PGA.
    Kim, M.‐K. ; Hong, S.‐K. ; et al.
    In: Electronics Letters (Wiley-Blackwell), Jg. 53 (2017), Heft 1, S. 16-18
    Online academicJournal
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    Reduced switching mode for SAR ADCs: analysis and design of SAR A‐to‐D algorithm with periodic standby mode circuit components.
    Joshi, Ashish ; Shrimali, Hitesh ; et al.
    In: IET Circuits, Devices & Systems (Wiley-Blackwell), Jg. 14 (2020-08-01), Heft 5, S. 686-694
    academicJournal
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    Exploiting uncertain timing information in time‐based SAR ADCs.
    Wang, Haibo ; Karnatakam Nagabhushana, Abhilash ; et al.
    In: IET Circuits, Devices & Systems (Wiley-Blackwell), Jg. 14 (2020-05-01), Heft 3, S. 390-397
    academicJournal
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    Fully‐VCO‐based 0‐2 MASH CT ΔΣ ADC.
    Xing, Xinpeng ; Zhu, Peng ; et al.
    In: Electronics Letters (Wiley-Blackwell), Jg. 54 (2018-08-01), Heft 17, S. 1018-1020
    Online academicJournal
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    9‐bit time–digital‐converter‐assisted compressive‐sensing analogue–digital‐converter with 4 GS/s equivalent speed.
    Hu, B. ; Ren, F. ; et al.
    In: Electronics Letters (Wiley-Blackwell), Jg. 52 (2016-03-01), Heft 5, S. 430-432
    Online academicJournal
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    Ultra‐low power comparator with dynamic offset cancellation for SAR ADC.
    Xin, Xin ; Cai, Jueping ; et al.
    In: Electronics Letters (Wiley-Blackwell), Jg. 53 (2017-11-01), Heft 23, S. 1572-1574
    Online academicJournal
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    Methodology for designing and verifying switched‐capacitor sample and hold circuits used in data converters.
    Mohammed, Mahmood ; Kawar, Sanad ; et al.
    In: IET Circuits, Devices & Systems (Wiley-Blackwell), Jg. 8 (2014-07-01), Heft 4, S. 252-262
    academicJournal
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    Two‐step, piecewise‐linear SAR ADC with programmable transfer function.
    Sengupta, S. ; Johnston, M.L.
    In: Electronics Letters (Wiley-Blackwell), Jg. 55 (2019-04-01), Heft 7, S. 444-446
    Online academicJournal
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    Low‐power time‐based ADC with alternating time‐residue amplification.
    Jung, J. ; Shin, S.
    In: Electronics Letters (Wiley-Blackwell), Jg. 52 (2016-10-01), Heft 21, S. 1845-1847
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    4×, 3‐level, blind ADC‐based receiver.
    Kovacevic, N. ; Jalali, M. S. ; et al.
    In: Electronics Letters (Wiley-Blackwell), Jg. 51 (2015-04-01), Heft 8, S. 551-553
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  15. Detailansicht für Treffer 15 öffnen
    Four‐channel self‐compensating single‐slope ADC for space environments.
    Sordo‐Ibáñez, S. ; Espejo‐Meana, S. ; et al.
    In: Electronics Letters (Wiley-Blackwell), Jg. 50 (2014-04-01), Heft 8, S. 579-581
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    Balanced sampling switch for high linearity and a wide temperature range in low power SAR ADCs.
    Kim, J.E. ; Yoo, T. ; et al.
    In: Electronics Letters (Wiley-Blackwell), Jg. 55 (2019-11-01), Heft 23, S. 1273-1275
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