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    A 208-MHz, 0.75-mW Self-Calibrated Reference Frequency Quadrupler for a 2-GHz Fractional-N Ring-PLL in 4-nm FinFET CMOS
    Lee, K. ; Jung, J. ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 70 (2023-08-01), Heft 8, S. 2719-2723
    Online academicJournal
    Zugriff:
    Volltext
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    A 100-Gb/s PAM-4 Voltage-Mode Transmitter With High-Resolution Unsegmented Three-Tap FFE in 40-nm CMOS
    Chen, Y. ; Peng, P. ; et al.
    In: IEEE Solid-State Circuits Letters, Jg. 5 (2022), S. 218-221
    Online academicJournal
    Zugriff:
    Volltext
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    A 112-Gb/s PAM-4 Voltage-Mode Transmitter With Four-Tap Two-Step FFE and Automatic Phase Alignment Techniques in 40-nm CMOS
    Peng, P. ; Chen, Y. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-07-01), Heft 7, S. 2123-2131
    Online academicJournal
    Zugriff:
    Volltext
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  4. Detailansicht für Treffer 4 öffnen
    Low Power Clock Generator Design With CMOS Signaling
    Fan, Y. ; Young, I.A.
    In: IEEE Open Journal of the Solid-State Circuits Society, Jg. 1 (2021), S. 162-170
    Online academicJournal
    Zugriff:
    Volltext
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  5. Detailansicht für Treffer 5 öffnen
    A Terahertz Molecular Clock on CMOS Using High-Harmonic-Order Interrogation of Rotational Transition for Medium-/Long-Term Stability Enhancement
    Wang, C. ; Yi, X. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-02-01), Heft 2, S. 566-580
    Online academicJournal
    Zugriff:
    Volltext
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    A 1.25Gbps FPGA I/O Cell Design for Source-Synchronous System in 65nm CMOS Process
    Qian, Taotao ; Chen, Lei ; et al.
    In: 2019 IEEE 2nd International Conference on Electronics Technology (ICET), 2019-05-01, S. 171-175
    Konferenz
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  7. Detailansicht für Treffer 7 öffnen
    A Configurable, Multi-Mode Comma Detection and Word Alignment Controller for High Speed Serial Interface in 130 nm CMOS Technology
    Ali, Imran ; Asif, Muhammad ; et al.
    In: 2018 14th International Conference on Emerging Technologies (ICET), 2018-11-01, S. 1-5
    Konferenz
    Wie komme ich dran?
  8. Detailansicht für Treffer 8 öffnen
    An Output Bandwidth Optimized 200-Gb/s PAM-4 100-Gb/s NRZ Transmitter With 5-Tap FFE in 28-nm CMOS
    Wang, Z. ; Choi, M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022), Heft 1, S. 21-31
    Online academicJournal
    Zugriff:
    Volltext
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  9. Detailansicht für Treffer 9 öffnen
    Power Aware Study of 32-bit 5-stage Pipeline RISC CPU using 180nm CMOS Technology
    Yadav, Pritesh Kumar ; Misra, Prasanna Kumar
    In: 2017 14th IEEE India Council International Conference (INDICON), 2017-12-01, S. 1-4
    Konferenz
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  10. Detailansicht für Treffer 10 öffnen
    A low power AES-GCM authenticated encryption core in 65nm SOTB CMOS process
    Hoang, Van-Phuc ; Nguyen, Van-Tinh ; et al.
    In: 2017 IEEE 60th International Midwest Symposium on Circuits and Systems (MWSCAS), 2017-08-01, S. 112-115
    Konferenz
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  11. Detailansicht für Treffer 11 öffnen
    A 73dB-A Audio VCO-ADC Based on a Maximum Length Sequence Generator in 130nm CMOS
    Perez, C. ; Quintero, A. ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021-10-01), Heft 10, S. 3194-3198
    Online academicJournal
    Zugriff:
    Volltext
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  12. Detailansicht für Treffer 12 öffnen
    A new two-step ΣΔ architecture column-parallel ADC for CMOS image sensor
    Bisiaux, P. ; Lelandais-Perrault, C. ; et al.
    In: 2016 29th Symposium on Integrated Circuits and Systems Design (SBCCI), 2016-08-01, S. 1-6
    Online Konferenz
    Zugriff:
    Full Text Finder (Volltext)
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  13. Detailansicht für Treffer 13 öffnen
    A Low-Power 9-Bit 222 MS/s Asynchronous SAR ADC in 65 nm CMOS
    Akkaya, Ayca ; Celik, Firat ; et al.
    In: 2020 IEEE International Symposium on Circuits and Systems (ISCAS), 2020-10-01, S. 1-5
    Konferenz
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  14. Detailansicht für Treffer 14 öffnen
    A 0.4V 0.08fJ/cycle retentive True-Single-Phase-Clock 18T Flip-Flop in 28nm FDSOI CMOS
    Stas, Francois ; Bol, David
    In: 2017 IEEE International Symposium on Circuits and Systems (ISCAS), 2017-05-01, S. 1-4
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    A 76 mW 40-Gb/s SerDes transmitter with 64:1 MUX In 65-nm CMOS technology
    Zhou, Naiwen ; Huang, Ke ; et al.
    In: 2016 6th International Conference on Electronics Information and Emergency Communication (ICEIEC), 2016-06-01, S. 155-158
    Konferenz
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  16. Detailansicht für Treffer 16 öffnen
    A 138Fsrms-Integrated-Jitter and −249dB-FoM Clock Multiplier with -51dBc Spur Using A Digital Spur Calibration Technique in 28-nm CMOS
    Li, Yi-An ; Niknejad, Ali M.
    In: 2019 Symposium on VLSI Circuits, 2019-06-01, S. 2
    Konferenz
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  17. Detailansicht für Treffer 17 öffnen
    A SAR ADC Based Time-to-Digital Converter in CMOS Technology
    Fathi, Mostafa ; Sheikhaei, Samad
    In: 2020 28th Iranian Conference on Electrical Engineering (ICEE), 2020-08-04, S. 1-5
    Konferenz
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  18. Detailansicht für Treffer 18 öffnen
    A 1–3 GHz I/Q Interleaved Direct-Digital RF Modulator As A Driver for A Common-Gate PA in 40 nm CMOS
    Shen, Yiyu ; Bootsman, Rob ; et al.
    In: 2020 IEEE Radio Frequency Integrated Circuits Symposium (RFIC), 2020-08-01, S. 287-290
    Konferenz
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  19. Detailansicht für Treffer 19 öffnen
    Configurable Logic Blocks and Memory Blocks for Beyond-CMOS FPGA-Based Embedded Systems
    Raj, M. ; Gopalakrishnan, L. ; et al.
    In: IEEE Embedded Systems Letters, Jg. 12 (2020-12-01), Heft 4, S. 113-116
    Online academicJournal
    Zugriff:
    Volltext
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  20. Detailansicht für Treffer 20 öffnen
    A 0.4-V 0.66-fJ/Cycle Retentive True-Single-Phase-Clock 18T Flip-Flop in 28-nm Fully-Depleted SOI CMOS
    Stas, F. ; Bol, D.
    In: IEEE Transactions on Circuits and Systems I: Regular Papers, Jg. 65 (2018-03-01), Heft 3, S. 935-945
    Online academicJournal
    Zugriff:
    Volltext
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