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    A voltage-controlled cmos phase-shift oscillator for short-range wireless communications
    Nakamura, Mitsuo ; Taniguchi, Kenji ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 86 (2003-08-18), S. 24-30
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    Design of coplanar waveguide matching circuit for RF-CMOS front-end
    Kawakami, Kouji ; Yoshida, Keiji ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 88 (2005), S. 19-26
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    Adiabatic dynamic CMOS logic circuit
    Takahashi, Kazukiyo ; Mizunuma, Mitsuru
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 83 (2000-05-01), S. 50-58
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    Deep-submicron CMOS technologies for low-power and high-performance operation
    Nara, Yasuo ; Kurata, H. ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 79 (1996), S. 1-9
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    A simple model for evaluating offset error characteristics in CMOS autozeroed chopper-type comparators
    Imaizumi, Eiki ; Matsuura, T. ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 78 (1995-04-01), S. 79-89
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    A 5-ns 32 K ×8/×9 bi-CMOS TTL SRAM with alternated bit line load architecture
    Kohno, Y. ; Sumi, Tadashi ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 77 (1994-02-01), S. 65-76
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    A 256-K Bi-CMOS ECL self-timed RAM using merged Bi-nMOS gates
    Suzuki, Kimio ; Shiomi, Toru ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 75 (1992), S. 77-87
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    Static-noise margin analysis for a scaled-down CMOS memory cell
    Mutoh, Shin'ichiro ; Douseki, Takakuni
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 75 (1992), S. 102-115
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    Delay-time evaluation of submicron BiCMOS, CMOS, and bipolar ecl gates
    Makoto, Suzuki ; Tachibana, Suguru ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 74 (1991), S. 78-89
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    The optimization of a DRAM CMOS row decoder circuit
    Miyamot, Hiroshi ; Yamagata, Tadato ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 73 (1990), S. 1-9
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    Design of CMOS multiple–valued logic circuits using only one voltage source
    Inoue, Takahiro ; Ueno, Fumio ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 73 (1990), S. 107-114
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    Low-voltage rail-to-rail CMOS operational amplifier design
    Suzuki, Tatsuya ; Myono, Takao ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 89 (2006), S. 1-7
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    A current-mode multivalued logic circuit based on by Bi-CMOS transistors
    Yamashita, Toshitsugu ; Taniguchi, Kazutaka ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 76 (1993), S. 105-116
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    High-speed and high-accuracy CMOS LSI for document image signal processor
    Tadauchi, Masaharu ; Nagai, Kenji ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 71 (1988), S. 28-38
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    Cmos device model for accurate circuit simulation application
    Sano, Eiichi ; Kimura, Tadakatsu
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 70 (1987), S. 94-102
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    A time-dependent and two-dimensional device analysis of CMOS structures
    Toyoki, Takemoto ; Wakabayashi, Mutsuko ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 68 (1985-04-01), S. 36-43
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    High-speed logic circuits combining bipolar and CMOS technology
    Nishio, Yoji ; Ikeda, Takahide ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 69 (1986), S. 28-36
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    Proposal of high speed bipolar-CMOS merged VLSI technology and its future prospect
    Hiraisi, Atsusi ; Masuda, Ikuro ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 71 (1988), S. 63-73
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    An SOI/CMOS flash A/D converter
    Nakaya, Masao ; Yazawa, Nobuharu ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 72 (1989), S. 30-39
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    Very high-speed ROM using bipolar/CMOS technology
    Kurita, Koozaburoo ; Hotta, Takasi ; et al.
    In: Electronics and Communications in Japan (Part II: Electronics), Jg. 71 (1988), S. 18-26
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