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    A 1 μs Locking Time Dual Loop ADPLL with Foreground Calibration-Based 6 ps Resolution Flash TDC in 180 nm CMOS
    Singh, Anil ; Agarwal, Alpana ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 41 (2021-11-10), S. 1299-1323
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    A 170 MHz to 330 MHz Wideband 90 nm CMOS RC–CR Phase Shifter with Integrated On-Line Amplitude Locked Loop Calibration for Hartley Image Rejection Transceiver
    Li, Shuo ; Zhang, Xiaomeng ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 40 (2021-04-26), S. 5249-5263
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    A New Circuit-Level Technique for Leakage and Short-Circuit Power Reduction of Static Logic Gates in 22-nm CMOS Technology
    Seyed Javad Azhari ; Amini-Valashani, Majid ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 40 (2021-01-05), S. 3536-3560
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    Wideband Inductorless True Time Delay Cell Based on CMOS Inverter for Timed Array Receivers
    Yarahmadi, Ahmad ; Jannesari, Abumoslem
    In: Circuits, Systems, and Signal Processing, Jg. 40 (2021-03-04), S. 3703-3726
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    A Power-Efficient SAR ADC with Optimized Timing-Redistribution Asynchronous SAR Logic in 40-nm CMOS
    Zhou, Jianjun ; Jin, Jing ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 40 (2021-01-21), S. 3125-3142
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    Concurrent Tri-band CMOS Power Amplifier Linearized by 3D Improved Memory Polynomial Digital Predistorter
    Leite, Bernardo ; Lima, Eduardo G. ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 40 (2020-11-05), S. 2176-2208
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    A New Low Power Mixed-Signal Digital Voltage Mode CMOS Fuzzy Logic Controller
    Ghasemzadeh, Mehdi ; Hadidi, Khayrollah
    In: Circuits, Systems, and Signal Processing, Jg. 40 (2020-07-10), S. 738-755
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    Light-Powered Starter for Micro-Power Boost DC–DC Converter for CMOS Image Sensors
    Jakusz, J. ; Blakiewicz, Grzegorz ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 39 (2019-07-09), S. 1195-1212
    Online unknown
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    Design of a Low Power Analog and Multi-shaped Fully Programmable Twin-Cell Membership Function Generator Circuit in 65 nm CMOS Technology
    Abiri, Ebrahim ; Ghasemian, Hossein ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 40 (2020-06-19), S. 2-21
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  10. Detailansicht für Treffer 10 öffnen
    Design of High Linearity Inductor-Less Active CMOS Mixer Based on Volterra Series Analysis
    Karimi, Gholamreza ; Ali Ataei Siah Bidi
    In: Circuits, Systems, and Signal Processing, Jg. 39 (2020-04-08), S. 4810-4828
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  11. Detailansicht für Treffer 11 öffnen
    Theory of Expansion Boolean Algebra and Its Applications in CMOS VLSI Digital Systems
    Jiang, Wen-bin ; Jiang, En-hua
    In: Circuits, Systems, and Signal Processing, Jg. 38 (2019-06-11), S. 5817-5838
    Online unknown
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  12. Detailansicht für Treffer 12 öffnen
    Practical Design of RC Approximants of Constant Phase Elements and Their Implementation in Fractional-Order PID Regulators Using CMOS Voltage Differencing Current Conveyors
    Jerabek, Jan ; Tsirimokou, Georgia ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 38 (2018-10-03), S. 1520-1546
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    A Power-Efficient CMOS Active Rectifier with Circuit Delay Compensation for Wireless Power Transfer Systems
    Saberi, Mehdi ; Shahsavari, Sajjad
    In: Circuits, Systems, and Signal Processing, Jg. 38 (2018-07-20), S. 947-966
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    Modular Discrete and CMOS Integrated Implementations of High-Speed Analog Rank-Order Filters
    J. Miguel Rocha-Pérez ; Lopez-Martin, Antonio J. ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 37 (2018-05-07), S. 5637-5646
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  15. Detailansicht für Treffer 15 öffnen
    RETRACTED ARTICLE: Hybrid Cascode Miller Compensation with Bandwidth Extension for 28-nm CMOS Multistage Amplifiers Driving Large Capacitive Loads
    Wang, Menghai ; Yan, Zhanke ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 39 (2019-07-23), S. 513-513
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    A 10-Bit, 12 ps Resolution CMOS Time-to-Digital Converter Dedicated to Ultra-Fast Optical Timing Applications
    Bérubé-Lauzière, Yves ; Fontaine, Rejean ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 34 (2014-10-18), S. 1129-1148
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    A Gigahertz Digital CMOS Divide-by-N Frequency Divider Based on a State Look-Ahead Structure
    Abdel-Hafeez, Saleh ; Gordon-Ross, Ann
    In: Circuits, Systems, and Signal Processing, Jg. 30 (2011-03-01), S. 1549-1572
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    A Novel High-Performance Hybrid Full Adder for VLSI Circuits
    Chakrapani, Arvind ; Rajagopal, Thiruvengadam
    In: Circuits, Systems, and Signal Processing, Jg. 40 (2021-05-10), S. 5718-5732
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    A Split-Input Driver-Enabled High-Speed and Energy-Efficient Level Shifter Using Hybrid Pull-Up Network
    Shanmuganathan, V. K. ; Rajendran, S. ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 41 (2021-10-15), S. 2308-2321
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    Design and Implementation of an Optimized Artificial Human Eardrum Model
    Bertsias, Panagiotis ; Said, Lobna A. ; et al.
    In: Circuits, Systems, and Signal Processing, Jg. 39 (2019-11-26), S. 3219-3233
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