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    Graphene for CMOS and Beyond CMOS Applications
    BANERJEE, Sanjay K ; FRANKLIN, Leonard ; et al.
    In: NANOELECTRONICS RESEARCH FOR BEYOND CMOS INFORMATION PROCESSING, Jg. 98 (2010), Heft 12, S. 2032-2046
    Online academicJournal
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    Enhancing CMOS Using Nanoelectronic Devices: A Perspective on Hybrid Integrated Systems
    RICKETTS, David S ; BAIN, James A ; et al.
    In: NANOELECTRONICS RESEARCH FOR BEYOND CMOS INFORMATION PROCESSING, Jg. 98 (2010), Heft 12, S. 2061-2075
    Online academicJournal
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    Growing Cells Atop Microelectronic Chips: Interfacing Electrogenic Cells In Vitro With CMOS-Based Microelectrode Arrays
    HIERLEMANN, Andreas ; FREY, Urs ; et al.
    In: Proceedings of the IEEE, Jg. 99 (2011), Heft 2, S. 252-284
    Online academicJournal
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    Device and Architecture Outlook for Beyond CMOS Switches
    BERNSTEIN, Kerry ; CAVIN, Ralph K ; et al.
    In: NANOELECTRONICS RESEARCH FOR BEYOND CMOS INFORMATION PROCESSING, Jg. 98 (2010), Heft 12, S. 2169-2184
    Online academicJournal
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    Analog Circuit Design in Nanoscale CMOS Technologies
    LEWYN, Lanny L ; YTTERDAL, Trond ; et al.
    In: Proceedings of the IEEE, Jg. 97 (2009), Heft 10, S. 1687-1714
    Online academicJournal
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    Computer-aided design for low-power robust computing in nanoscale CMOS
    SYLVESTER, Dennis ; SRIVASTAVA, Ashish
    In: Leading-edge computer aided design solutions for advanced digital and mixed-signal systems-on-chips, Jg. 95 (2007), Heft 3, S. 507-529
    Online academicJournal
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    Digital Circuit Design Challenges and Opportunities in the Era of Nanoscale CMOS : Small transistors necessitate big changes, in the way digital circuits are modeled and optimized for manufacturability, and new strategies for logic, memory, clocking and power distribution
    CALHOUN, Benton H ; YU, CAO ; et al.
    In: A Future of Integrated Electronics: Moving Off the Roadmap, Jg. 96 (2008), Heft 2, S. 343-365
    Online academicJournal
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    CMOS and Memristor-Based Neural Network Design for Position Detection
    EBONG, Idongesit E ; MAZUMDER, Pinaki
    In: Memristors: Devices, Models & Applications, Jg. 100 (2012), Heft 6, S. 2050-2060
    Online academicJournal
    Zugriff:
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    Nanoarchitectonics for Heterogeneous Integrated Nanosystems : Research on nanomaterials aims at development of smaller and smaller CMOS devices and also at increasing device functioning at low dissipation power
    WANG, Kang L ; GALATSIS, Kosmas ; et al.
    In: A Future of Integrated Electronics: Moving Off the Roadmap, Jg. 96 (2008), Heft 2, S. 212-229
    Online academicJournal
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    Analog-to-Digital Converters: Digitizing the Analog World : New mixed-signal CMOS circuits, that eliminate the need for op-amps, may be capable of performing data conversion at dramatically lower power consumption
    LEE, Hae-Seung ; SODINI, Charles G
    In: A Future of Integrated Electronics: Moving Off the Roadmap, Jg. 96 (2008), Heft 2, S. 323-334
    Online academicJournal
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    Is a New Paradigm for Nanoscale Analog CMOS Design Needed?
    LEWYN, Lanny ; WILLIAMS, Nicolas
    In: Proceedings of the IEEE, Jg. 99 (2011), Heft 1, S. 3-6
    Online academicJournal
    Zugriff:
    Volltext
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    Mitigating Memory Wall Effects in High-Clock-Rate and Multicore CMOS 3-D Processor Memory Stacks : Simulations indicate that 3-D stacking of memory chips can overcome memory limitations on computer processing by allowing for faster clock rates or improved transfer of data and address information
    JACOB, Philip ; ZIA, Aamir ; et al.
    In: 3-D Integration Technologies, Jg. 97 (2009), Heft 1, S. 108-122
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Nanoscale CMOS : Special issue on quantum devices and their applications
    WONG, H.-S. P ; FRANK, D. J ; et al.
    In: Proceedings of the IEEE, Jg. 87 (1999), Heft 4, S. 537-570
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    The challenge of signal integrity in deep-submicrometer CMOS technology
    CAIGNET, Fabrice ; DELMAS-BENDHIA, Sonia ; et al.
    In: Interconnections-Addressing the Next Challenge of IC Technology. Part I: Integration and Packaging Trends, Jg. 89 (2001), Heft 4, S. 556-573
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    Integration and electrical isolation in CMOS mixed-signal wireless chips
    FRYE, Robert C
    In: Interconnections-Addressing the Next Challenge of IC Technology. Part I: Integration and Packaging Trends, Jg. 89 (2001), Heft 4, S. 444-455
    Online academicJournal
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  16. Detailansicht für Treffer 16 öffnen
    SOI for digital CMOS VLSI : Design considerations and advances
    CHUANG, C.-T ; LU, P.-F ; et al.
    In: Proceedings of the IEEE, Jg. 86 (1998), Heft 4, S. 689-720
    Online academicJournal
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    CMOS scaling into the nanometer regime
    TAUR, Y ; BUCHANAN, D. A ; et al.
    In: Nanometer-scale science and technology, Jg. 85 (1997), Heft 4, S. 486-504
    Online academicJournal
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    Iddq testing for CMOS VLSI
    RAJSUMAN, R
    In: Proceedings of the IEEE, Jg. 88 (2000), Heft 4, S. 544-566
    Online academicJournal
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    Possibilities of deep-submicrometer CMOS for very-high-speed computer logic
    MASAKI, A
    In: Proceedings of the IEEE, Jg. 81 (1993), Heft 9, S. 1311-1324
    Online academicJournal
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    Minimizing power consumption in digital CMOS circuits
    CHANDRAKASAN, A. P ; BRODERSEN, R. W
    In: Low-power electronics, Jg. 83 (1995), Heft 4, S. 498-523
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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