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    A cycle-accurate energy estimator for CMOS digital circuits
    SONG, Eunseok ; PARK, Young-Kil ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 159-168
    Konferenz
    Wie komme ich dran?
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    Logic-level fast current simulation for digital CMOS circuits
    RUIZ DE CLAVIJO, Paulino ; JUAN-CHICO, Jorge ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2005, S. 425-435
    Konferenz
    Wie komme ich dran?
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    Operating region modelling and timing analysis of CMOS gates driving transmission lines
    CAPPUCCINO, Gregorio ; COCORULLO, Giuseppe
    In: Integrated circuit design (Seville, 11-13 September 2002), 2002, S. 438-447
    Konferenz
    Wie komme ich dran?
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    Minimizing spurious switching activities in CMOS circuits
    WROBLEWSKI, Artur ; AUERNHAMMER, Florian ; et al.
    In: Integrated circuit design (Seville, 11-13 September 2002), 2002, S. 419-428
    Konferenz
    Wie komme ich dran?
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    Leakage in CMOS circuits: An introduction
    HELMS, D ; SCHMIDT, E ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 17-35
    Konferenz
    Wie komme ich dran?
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    Measurement of the switching activity of CMOS digital circuits at the gate level
    BAENA, C ; JUAN-CHICO, J ; et al.
    In: Integrated circuit design (Seville, 11-13 September 2002), 2002, S. 353-362
    Konferenz
    Wie komme ich dran?
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    Leakage power analysis and comparison of deep submicron logic gates
    MERRETT, Geoff ; AL-HASHIMI, Bashir M
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 198-207
    Konferenz
    Wie komme ich dran?
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    Sleepy stack reduction of leakage power
    JUN CHEOL, PARK ; MOONEY, Vincent J ; et al.
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 148-158
    Konferenz
    Wie komme ich dran?
  9. Detailansicht für Treffer 9 öffnen
    Minimizing the power consumption of an asynchronous multiplier
    YIJUN, LIU ; FURBER, Steve
    In: Integrated circuit and system design (power and timing modeling, optimization and simulation), 2004, S. 289-300
    Konferenz
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    Exploiting metal layer characteristics for low-power routing
    WINDSCHIEGL, Armin ; ZUBER, Paul ; et al.
    In: Integrated circuit design (Seville, 11-13 September 2002), 2002, S. 55-64
    Konferenz
    Wie komme ich dran?
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