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    A Sub-0.25-pJ/bit 47.6-to-58.8-Gb/s Reference-Less FD-Less Single-Loop PAM-4 Bang-Bang CDR With a Deliberate-Current-Mismatch Frequency Acquisition Technique in 28-nm CMOS.
    Zhao, Xiaoteng ; Chen, Yong ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-05-01), Heft 5, S. 1358-1371
    Online academicJournal
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    A 0.0285-mm 2 0.68-pJ/bit Single-Loop Full-Rate Bang-Bang CDR Without Reference and Separate FD Pulling Off an 8.2-Gb/s/μs Acquisition Speed of the PAM-4 Input in 28-nm CMOS.
    Zhao, Xiaoteng ; Chen, Yong ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-02-01), Heft 2, S. 546-561
    Online academicJournal
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    A 5.2 Gb/s Receiver for Next-Generation 8K Displays in 180 nm CMOS Process.
    Wang, Tianyu ; Wei, Da ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-08-01), Heft 8, S. 2521-2531
    Online academicJournal
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    A 56-Gb/s 50-mW NRZ Receiver in 28-nm CMOS.
    Atharav, Atharav ; Razavi, Behzad
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022), Heft 1, S. 54-67
    Online academicJournal
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    A 4–20-Gb/s 1.87-pJ/b Continuous-Rate Digital CDR Circuit With Unlimited Frequency Acquisition Capability in 65-nm CMOS.
    Park, Kwanseo ; Lee, Kwangho ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-05-01), Heft 5, S. 1597-1607
    Online academicJournal
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    A 6.5–12.5-Gb/s Half-Rate Single-Loop All-Digital Referenceless CDR in 28-nm CMOS.
    Yu, Changzhi ; Sa, Euije ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-10-01), Heft 10, S. 2831-2841
    Online academicJournal
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    Volltext
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    A 12-Gb/s 10-ns Turn-On Time Rapid ON/OFF Baud-Rate DFE Receiver in 65-nm CMOS.
    Kim, Dongwook ; Ahmed, Mostafa G. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-08-01), Heft 8, S. 2196-2205
    Online academicJournal
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    A 10-Gb/s, 0.03-mm2, 1.28-pJ/bit Half-Rate Injection-Locked CDR With Path Mismatch Tracking Loop in a 28-nm CMOS Technology.
    Choo, Min-Seong ; Park, Kwanseo ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-10-01), Heft 10, S. 2812-2822
    Online academicJournal
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    A 22.5-to-32-Gb/s 3.2-pJ/b Referenceless Baud-Rate Digital CDR With DFE and CTLE in 28-nm CMOS.
    Rahman, Wahid ; Yoo, Danny ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-12-01), Heft 12, S. 3517-3531
    Online academicJournal
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    Design Techniques for a 60-Gb/s 288-mW NRZ Transceiver With Adaptive Equalization and Baud-Rate Clock and Data Recovery in 65-nm CMOS Technology.
    Han, Jaeduk ; Sutardja, Nicholas ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-12-01), Heft 12, S. 3474-3485
    Online academicJournal
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    A 12 Gb/s 0.9 mW/Gb/s Wide-Bandwidth Injection-Type CDR in 28 nm CMOS With Reference-Free Frequency Capture.
    Masuda, Takashi ; Shinoda, Ryota ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016-12-01), Heft 12, S. 3204-3215
    Online academicJournal
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    A 1.2–6 Gb/s, 4.2 pJ/Bit Clock & Data Recovery Circuit With High Jitter Tolerance in 0.14 \mum CMOS.
    van der Wel, Arnoud P. ; den Besten, Gerrit W.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-07-01), Heft 7, S. 1768-1775
    Online academicJournal
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    A 22 to 26.5 Gb/s Optical Receiver With All-Digital Clock and Data Recovery in a 65 nm CMOS Process.
    Chu, Sang-Hyeok ; Bae, Woorham ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-11-01), Heft 11, S. 2603-2612
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    A Fully-Integrated 40-Gb/s Transceiver in 65-nm CMOS Technology.
    Chen, Ming-Shuan ; Shih, Yu-Nan ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-03-01), Heft 3, S. 627-640
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    On-Chip Jitter Measurement Using Jitter Injection in a 28 Gb/s PI-Based CDR.
    Liang, Joshua ; Sheikholeslami, Ali ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-03-01), Heft 3, S. 750-761
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    A 32 Gb/s Data-Interpolator Receiver With Two-Tap DFE Fabricated With 28-nm CMOS Process.
    Doi, Yoshiyasu ; Shibasaki, Takayuki ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-12-01), Heft 12, S. 3258-3267
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    A 25-Gb/s 5-mW CMOS CDR/Deserializer.
    Jung, Jun Won ; Razavi, Behzad
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-03-01), Heft 3, S. 684-697
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    A Reference-Less Clock and Data Recovery Circuit Using Phase-Rotating Phase-Locked Loop.
    Shu, Guanghua ; Saxena, Saurabh ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-04-01), Heft 4, S. 1036-1047
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    Design Techniques for 48-Gb/s 2.4-pJ/b PAM-4 Baud-Rate CDR With Stochastic Phase Detector.
    Ju, Haram ; Lee, Kwangho ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-10-01), Heft 10, S. 3014-3024
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    A 56-Gb/s 8-mW PAM4 CDR/DMUX With High Jitter Tolerance.
    Hou, Guanrong ; Razavi, Behzad
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-09-01), Heft 9, S. 2856-2867
    Online academicJournal
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