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    Design and application of CMOS bulk input scheme
    Huang, Hong-Yi ; Lin, Jing-Fu
    In: IEEE Journal of Solid-State Circuits, Jg. 39 (2004-08-01), S. 1305-1312
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    A redundant multivalued logic for a 10-Gb/s CMOS demultiplexer IC
    Tanabe, A. ; Mogami, Tohru ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 38 (2003), S. 107-113
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    High-performance and power-efficient CMOS comparators
    Huang, Chung-Hsun ; Wang, Jinn-Shyan
    In: IEEE Journal of Solid-State Circuits, Jg. 38 (2003-02-01), S. 254-262
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    0.18-μm CMOS 10-Gb/s multiplexer/demultiplexer ICs using current mode logic with tolerance to threshold voltage fluctuation
    Okihara, M. ; Endoh, Tetsuo ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 36 (2001-06-01), S. 988-996
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    Low-power logic styles: CMOS versus pass-transistor logic
    Zimmermann, R. ; Fichtner, Wolfgang
    In: IEEE Journal of Solid-State Circuits, Jg. 32 (1997-07-01), S. 1079-1090
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    Floating-body effects in partially depleted SOI CMOS circuits
    Anderson, Carl J. ; Wagner, Lawrence F. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 32 (1997), S. 1241-1253
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    A 3.8-ns CMOS 16*16-b multiplier using complementary pass-transistor logic
    Nishida, Takashi ; Shimizu, Akihiro ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 25 (1990-04-01), S. 388-395
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    NORA: a racefree dynamic CMOS technique for pipelined logic structures
    H. De Man ; Goncalves, N.F.
    In: IEEE Journal of Solid-State Circuits, Jg. 18 (1983-06-01), S. 261-266
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    Implementation of iterative networks with CMOS differential logic
    Lu, S.-L.
    In: IEEE Journal of Solid-State Circuits, Jg. 23 (1988), S. 1013-1017
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    Ultrafast compact 32-bit CMOS adders in multiple-output domino logic
    Hwang, I.S. ; Fisher, A.L.
    In: IEEE Journal of Solid-State Circuits, Jg. 24 (1989-04-01), S. 358-369
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    CMOS differential pass-transistor logic design
    Salama, C.A.T. ; Shubat, Alex ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 22 (1987-04-01), S. 216-222
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    A Design Style for VLSI CMOS
    Ivey, P.A. ; Myers, D.J.
    In: IEEE Journal of Solid-State Circuits, Jg. 20 (1985-06-01), S. 741-745
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    High-speed compact circuits with CMOS
    Lee, C.M. ; Krambeck, R.H. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 17 (1982-06-01), S. 614-619
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    FFT scaling in Domino CMOS gates
    Shoji, M.
    In: IEEE Journal of Solid-State Circuits, Jg. 20 (1985-10-01), S. 1067-1071
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    Differential split-level CMOS logic for subnanosecond speeds
    Mol, W.G.L. ; Pfennings, L.C.M.G. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 20 (1985-10-01), S. 1050-1055
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    Dynamic logic CMOS circuits
    Friedman, V. ; Liu, S.
    In: IEEE Journal of Solid-State Circuits, Jg. 19 (1984-04-01), S. 263-266
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    Resistance-CMOS circuits
    Oguey, H. ; Vittoz, Eric A.
    In: IEEE Journal of Solid-State Circuits, Jg. 12 (1977-06-01), S. 283-285
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    Design-performance trade-offs in CMOS-domino logic
    Oklobdzija, Vojin G. ; Montoye, R. K.
    In: IEEE Journal of Solid-State Circuits, Jg. 21 (1986-04-01), S. 304-306
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    An expression for the propagation delay of a differential split-level (DSL) CMOS logic gate
    Huizer, C.M. ; Sheridan, P.
    In: IEEE Journal of Solid-State Circuits, Jg. 22 (1987-06-01), S. 457-459
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    An electrically reconfigurable programmable logic array using a CMOS/DMOS technology
    Denham, P. ; Fong, E. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 19 (1984-12-01), S. 1041-1043
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