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    A Sub-0.25-pJ/bit 47.6-to-58.8-Gb/s Reference-Less FD-Less Single-Loop PAM-4 Bang-Bang CDR With a Deliberate-Current-Mismatch Frequency Acquisition Technique in 28-nm CMOS.
    Zhao, Xiaoteng ; Chen, Yong ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-05-01), Heft 5, S. 1358-1371
    Online academicJournal
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    A 0.0285-mm 2 0.68-pJ/bit Single-Loop Full-Rate Bang-Bang CDR Without Reference and Separate FD Pulling Off an 8.2-Gb/s/μs Acquisition Speed of the PAM-4 Input in 28-nm CMOS.
    Zhao, Xiaoteng ; Chen, Yong ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-02-01), Heft 2, S. 546-561
    Online academicJournal
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    A 600-μm² Ring-VCO-Based Hybrid PLL Using a 30-μW Charge-Sharing Integrator in 28-nm CMOS.
    Yang, Shiheng ; Yin, Jun ; et al.
    In: IEEE Transactions on Circuits & Systems. Part II: Express Briefs, Jg. 68 (2021-09-01), Heft 9, S. 3108-3112
    Online academicJournal
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    A Robust Energy/Area-Efficient Forwarded-Clock Receiver With All-Digital Clock and Data Recovery in 28-nm CMOS for High-Density Interconnects.
    Chen, Shuai ; Li, Hao ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-02-01), Heft 2, S. 578-586
    Online academicJournal
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    An 80 × 60 Flash LiDAR Sensor With In-Pixel Delta-Intensity Quaternary Search Histogramming TDC.
    Park, Seonghyeok ; Kim, Bumjun ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-11-01), Heft 11, S. 3200-3211
    Online academicJournal
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    A 4–20-Gb/s 1.87-pJ/b Continuous-Rate Digital CDR Circuit With Unlimited Frequency Acquisition Capability in 65-nm CMOS.
    Park, Kwanseo ; Lee, Kwangho ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-05-01), Heft 5, S. 1597-1607
    Online academicJournal
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    A 7.1-GHz 0.7-mW Programmable Counter With Fast EOC Generation in 65-nm CMOS.
    Som, Indranil ; Sarangi, Santunu ; et al.
    In: IEEE Transactions on Circuits & Systems. Part II: Express Briefs, Jg. 67 (2020-11-01), Heft 11, S. 2397-2401
    Online academicJournal
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    A 6.5–12.5-Gb/s Half-Rate Single-Loop All-Digital Referenceless CDR in 28-nm CMOS.
    Yu, Changzhi ; Sa, Euije ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-10-01), Heft 10, S. 2831-2841
    Online academicJournal
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    An All-Digital, $V_{\mathrm{MAX}}$ -Compliant, Stable, and Scalable Distributed Charge Injection Scheme in 10-nm CMOS for Fast and Local Mitigation of Voltage Droop.
    Bang, Suyoung ; Cho, Minki ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-07-01), Heft 7, S. 1898-1908
    Online academicJournal
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  10. Detailansicht für Treffer 10 öffnen
    A Tileable CMOS X-Ray Line Detector Using Time-Delay-Integration With Pseudomultisampling for Large-Sized Dental X-Ray Imaging Systems.
    Jo, Yun-Rae ; Hong, Seong-Kwan ; et al.
    In: IEEE Transactions on Electron Devices, Jg. 64 (2017), Heft 1, S. 211-216
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    CMOS Rad-Hard Front-End Electronics for Precise Sensors Measurements.
    Sordo-Ibanez, Samuel ; Pinero-Garcia, Blanca ; et al.
    In: IEEE Transactions on Nuclear Science, Jg. 63 (2016-08-15), Heft b4, S. 2379-2389
    Online academicJournal
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    A 0.2-1.3 ns Range Delay-Control Scheme for a 25 Gb/s Data-Receiver Using a Replica Delay-Line-Based Delay-Locked-Loop in 45-nm CMOS.
    Rehman, Sami Ur ; Khafaji, Mohammad Mahdi ; et al.
    In: IEEE Transactions on Circuits & Systems. Part II: Express Briefs, Jg. 67 (2020-05-01), Heft 5, S. 806-810
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Synchronized Interconnected ADPLLs for Distributed Clock Generation in 65 nm CMOS Technology.
    Galayko, Dimitri ; Shan, Chuan ; et al.
    In: IEEE Transactions on Circuits & Systems. Part II: Express Briefs, Jg. 66 (2019-10-01), Heft 10, S. 1673-1677
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    A 6.7–11.2 Gb/s, 2.25 pJ/bit, Single-Loop Referenceless CDR With Multi-Phase, Oversampling PFD in 65-nm CMOS.
    Park, Kwanseo ; Bae, Woorham ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-10-01), Heft 10, S. 2982-2993
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  15. Detailansicht für Treffer 15 öffnen
    Steamroller Module and Adaptive Clocking System in 28 nm CMOS.
    Wilcox, Kathryn ; Cole, Robert ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015), Heft 1, S. 24-34
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    An 8.2 Gb/s-to-10.3 Gb/s Full-Rate Linear Referenceless CDR Without Frequency Detector in 0.18 μm CMOS.
    Huang, Sui ; Cao, Jun ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-09-01), Heft 9, S. 2048-2060
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  17. Detailansicht für Treffer 17 öffnen
    A 22.5-to-32-Gb/s 3.2-pJ/b Referenceless Baud-Rate Digital CDR With DFE and CTLE in 28-nm CMOS.
    Rahman, Wahid ; Yoo, Danny ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-12-01), Heft 12, S. 3517-3531
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  18. Detailansicht für Treffer 18 öffnen
    A 2.2-mW 20–135-MHz False-Lock-Free DLL for Display Interface in 0.15- \mu\m CMOS.
    Moon, Yong-Hwan ; Kong, In-Seok ; et al.
    In: IEEE Transactions on Circuits & Systems. Part II: Express Briefs, Jg. 61 (2014-08-01), Heft 8, S. 554-558
    Online academicJournal
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  19. Detailansicht für Treffer 19 öffnen
    A 0.003-mm2 440fsRMS-Jitter and −64dBc-Reference-Spur Ring-VCO-Based Type-I PLL Using a Current-Reuse Sampling Phase Detector in 28-nm CMOS.
    Yang, Zunsong ; Chen, Yong ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 68 (2021-06-01), Heft 6, S. 2307-2316
    Online serialPeriodical
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  20. Detailansicht für Treffer 20 öffnen
    A 12 Gb/s 0.9 mW/Gb/s Wide-Bandwidth Injection-Type CDR in 28 nm CMOS With Reference-Free Frequency Capture.
    Masuda, Takashi ; Shinoda, Ryota ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016-12-01), Heft 12, S. 3204-3215
    Online academicJournal
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