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    Asymmetric slope dual mode differential logic circuit for compatibility of low-power and high-speed operations : Low-power, high-speed LSIs and related technologies
    MORIMOTO, Masao ; NAGATA, Makoto ; et al.
    In: IEICE transactions on electronics, Jg. 90 (2007), Heft 4, S. 675-682
    Online academicJournal
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    Noise immunity investigation of low power design schemes
    ABBAS, Mohamed ; IKEDA, Makoto ; et al.
    In: IEICE transactions on electronics, Jg. 89 (2006), Heft 8, S. 1238-1247
    Online academicJournal
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    64-bit high-performance power-aware conditional carry adder design
    CHENG, Kuo-Hsing ; CHENG, Shun-Wen
    In: IEICE transactions on electronics, Jg. 88 (2005), Heft 6, S. 1322-1331
    Online academicJournal
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    Adiabatic charging reversible logic using a switched capacitor regenerator : New system paradigms for integrated electronics
    NAKATA, Shunji
    In: IEICE transactions on electronics, Jg. 87 (2004), Heft 11, S. 1837-1846
    academicJournal
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    A Novel Fast-Lock-in Digitally Controlled Phase-Locked Loop
    CHEN, Xin ; YANG, Jun ; et al.
    In: IEICE transactions on electronics, Jg. 91 (2008), Heft 12, S. 1971-1975
    Online academicJournal
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    Multi-Context FPGA Using Fine-Grained Interconnection Blocks and Its CAD Environment : Advanced technologies in digital LSIs and memories
    WAIDYASOORIYA, Hasitha Muthumala ; CHONG, Weisheng ; et al.
    In: IEICE transactions on electronics, Jg. 91 (2008), Heft 4, S. 517-525
    Online academicJournal
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    Evaluation of a Field-Programmable VLSI Based on an Asynchronous Bit-Serial Architecture : Advanced processors based on novel concepts in computation
    HARIYAMA, Masanori ; ISHIHARA, Shota ; et al.
    In: IEICE transactions on electronics, Jg. 91 (2008), Heft 9, S. 1419-1426
    Online academicJournal
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    Design and evaluation of a massively parallel processor based on matrix architecture : Novel device architectures and system integration technologies
    SHIMIZU, Toru ; NAKAJIMA, Masami ; et al.
    In: IEICE transactions on electronics, Jg. 89 (2006), Heft 11, S. 1512-1518
    Online academicJournal
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    A spread-spectrum clock generator using fractional-N PLL with an extended range ΣΔ modulator
    HSIEH, Yi-Bin ; KAO, Yao-Huang
    In: IEICE transactions on electronics, Jg. 89 (2006), Heft 6, S. 851-857
    Online academicJournal
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    Reducing consuming clock power optimization of a 90 nm embedded processor core : VLSI design technology in the sub-100 nm era
    YAMADA, Tetsuya ; ABE, Masahide ; et al.
    In: IEICE transactions on electronics, Jg. 89 (2006), Heft 3, S. 287-294
    Online academicJournal
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    Fast pulse driving of ferroelectric SBT capacitors in a nonvolatile latch
    KOYAMA, Shinzo ; KATO, Yoshihisa ; et al.
    In: IEICE transactions on electronics, Jg. 89 (2006), Heft 9, S. 1368-1372
    Online academicJournal
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