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    A Scalable 32–56 Gb/s 0.56–1.28 pJ/b Voltage-Mode VCSEL-Based Optical Transmitter in 28-nm CMOS
    Casper, Bryan K. ; Hsu, Chun-Ming ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-03-01), S. 757-766
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    A 0.8-V Resistor-Based Temperature Sensor in 65-nm CMOS With Supply Sensitivity of 0.28 °C/V.
    Park, Hyunmin ; Kim, Jintae
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-03-01), Heft 3, S. 906-912
    Online academicJournal
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    An IR-UWB CMOS Transceiver for High-Data-Rate, Low-Power, and Short-Range Communication
    Park, Jungwoon ; Tae Wook Kim ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-08-01), S. 2163-2174
    Online unknown
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    Ultra-Low Power 18-Transistor Fully Static Contention-Free Single-Phase Clocked Flip-Flop in 65-nm CMOS
    Cai, Yunpeng ; Savanth, Anand ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-02-01), S. 550-559
    Online unknown
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    A 4–20-Gb/s 1.87-pJ/b Continuous-Rate Digital CDR Circuit With Unlimited Frequency Acquisition Capability in 65-nm CMOS.
    Park, Kwanseo ; Lee, Kwangho ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-05-01), Heft 5, S. 1597-1607
    Online academicJournal
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    An IR-UWB CMOS Transceiver for High-Data-Rate, Low-Power, and Short-Range Communication.
    Lee, Geunhaeng ; Park, Jungwoon ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-08-01), Heft 8, S. 2163-2174
    Online academicJournal
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    A 3.4-pJ FeRAM-Enabled D Flip-Flop in 0.13-\mu \m CMOS for Nonvolatile Processing in Digital Systems.
    Qazi, Masood ; Amerasekera, Ajith ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014), Heft 1, S. 202-211
    Online academicJournal
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    Single-Inductor Quad-Output Switching Converter With Priority-Scheduled Program for Fast Transient Response and Unlimited Load Range in 40 nm CMOS Technology
    Lin, Kuei-Liang ; Peng, Ruei-Hong ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-07-01), S. 1525-1539
    Online unknown
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    A 16.1-bit Resolution 0.064-mm2 Compact Highly Digital Closed-Loop Single-VCO-Based 1-1 Sturdy-MASH Resistance-to-Digital Converter With High Robustness in 180-nm CMOS.
    Sacco, Elisa ; Vergauwen, Johan ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-09-01), Heft 9, S. 2456-2467
    Online academicJournal
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    A 12-bit 300-MS/s SAR ADC With Inverter-Based Preamplifier and Common-Mode-Regulation DAC in 14-nm CMOS FinFET.
    Luu, Danny ; Kull, Lukas ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-11-01), Heft 11, S. 3268-3279
    Online academicJournal
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    Software Assisted Digital RF Processor (DRP™) for Single-Chip GSM Radio in 90 nm CMOS
    Muhammad, Khurram ; Staszewski, Robert B. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010-02-01), S. 276-288
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    An Activity-Triggered 95.3 dB DR $-$75.6 dB THD CMOS Imaging Sensor With Digital Calibration
    Yuan, Jie ; Ho Yeung Chan ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 44 (2009-10-01), S. 2834-2843
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    A 4096-Neuron 1M-Synapse 3.8-pJ/SOP Spiking Neural Network With On-Chip STDP Learning and Sparse Weights in 10-nm FinFET CMOS.
    Chen, Gregory K. ; Kumar, Raghavan ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-04-01), Heft 4, S. 992-1002
    Online academicJournal
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    Ultra-Low Power 18-Transistor Fully Static Contention-Free Single-Phase Clocked Flip-Flop in 65-nm CMOS.
    Cai, Yunpeng ; Savanth, Anand ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-02-01), Heft 2, S. 550-559
    Online academicJournal
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    A Phase-Selecting Digital Phase-Locked Loop With Bandwidth Tracking in 65-nm CMOS Technology
    Maxey, Jay A. ; Hsieh, Ping-Hsuan ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010-04-01), S. 781-792
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    A Digital CMOS Architecture for a Micro-Hotplate Array
    Frey, Urs ; Graf, Markus ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 42 (2007-02-01), S. 441-450
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    Design and application of CMOS bulk input scheme
    Huang, Hong-Yi ; Lin, Jing-Fu
    In: IEEE Journal of Solid-State Circuits, Jg. 39 (2004-08-01), S. 1305-1312
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    Energy–Delay Optimization of 64-Bit Carry-Lookahead Adders With a 240 ps 90 nm CMOS Design Example
    Nikolic, Borivoje ; Zlatanovici, R. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 44 (2009-02-01), S. 569-583
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    A redundant multivalued logic for a 10-Gb/s CMOS demultiplexer IC
    Tanabe, A. ; Mogami, Tohru ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 38 (2003), S. 107-113
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    Minimum Energy Tracking Loop With Embedded DC–DC Converter Enabling Ultra-Low-Voltage Operation Down to 250 mV in 65 nm CMOS
    Ramadass, Yogesh ; Chandrakasan, Anantha P.
    In: IEEE Journal of Solid-State Circuits, Jg. 43 (2008), S. 256-265
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