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    An energy-efficient high-speed CMOS hybrid comparator with reduced delay time in 40-nm CMOS process.
    Huang, Sen ; Diao, Shengxi ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 89 (2016-10-01), Heft 1, S. 231-238
    Online academicJournal
    Zugriff:
    View record at Springer (Volltext)
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    An energy-efficient, 6 GS/s dynamic comparator in 90 nm CMOS technology.
    Amirkhan Dehkordi, Mehrdad ; Dolatshahi, Mehdi
    In: Analog Integrated Circuits & Signal Processing, Jg. 101 (2019-11-01), Heft 2, S. 319-330
    Online academicJournal
    Zugriff:
    View record at Springer (Volltext)
    Wie komme ich dran?
  3. Detailansicht für Treffer 3 öffnen
    Design and analysis of a high speed double-tail comparator with isomorphic latch-preamplifier pairs and tail bootstrapping.
    Rahmani, S. ; Ghaznavi-Ghoushchi, M.
    In: Analog Integrated Circuits & Signal Processing, Jg. 93 (2017-12-01), Heft 3, S. 507-521
    Online academicJournal
    Zugriff:
    View record at Springer (Volltext)
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  4. Detailansicht für Treffer 4 öffnen
    CNTFET based comparators: design, simulation and comparative analysis.
    Jogad, Seema ; Akhoon, M. Saqib ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 114 (2023-02-01), Heft 2, S. 265-273
    Online academicJournal
    Zugriff:
    View record at Springer (Volltext)
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  5. Detailansicht für Treffer 5 öffnen
    A novel low-power, low-offset, and high-speed CMOS dynamic latched comparator.
    Jeon, Heung ; Jun ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 70 (2012-03-01), Heft 3, S. 337-346
    Online academicJournal
    Zugriff:
    View record at Springer (Volltext)
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  6. Detailansicht für Treffer 6 öffnen
    Low-voltage dynamic comparator using positive feedback bulk effect on a floating inverter amplifier.
    Canal, Bruno ; Klimach, Hamilton D. ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 108 (2021-09-01), Heft 3, S. 511-524
    Online academicJournal
    Zugriff:
    View record at Springer (Volltext)
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    Design of a Dynamic ADC Comparator with Low Power and Low Delay Time for IoT Application.
    Nejadhasan, Sajad ; Mehrabi-Moghadam, Zahra ; et al.
    In: Wireless Personal Communications, Jg. 123 (2022-03-15), Heft 2, S. 1573-1591
    Online academicJournal
    Zugriff:
    Volltext (PDF)
    View record at Springer (Volltext)
    Siehe Detailanzeige für Volltext
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  8. Detailansicht für Treffer 8 öffnen
    Design and analysis of a SET tolerant single-phase clocked double-tail dynamic comparator.
    Wu, Hao ; Jin, Gang ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 112 (2022-08-01), Heft 2, S. 367-377
    Online academicJournal
    Zugriff:
    View record at Springer (Volltext)
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  9. Detailansicht für Treffer 9 öffnen
    Design of A 1-V 3rd-order 1-bit Σ-Δ modulator with inverter-based static–dynamic hybrid structure amplifiers.
    Chen, Xiao ; Wang, Zhi-gong ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 101 (2019-11-01), Heft 2, S. 351-361
    Online academicJournal
    Zugriff:
    View record at Springer (Volltext)
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