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    A wideband design analysis of LNA utilizing complimentary common gate stage with mutually coupled common source stage.
    Kumar, Manish ; Deolia, Vinay Kumar
    In: Analog Integrated Circuits & Signal Processing, Jg. 98 (2019-03-01), Heft 3, S. 575-585
    Online academicJournal
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    View record at Springer (Volltext)
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    A zero-crossing based 10-bit 100 MS/s pipeline ADC with controlled current in 90 nm CMOS.
    Shafti, Ali ; Yavari, Mohammad
    In: Analog Integrated Circuits & Signal Processing, Jg. 80 (2014-07-01), Heft 1, S. 141-151
    Online academicJournal
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    View record at Springer (Volltext)
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    An 87 fJ/conversion-step 12 b 10 MS/s SAR ADC using a minimum number of unit capacitors.
    Kim, Yong-Min ; Park, Jun-Sang ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 80 (2014-07-01), Heft 1, S. 49-57
    Online academicJournal
    Zugriff:
    View record at Springer (Volltext)
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    A high CMRR, class AB, fully differential current output stage.
    Faraji Baghtash, Hassan ; Ayatollahi, Ahmad
    In: Analog Integrated Circuits & Signal Processing, Jg. 78 (2014-02-01), Heft 2, S. 465-477
    Online academicJournal
    Zugriff:
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    Self-powered micro-watt level piezoelectric energy harvesting system with wide input voltage range.
    Nielsen-Lönn, Martin ; Angelov, Pavel ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 98 (2019-03-01), Heft 3, S. 441-451
    Online academicJournal
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    Two Novel Ultra-Low-Power SRAM Cells with Separate Read and Write Path.
    Naghizadeh, Shokoufeh ; Gholami, Mohammad
    In: Circuits, Systems & Signal Processing, Jg. 38 (2019), Heft 1, S. 287-303
    Online academicJournal
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    A current-controlled oscillator with temperature, voltage, and process compensation.
    Yang, Wei-Bin ; Chiang, Jen-Shiun ; et al.
    In: Microsystem Technologies, Jg. 24 (2018), Heft 1, S. 109-118
    Online academicJournal
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    A fast-lock and low-power DLL-based clock generator applied for DDR4.
    Lo, Yu-Lung ; Yang, Wei-Bin ; et al.
    In: Microsystem Technologies, Jg. 24 (2018), Heft 1, S. 137-146
    Online academicJournal
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    An active-RC reconfigurable lowpass-polyphase biquad filter for wireless receiver.
    Huang, C. ; Chen, C. ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 84 (2015-07-01), Heft 1, S. 97-105
    Online academicJournal
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    Analytical modeling of read noise margin of a CNFET based 6T SRAM cell.
    Saha, Priyanka ; Jain, Amit ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 83 (2015-06-01), Heft 3, S. 369-376
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    A source degenerated LC quadrature VCO (SD-QVCO) using 0.18-μm SiGe BiCMOS.
    Jain, Sanjeev ; Jang, Sheng-Lyang ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 76 (2013-08-01), Heft 2, S. 161-166
    Online academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    Two op-amps third-order sigma-delta modulator with 61-dB SNDR, 6-MHz bandwidth and 6-mW power consumption.
    Bonizzoni, Edoardo ; Perez, Aldo ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 66 (2011-03-01), Heft 3, S. 381-388
    Online academicJournal
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