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    A Low Noise Fault Tolerant Radiation Hardened 2.56 Gbps Clock-Data Recovery Circuit With High Speed Feed Forward Correction in 65 nm CMOS
    Prinzie, Jeffrey ; Francisco, R. ; et al.
    2020
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    Comparison of TFETs and CMOS using optimal design points for power-speed trade-offs
    Avedillo, Maria J. ; Núñez, Juan ; et al.
    2017
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    Characterization of 4 K CMOS devices and circuits for hybrid Josephson-CMOS systems
    Tokuda, M. ; Yoshikawa, Nobuyuki ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 15 (2005-06-01), Heft 2, Part 1, S. 267-271
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    An ultra-low-energy multi-standard JPEG co-processor in 65 nm CMOS with sub/near threshold supply voltage
    Ha, Yajun ; Pu, Yu ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010), Heft 3, S. 668-680
    Online unknown
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    Threshold voltage mismatch and intra-die leakage current in digital CMOS circuits
    Tuinhout, H. ; J. Pineda de Gyvez
    In: IEEE Journal of Solid-State Circuits, Jg. 39 (2004), Heft 1, S. 157-168
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    Custom transistor layout design techniques for random telegraph signal noise reduction in CMOS image sensors
    Havard, E. ; Magnan, Pierre ; et al.
    In: IEEE Electronics Letters, 2010
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    A 5.8 GHz 1 V linear power amplifier using a novel on-chip transformer power combiner in standard 90 nm CMOS
    Niknejad, Ali M. ; Reynaert, Patrick ; et al.
    2008
    Online unknown
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    Total dose evaluation of deep submicron CMOS imaging technology through elementary device and pixel array behavior analysis
    Bernard, Frédéric ; Rolland, Guy ; et al.
    In: IEEE Transactions on Nuclear Science, 2008-12-01
    Online unknown
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    A 0.5GHz CMOS digital RF memory chip
    Schnaitter, W.M. ; Gordon, B.E. ; et al.
    In: 1986 IEEE International Solid-State Circuits Conference. Digest of Technical Papers, 2005-03-23
    Online unknown
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    Sub-1-V CMOS proportional-to-absolute temperature references
    Huertas, José L. ; Serra-Graells, Francisco ; et al.
    In: IEEE Journal of Solid-State Circuits, 2003-01-06
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    7-decade tuning range CMOS OTA-C sinusoidal VCO
    Linares-Barranco, Bernabe ; Serrano-Gotarredona, Teresa ; et al.
    1998
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    LC-VCO design optimization methodology based on the gm/ID ratio for nanometer CMOS technologies
    Fiorelli, Rafaella ; Peralfas, Eduardo J. ; et al.
    2011
    Online unknown
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    Switching activity evaluation of CMOS digital circuits using logic timing simulation
    Valencia, Manuel ; Ruiz-de-Clavijo, P. ; et al.
    In: Electronics Letters, 2001
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    Ultra-Sensitive Capacitive Detection Based on SGMOSFET Compatible With Front-End CMOS Process
    Colinet, Eric ; Ionescu, Adrian M. ; et al.
    Online unknown
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  15. Detailansicht für Treffer 15 öffnen
    A 3.1 mW 8b 1.2 GS/s Single-Channel Asynchronous SAR ADC With Alternate Comparators for Enhanced Speed in 32 nm Digital SOI CMOS
    Pier Andrea Francese ; Toke Meyer Andersen ; et al.
    Online unknown
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  16. Detailansicht für Treffer 16 öffnen
    A Fully Integrated Switched-Capacitor-Based AC-DC Converter for a 120 VRMS Mains Interface
    Elly De Pelecijn ; Steyaert, Michiel ; et al.
    2019
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    Insights Into the Operation of Hyper-FET-Based Circuits
    Núñez, Juan ; Avedillo, Maria J. ; et al.
    2017
    Online unknown
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    Guest editor' introduction
    Erik Jan Marinissen ; Zorian, Yervant ; et al.
    In: IEEE Design & Test, Jg. 34 (2017-02-01), Heft 1, S. 6-7
    Online unknown
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    Improving speed of tunnel FETs logic circuits
    Avedillo, Maria J. ; Núñez, Juan ; et al.
    2015
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    Ultralow-power processing array for image enhancement and edge detection
    Rodríguez-Vázquez, Ángel ; Carmona-Galan, Ricardo ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, 2012
    Online unknown
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    Wie komme ich dran?
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