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    Body-Bias-Driven Design Strategy for Area- and Performance-Efficient CMOS Circuits
    MEIJER, Maurice ; DE GYVEZ, José Pineda
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 1, S. 42-51
    Online academicJournal
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    A Wide-Range PLL Using Self-Healing Prescaler/VCO in 65-nm CMOS
    LEE, I-Ting ; TSAI, Yun-Ta ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 21 (2013), Heft 2, S. 250-258
    Online academicJournal
    Zugriff:
    Volltext
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    Low-Cost Error Tolerance Scheme for 3-D CMOS Imagers
    CHANG, Hsiu-Ming ; HUANG, Jiun-Lang ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 21 (2013), Heft 3, S. 465-474
    Online academicJournal
    Zugriff:
    Volltext
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  4. Detailansicht für Treffer 4 öffnen
    CS-CMOS: A Low-Noise Logic Family for Mixed Signal SoCs
    TAPARIA, Ajay ; BANERJEE, Bhaskar ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 12, S. 2141-2148
    Online academicJournal
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    Volltext
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    FPGA Based on Integration of CMOS and RRAM
    TANACHUTIWAT, Sansiri ; MING, LIU ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 11, S. 2023-2032
    Online academicJournal
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    Volltext
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    Compressive Acquisition CMOS Image Sensor: From the Algorithm to Hardware Implementation
    MILIN, ZHANG ; BERMAK, Amine
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 18 (2010), Heft 3, S. 490-500
    Online academicJournal
    Zugriff:
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    Time-Domain CMOS Temperature Sensors With Dual Delay-Locked Loops for Microprocessor Thermal Monitoring
    DONGWAN, HA ; WOO, Kyoungho ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 9, S. 1590-1601
    Online academicJournal
    Zugriff:
    Volltext
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  8. Detailansicht für Treffer 8 öffnen
    Temperature Characteristics and Analysis of Monolithic Microwave CMOS Distributed Oscillators With Gm - -Varied Gain Cells and Folded Coplanar Interconnects
    BHATTACHARYYA, Kalyan ; SZYMANSKI, Ted H
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 7, S. 1332-1336
    Online academicJournal
    Zugriff:
    Volltext
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    Dynamic Supply and Threshold Voltage Scaling for CMOS Digital Circuits Using In-Situ Power Monitor
    MEHTA, Nandish ; AMRUTUR, Bharadwaj
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 5, S. 892-901
    Online academicJournal
    Zugriff:
    Volltext
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  10. Detailansicht für Treffer 10 öffnen
    A Low-Power Gigabit CMOS Limiting Amplifier Using Negative Impedance Compensation and Its Application
    HAN, Jungwon ; YOO, Kwisung ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 3, S. 393-399
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    A CMOS MEMS Audio Transducer Implemented by Silicon Condenser Microphone With Analog Front-End Circuits of Audio Codec
    CHIANG, Cheng-Ta ; WANG, Chih-Hsien ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 9, S. 1656-1667
    Online academicJournal
    Zugriff:
    Volltext
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  12. Detailansicht für Treffer 12 öffnen
    A 3―5 GHz Current-Reuse gm-Boosted CG LNA for Ultrawideband in 130 nm CMOS
    KHURRAM, Muhammad ; HASAN, S. M. Rezaul
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 3, S. 400-409
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Variable Input Delay CMOS Logic for Low Power Design
    RAJA, Tezaswi ; AGRAWAL, Vishwani D ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 17 (2009), Heft 10, S. 1534-1545
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    A Sub-1 V, 26 μW, Low-Output-Impedance CMOS Bandgap Reference With a Low Dropout or Source Follower Mode
    NG, David C. W ; KWONG, David K. K ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 7, S. 1305-1309
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    A Digital CMOS Parallel Counter Architecture Based on State Look-Ahead Logic
    ABDEL-HAFEEZ, Saleh ; GORDON-ROSS, Ann
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 6, S. 1023-1033
    Online academicJournal
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  16. Detailansicht für Treffer 16 öffnen
    Design and Application of Power Optimized High-Speed CMOS Frequency Dividers
    HENZLER, Stephan ; KOEPPE, Siegmar
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 16 (2008), Heft 11, S. 1513-1520
    Online academicJournal
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  17. Detailansicht für Treffer 17 öffnen
    Properties of Digital Switching Currents in Fully CMOS Combinational Logic
    BOSELLI, Giorgio ; TRUCCO, Gabriella ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 18 (2010), Heft 12, S. 1625-1638
    Online academicJournal
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  18. Detailansicht für Treffer 18 öffnen
    Fully CMOS-Compatible On-Chip Optical Clock Distribution and Recovery
    THANGARAJ, Charles ; POWNALL, Robert ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 18 (2010), Heft 10, S. 1385-1398
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  19. Detailansicht für Treffer 19 öffnen
    A low power fully CMOS integrated RF transceiver IC for wireless sensor networks
    SEO, Hae-Moon ; MOON, Yeonkug ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 15 (2007), Heft 2, S. 227-231
    Online academicJournal
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    Design of Parasitic and Process-Variation Aware Nano-CMOS RF Circuits: A VCO Case Study
    GHAI, Dhruva ; MOHANTY, Saraju P ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 17 (2009), Heft 9, S. 1339-1342
    Online academicJournal
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