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    A 1.9GHz Low-Phase-Noise Complementary Cross-Coupled FBAR-VCO without Additional Voltage Headroom in 0.18µm CMOS Technology
    Esashi, Masayoshi ; Tanaka, Shuji ; et al.
    In: IEICE Transactions on Electronics, 2017, S. 363-369
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    Optimization on Layout Strategy of Gate-Grounded NMOS for On-Chip ESD Protection in a 65-nm CMOS Process
    Lu, Guangyi ; Wang, Yuan ; et al.
    In: IEICE Transactions on Electronics, 2016, S. 590-596
    Online unknown
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    CMOS Majority Circuit with Large Fan-In
    Madrenas, Jordi ; Sato, Shigeo ; et al.
    In: IEICE Transactions on Electronics, 2016, S. 1056-1064
    Online unknown
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    A 60-GHz CMOS Transmitter with Gain-Enhanced On-Chip Antenna for Short-Range Wireless Interconnections
    Wu, Rui ; Sakane, Hitoshi ; et al.
    In: IEICE Transactions on Electronics, 2015-04-01, Heft No. 4, S. 304-314
    Online unknown
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    A 5-GHz Band WLAN SiGe HBT Power Amplifier IC with Novel Adaptive-Linearizing CMOS Bias Circuit
    Yoshimasu, Toshihiko ; Yang, Xin ; et al.
    In: IEICE Transactions on Electronics, 2015, S. 651-658
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    Characterization of Crossing Transmission Line Using Two-Port Measurements for Millimeter-Wave CMOS Circuit Design
    Tokgoz, Korkut ; Kaan ; et al.
    In: IEICE Transactions on Electronics, 2015, Heft No. 1, S. 35-44
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    A Sub-1mW Class-C-VCO-Based Low Voltage PLL with Ultra-Low-Power Digitally-Calibrated ILFD in 65nm CMOS
    Ikeda, Sho ; Kamimura, Tatsuya ; et al.
    In: IEICE TRANSACTIONS on Electronics, 2014-06-01, Heft no. 6, S. 495-504
    Online unknown
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    A 2-Gb/s CMOS SLVS Transmitter with Asymmetric Impedance Calibration for Mobile Interfaces
    Jang, Young-Chan ; Lee, Kwang-Hun
    In: IEICE Transactions on Electronics, 2014, S. 837-840
    Online unknown
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    Two-Stage Band-Selectable CMOS Power Amplifiers Using Inter-Stage Frequency Tuning
    Matsuzawa, Akira ; Jee Young Hong ; et al.
    In: IEICE Transactions on Electronics, 2012-02-01, Heft No. 2, S. 290-296
    Online unknown
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    An Area-Efficient, Low-Power CMOS Fractional Bandgap Reference
    Indika U. K. Bogoda Appuhamylage ; Okura, Shunsuke ; et al.
    In: IEICE Transactions on Electronics, 2011, S. 960-967
    Online unknown
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    Novel DEM Technique for Current-Steering DAC in 65-nm CMOS Technology
    Guo, Guangliang ; Su, Wei ; et al.
    In: IEICE Transactions on Electronics, 2015, S. 1193-1195
    Online unknown
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  12. Detailansicht für Treffer 12 öffnen
    A 4-Gbps Quasi-Millimeter-Wave Transmitter in 65 nm CMOS and a Fast Carrier and Symbol Timing Recovery Scheme
    Kulkarni, Vishal V. ; Ishikuro, Hiroki ; et al.
    In: IEICE Transactions on Electronics, 2010, S. 120-127
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    An Arbitrary Digital Power Noise Generator Using 65 nm CMOS Technology
    Kosaka, Daisuke ; Nagata, Makoto ; et al.
    In: IEICE Transactions on Electronics, 2010, S. 820-826
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    An On-Chip PVT Compensation Technique with Current Monitoring Circuit for Low-Voltage CMOS Digital LSIs
    Amemiya, Yoshihito ; Asai, Tetsuya ; et al.
    In: IEICE Transactions on Electronics, 2010, S. 835-841
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  15. Detailansicht für Treffer 15 öffnen
    A Transformer Noise-Canceling Ultra-Wideband CMOS Low-Noise Amplifier
    Kihara, Takao ; Taniguchi, Kenji ; et al.
    In: IEICE Transactions on Electronics, 2010, S. 187-199
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  16. Detailansicht für Treffer 16 öffnen
    Design and Implementation of 10-Gb/s Optical Receiver Analog Front-End in 0.13-.MU.m CMOS Technology
    Moon, Jong-Kook ; Kim, Chang-Joon ; et al.
    In: IEICE Transactions on Electronics, 2010, S. 393-398
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  17. Detailansicht für Treffer 17 öffnen
    An Integrated CMOS Front-End Receiver with a Frequency Tripler for V-Band Applications
    Chun Lin Ko ; Chen, Po-Hung ; et al.
    In: IEICE Transactions on Electronics, 2010, S. 877-883
    Online unknown
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  18. Detailansicht für Treffer 18 öffnen
    A 0.13 .MU.m CMOS Bluetooth EDR Transceiver with High Sensitivity over Wide Temperature Range and Immunity to Process Variation
    Agawa, Kenichi ; Koizumi, Masayuki ; et al.
    In: IEICE Transactions on Electronics, 2010, S. 803-811
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    A 580fs-Resolution Time-to-Digital Converter Utilizing Differential Pulse-Shrinking Buffer Ring in 0.18µm CMOS Technology
    Iizuka, Tetsuya ; Miura, Satoshi ; et al.
    In: IEICE Transactions on Electronics, 2012, S. 661-667
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    A 0.31 pJ/Conversion-Step 12-Bit 100 MS/s 0.13 .MU.m CMOS A/D Converter for 3G Communication Systems
    Lee, Myung-Hwan ; Lee, Seung-Hoon ; et al.
    In: IEICE Transactions on Electronics, 2009, S. 1194-1200
    Online unknown
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