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    Graphene for CMOS and Beyond CMOS Applications
    BANERJEE, Sanjay K ; FRANKLIN, Leonard ; et al.
    In: NANOELECTRONICS RESEARCH FOR BEYOND CMOS INFORMATION PROCESSING, Jg. 98 (2010), Heft 12, S. 2032-2046
    Online academicJournal
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    Enhancing CMOS Using Nanoelectronic Devices: A Perspective on Hybrid Integrated Systems
    RICKETTS, David S ; BAIN, James A ; et al.
    In: NANOELECTRONICS RESEARCH FOR BEYOND CMOS INFORMATION PROCESSING, Jg. 98 (2010), Heft 12, S. 2061-2075
    Online academicJournal
    Zugriff:
    Volltext
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    Growing Cells Atop Microelectronic Chips: Interfacing Electrogenic Cells In Vitro With CMOS-Based Microelectrode Arrays
    HIERLEMANN, Andreas ; FREY, Urs ; et al.
    In: Proceedings of the IEEE, Jg. 99 (2011), Heft 2, S. 252-284
    Online academicJournal
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    Volltext
    Wie komme ich dran?
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    Device and Architecture Outlook for Beyond CMOS Switches
    BERNSTEIN, Kerry ; CAVIN, Ralph K ; et al.
    In: NANOELECTRONICS RESEARCH FOR BEYOND CMOS INFORMATION PROCESSING, Jg. 98 (2010), Heft 12, S. 2169-2184
    Online academicJournal
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    Analog Circuit Design in Nanoscale CMOS Technologies
    LEWYN, Lanny L ; YTTERDAL, Trond ; et al.
    In: Proceedings of the IEEE, Jg. 97 (2009), Heft 10, S. 1687-1714
    Online academicJournal
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    Overview of Beyond-CMOS Devices and a Uniform Methodology for Their Benchmarking
    NIKONOV, Dmitri E ; YOUNG, Ian A
    In: Proceedings of the IEEE, Jg. 101 (2013), Heft 12, S. 2498-2533
    Online academicJournal
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    Low-Voltage Tunnel Transistors for Beyond CMOS Logic
    SEABAUGH, Alan C ; QIN, ZHANG
    In: NANOELECTRONICS RESEARCH FOR BEYOND CMOS INFORMATION PROCESSING, Jg. 98 (2010), Heft 12, S. 2095-2110
    Online academicJournal
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    Computer-aided design for low-power robust computing in nanoscale CMOS
    SYLVESTER, Dennis ; SRIVASTAVA, Ashish
    In: Leading-edge computer aided design solutions for advanced digital and mixed-signal systems-on-chips, Jg. 95 (2007), Heft 3, S. 507-529
    Online academicJournal
    Zugriff:
    Volltext
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    Leakage current mechanisms and leakage reduction techniques in deep-submicrometer CMOS circuits
    ROY, Kaushik ; MUKHOPADHYAY, Saibal ; et al.
    In: Proceedings of the IEEE, Jg. 91 (2003), Heft 2, S. 305-327
    Online academicJournal
    Zugriff:
    Volltext
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    Adaptive CMOS: From biological inspiration to systems-on-a-chip
    DIORIO, Chris ; HSU, David ; et al.
    In: Proceedings of the IEEE, Jg. 90 (2002), Heft 3, S. 343-357
    Online academicJournal
    Zugriff:
    Volltext
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    Digital Circuit Design Challenges and Opportunities in the Era of Nanoscale CMOS : Small transistors necessitate big changes, in the way digital circuits are modeled and optimized for manufacturability, and new strategies for logic, memory, clocking and power distribution
    CALHOUN, Benton H ; YU, CAO ; et al.
    In: A Future of Integrated Electronics: Moving Off the Roadmap, Jg. 96 (2008), Heft 2, S. 343-365
    Online academicJournal
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    Nanotube electronics: Non-CMOS routes
    XU, Jimmy
    In: Nanoelectronics and nasoscale processing, Jg. 91 (2003), Heft 11, S. 1819-1829
    Online academicJournal
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    Extremely scaled silicon nano-CMOS devices
    LELAND, CHANG ; CHOI, Yang-Kyu ; et al.
    In: Nanoelectronics and nasoscale processing, Jg. 91 (2003), Heft 11, S. 1860-1873
    Online academicJournal
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    CMOS and Memristor-Based Neural Network Design for Position Detection
    EBONG, Idongesit E ; MAZUMDER, Pinaki
    In: Memristors: Devices, Models & Applications, Jg. 100 (2012), Heft 6, S. 2050-2060
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    Nanoarchitectonics for Heterogeneous Integrated Nanosystems : Research on nanomaterials aims at development of smaller and smaller CMOS devices and also at increasing device functioning at low dissipation power
    WANG, Kang L ; GALATSIS, Kosmas ; et al.
    In: A Future of Integrated Electronics: Moving Off the Roadmap, Jg. 96 (2008), Heft 2, S. 212-229
    Online academicJournal
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    Analog-to-Digital Converters: Digitizing the Analog World : New mixed-signal CMOS circuits, that eliminate the need for op-amps, may be capable of performing data conversion at dramatically lower power consumption
    LEE, Hae-Seung ; SODINI, Charles G
    In: A Future of Integrated Electronics: Moving Off the Roadmap, Jg. 96 (2008), Heft 2, S. 323-334
    Online academicJournal
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    Is a New Paradigm for Nanoscale Analog CMOS Design Needed?
    LEWYN, Lanny ; WILLIAMS, Nicolas
    In: Proceedings of the IEEE, Jg. 99 (2011), Heft 1, S. 3-6
    Online academicJournal
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  18. Detailansicht für Treffer 18 öffnen
    Mitigating Memory Wall Effects in High-Clock-Rate and Multicore CMOS 3-D Processor Memory Stacks : Simulations indicate that 3-D stacking of memory chips can overcome memory limitations on computer processing by allowing for faster clock rates or improved transfer of data and address information
    JACOB, Philip ; ZIA, Aamir ; et al.
    In: 3-D Integration Technologies, Jg. 97 (2009), Heft 1, S. 108-122
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    Limitations and challenges of computer-aided design technology for CMOS VLSI
    BRYANT, Randal E ; CHENG, Kwang-Ting ; et al.
    In: The Limits of Semiconductor Technology, Jg. 89 (2001), Heft 3, S. 341-365
    Online academicJournal
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    CMOS RF integrated circuits at 5 GHz and beyond
    LEE, Thomas H ; WONG, S. Simon
    In: Special issue on low-power RF systems, Jg. 88 (2000), Heft 10, S. 1560-1571
    Online academicJournal
    Zugriff:
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