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    A hybrid CDAC-threshold configuring SAR ADC in 28nm FDSOI CMOS.
    Kilic, Mustafa ; Mavrogordatos, Themistoklis G. ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 97 (2018-12-01), Heft 3, S. 397-404
    Online academicJournal
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    Design of a 12.8 ENOB, 1 kS/s pipelined SAR ADC in 0.35-μm CMOS.
    Chen, Kairang ; Harikumar, Prakash ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 86 (2016), Heft 1, S. 87-98
    Online academicJournal
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    High Energy Efficiency and Linearity Switching Scheme Without Reset Energy for SAR ADC.
    Tong, Xingyuan ; Zhao, Shimei ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 41 (2022-10-01), Heft 10, S. 5872-5894
    Online academicJournal
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    Analysis and Design of an Efficient 8-Bit 2b/Cycle SAR ADC with Multiple Calibration Techniques.
    Chen, Yushi ; Yuan, Yuan ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 41 (2022-05-01), Heft 5, S. 2541-2565
    Online academicJournal
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    A high-efficient dynamic comparator with low-offset in weak inversion region.
    Fan, Hua ; Lei, Peng ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 110 (2022), Heft 1, S. 175-183
    Online academicJournal
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    An energy-efficient switching scheme based on the improved semi-resting DAC structure and floating-capacitor technique for SAR ADC.
    Huang, Yi ; Huang, Linlin ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 108 (2021-09-01), Heft 3, S. 679-687
    Online academicJournal
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    MSB-split VCM-based charge recovery symmetrical switching with set-and-down asymmetrical switching method for dual-capacitive arrays SAR ADC.
    Lu, Yewangqing ; Zhou, Ting ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 106 (2021-03-01), Heft 3, S. 669-681
    Online academicJournal
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    An energy efficient SAR ADC with lowest total switching energy consumption.
    Ghanavati, B. ; Abiri, E. ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 97 (2018-10-01), Heft 1, S. 123-133
    Online academicJournal
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    Low-power C-R hybrid D/A conversion network for SAR A/D converter.
    Tong, X. ; Li, F.
    In: Analog Integrated Circuits & Signal Processing, Jg. 80 (2014-07-01), Heft 1, S. 159-162
    Online academicJournal
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    An 8/10 bit 200/100MS/s configurable asynchronous SAR ADC.
    Zhu, Zhangming ; Xiao, Yu ; et al.
    In: Analog Integrated Circuits & Signal Processing, Jg. 77 (2013-11-01), Heft 2, S. 249-255
    Online academicJournal
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