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    Exposure-Programmable CMOS Pixel With Selective Charge Storage and Code Memory for Computational Imaging.
    Luo, Yi ; Ho, Derek ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 65 (2018-05-01), Heft 5, S. 1555-1566
    Online serialPeriodical
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    A 1.2V-to-0.4V 3.2GHz-to-14.3MHz Power-Efficient 3-Port Register File in 65-nm CMOS.
    Sarfraz, Khawar ; Chan, Mansun
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 64 (2017-02-01), Heft 2, S. 360-372
    Online serialPeriodical
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    Non-Volatile Approximate Arithmetic Circuits Using Scalable Hybrid Spin-CMOS Majority Gates.
    Jiang, Honglan ; Angizi, Shaahin ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 68 (2021-03-01), Heft 3, S. 1217-1230
    Online serialPeriodical
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    A 0.14-to-0.29-pJ/bit 14-GBaud/s Trimodal (NRZ/PAM-4/PAM-8) Half-Rate Bang-Bang Clock and Data Recovery (BBCDR) Circuit in 28-nm CMOS.
    Zhao, Xiaoteng ; Chen, Yong ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 68 (2021), Heft 1, S. 89-102
    Online serialPeriodical
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    Deep Neural Network (DNN) Optimized Design of 2.45 GHz CMOS Rectifier With 73.6% Peak Efficiency for RF Energy Harvesting.
    Lau, Wendy Wee Yee ; Ho, Heng Wah ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 67 (2020-12-01), Heft 12, S. 4322-4333
    Online serialPeriodical
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    A 17 Gbps 156 fJ/bit Two-Channel Optical Receiver With Optical-Input Split and Delay in 65 nm CMOS.
    Taherzadeh-Sani, Mohammad ; Radi, Bahaa ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 67 (2020-07-01), Heft 7, S. 2288-2296
    Online serialPeriodical
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    In-Hardware Training Chip Based on CMOS Invertible Logic for Machine Learning.
    Onizawa, Naoya ; Smithson, Sean C. ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 67 (2020-05-01), Heft 5, S. 1541-1550
    Online serialPeriodical
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    A 2.12-V $V_{pp}~11.67$ -pJ/pulse Fully Integrated UWB Pulse Generator in 65-nm CMOS Technology.
    Gao, Shengkai ; Moez, Kambiz
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 67 (2020-03-01), Heft 3, S. 1058-1068
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    A 40-Gb/s PAM-4 Transmitter Using a 0.16-pJ/bit SST-CML-Hybrid (SCH) Output Driver and a Hybrid-Path 3-Tap FFE Scheme in 28-nm CMOS.
    Fan, Chao ; Yu, Wei-Han ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 66 (2019-12-01), Heft 12, S. 4850-4861
    Online serialPeriodical
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  10. Detailansicht für Treffer 10 öffnen
    A 14-bit 250 MS/s IF Sampling Pipelined ADC in 180 nm CMOS Process.
    Zheng, Xuqiang ; Wang, Zhijun ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 63 (2016-09-01), Heft 9, S. 1381-1392
    Online serialPeriodical
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    A 0.45-V Low-Power OOK/FSK RF Receiver in 0.18 \mu\textm CMOS Technology for Implantable Medical Applications.
    Hsieh, Jian-Yu ; Huang, Yi-Chun ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 63 (2016-08-01), Heft 8, S. 1123-1130
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  12. Detailansicht für Treffer 12 öffnen
    Low-Power Near-Threshold 10T SRAM Bit Cells With Enhanced Data-Independent Read Port Leakage for Array Augmentation in 32-nm CMOS.
    Gupta, Shourya ; Gupta, Kirti ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 66 (2019-03-01), Heft 3, S. 978-988
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  13. Detailansicht für Treffer 13 öffnen
    A 60 GHz Drain-Source Neutralized Wideband Linear Power Amplifier in 28 nm CMOS.
    Thyagarajan, Siva V. ; Niknejad, Ali M. ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 61 (2014-08-01), Heft 8, S. 2253-2262
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  14. Detailansicht für Treffer 14 öffnen
    A 0.6-V 10-bit 200-kS/s Fully Differential SAR ADC With Incremental Converting Algorithm for Energy Efficient Applications.
    Song, Yan ; Xue, Zhongming ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 63 (2016-04-01), Heft 4, S. 449-458
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    A Near-Threshold Voltage Oriented Digital Cell Library for High-Energy Efficiency and Optimized Performance in 65nm CMOS Process.
    Jun, Jaehun ; Song, Jaegeun ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 65 (2018-05-01), Heft 5, S. 1567-1580
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    Design-Oriented Energy Models for Wide Voltage Scaling Down to the Minimum Energy Point.
    Jain, Saurabh ; Lin, Longyang ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 64 (2017-12-01), Heft 12, S. 3115-3125
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    A 3x blind ADC-based CDR for a 20 dB loss channel.
    Jalali, Mohammad Sadegh ; Ting, Clifford ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 62 (2015-06-01), Heft 6, S. 1658-1667
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    A 0.3 V 10-bit 1.17 f SAR ADC With Merge and Split Switching in 90 nm CMOS.
    Lin, Jin-Yi ; Hsieh, Chih-Cheng
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 62 (2015), Heft 1, S. 70-79
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    A 14 Bit 500 MS/s CMOS DAC Using Complementary Switched Current Sources and Time-Relaxed Interleaving DRRZ.
    Li, Xueqing ; Wei, Qi ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 61 (2014-08-01), Heft 8, S. 2337-2347
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    A 3.54 nJ/bit-RX, 0.671 nJ/bit-TX Burst Mode Super-Regenerative UWB Transceiver in 0.18-\mum CMOS.
    Zheng, Yuanjin ; Zhu, Yao ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 61 (2014-08-01), Heft 8, S. 2473-2481
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