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    Silicon nanowire CMOS NOR logic gates featuring one-volt operation on bendable substrates
    Kim, Sangsig ; Moon, Jeongje ; et al.
    In: Nano Research, Jg. 11 (2018-05-01), S. 2625-2631
    Online unknown
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    CMOS- compatible fabrication method of graphene-based micro devices
    Czajka, Ryszard ; El-Ahmar, Semir ; et al.
    In: Materials Science in Semiconductor Processing, Jg. 67 (2017-08-01), S. 92-97
    Online unknown
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    Novel Fabrication Method for Forming Damage-Free Sensing Oxide and Threshold Voltage-Tunable Complementary Metal-Oxide Semiconductor in a pH Sensor-CMOS Hybrid System
    Kim, Sihyun ; Lee, Ryoongbin ; et al.
    In: Journal of Nanoscience and Nanotechnology, Jg. 17 (2017-11-01), S. 8265-8270
    Online unknown
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    Mixed-mode simulation and analysis of 3D double gate junctionless nanowire transistor for CMOS circuit applications
    Baishya, Srimanta ; Baidya, Achinta ; et al.
    In: Superlattices and Microstructures, Jg. 100 (2016-12-01), S. 14-23
    Online unknown
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    CMOS-Technology-Enabled Flexible and Stretchable Electronics for Internet of Everything Applications
    Hussain, Aftab M. ; Muhammad Mustafa Hussain
    In: Advanced Materials, Jg. 28 (2015-11-26), S. 4219-4249
    Online unknown
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    pMOSFETs Featuring ALD W Filling Metal Using SiH4 and B2H6 Precursors in 22 nm Node CMOS Technology
    Ye, Tianchun ; Yin, Huaxiang ; et al.
    In: Nanoscale Research Letters, Jg. 12 (2017-04-26)
    Online unknown
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    Ultralow-Loss CMOS Copper Plasmonic Waveguides
    Kirtaev, Roman V. ; Yakubovsky, Dmitry I. ; et al.
    In: Nano letters, Jg. 16 (2015-12-15), Heft 1
    Online unknown
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    Monolithic 3D CMOS Using Layered Semiconductors
    He, Jr-Hau ; Zeng, Yuping ; et al.
    In: Advanced materials (Deerfield Beach, Fla.), Jg. 28 (2015-10-16), Heft 13
    Online unknown
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    In Situ Analysis of Oxygen Vacancies and Band Alignment in HfO2/TiN Structure for CMOS Applications
    Lu, Hong-Liang ; Yu, Lin-Jie ; et al.
    In: Nanoscale Research Letters, Jg. 12 (2017-04-27)
    Online unknown
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    Droplet-Confined Alternate Pulsed Epitaxy of GaAs Nanowires on Si Substrates down to CMOS-Compatible Temperatures
    Balaghi, Leila ; Schneider, Harald ; et al.
    In: Nano letters, Jg. 16 (2016-06-29), Heft 7
    Online unknown
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    High aspect ratio sharp nanotip for nanocantilever integration at CMOS compatible temperature
    Chee Yee Kwok ; Wang, Peng ; et al.
    In: Nanotechnology, Jg. 28 (2017-07-18), S. 32LT01
    Online unknown
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  12. Detailansicht für Treffer 12 öffnen
    Single-donor ionization energies in a nanoscale CMOS channel
    Jehl, Xavier ; Sanquer, Marc ; et al.
    In: Nature Nanotechnology, 2010
    Online unknown
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    Volltext (PDF)
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  13. Detailansicht für Treffer 13 öffnen
    The Ge condensation technique: a solution for planar SOI/GeOI co-integration for advanced CMOS technologies?
    Clavelier, Laurent ; Campidelli, Yves ; et al.
    2008
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  14. Detailansicht für Treffer 14 öffnen
    Observation of Twin-free GaAs Nanowire Growth Using Template-Assisted Selective Epitaxy
    Riel, Heike ; Knoedler, Moritz ; et al.
    In: Crystal Growth & Design, Jg. 17 (2017-10-16), S. 6297-6302
    Online unknown
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  15. Detailansicht für Treffer 15 öffnen
    Ion implantation of advanced silicon devices: Past, present and future
    Current, Michael I.
    In: Materials Science in Semiconductor Processing, Jg. 62 (2017-05-01), S. 13-22
    Online unknown
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  16. Detailansicht für Treffer 16 öffnen
    Three-input gate logic circuits on chemically assembled single-electron transistors with organic and inorganic hybrid passivation layers
    Matsuzaki, Kosuke ; Azuma, Yasuo ; et al.
    In: Science and Technology of Advanced Materials, Jg. 18 (2017-12-01), Heft 1, S. 374-380
    Online unknown
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  17. Detailansicht für Treffer 17 öffnen
    Quantum ballistic analysis of transition metal dichalcogenides based double gate junctionless field effect transistor and its application in nano-biosensor
    Khosru, Quazi D. M. ; Shadman, Abir ; et al.
    In: Superlattices and Microstructures, Jg. 111 (2017-11-01), S. 414-422
    Online unknown
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  18. Detailansicht für Treffer 18 öffnen
    Phosphorus monolayer doping (MLD) of silicon on insulator (SOI) substrates
    Monaghan, Scott ; Holmes, Justin D. ; et al.
    In: Beilstein Journal of Nanotechnology, Jg. 9 (2018-08-01), S. 2106-2113
    Online unknown
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  19. Detailansicht für Treffer 19 öffnen
    Fully gravure printed complementary carbon nanotube TFTs for a clock signal generator using an epoxy-imine based cross-linker as an n-dopant and encapsulant
    Cho, Gyoujin ; Javey, Ali ; et al.
    In: Nanoscale, Jg. 8 (2016), S. 19876-19881
    Online unknown
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  20. Detailansicht für Treffer 20 öffnen
    Realizing Stable p-Type Transporting in Two-Dimensional WS2 Films
    Zhu, Hao ; David Wei Zhang ; et al.
    In: ACS Applied Materials & Interfaces, Jg. 9 (2017-05-16), S. 18215-18221
    Online unknown
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