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    An amplifier-offset-insensitive and high PSRR subthreshold CMOS voltage reference
    Zhan, Chenchang ; Wang, Lidan ; et al.
    In: International Journal of Circuit Theory and Applications, Jg. 46 (2017-07-17), S. 259-271
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    Threshold voltage extraction techniques adaptable from sub-micron CMOS to large-area oxide TFT technologies
    Samanta, Smrutilekha ; Barquinha, Pedro ; et al.
    In: International Journal of Circuit Theory and Applications, Jg. 45 (2017-04-05), S. 2201-2210
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    Automating the sizing of transistors in CMOS gates for low-power and high-noise margin operation
    Beg, Azam
    In: International Journal of Circuit Theory and Applications, Jg. 43 (2014-10-16), S. 1637-1654
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    900 MHZ radio-frequency identification rectifier with optimization and reusing of electro-static discharges protections in 180 nm digital CMOS technology
    Boni, Andrea ; Bigi, Marco
    In: International Journal of Circuit Theory and Applications, Jg. 43 (2014-10-10), S. 1655-1670
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    A 5.25-V-tolerant bidirectional I/O circuit in a 28-nm CMOS process
    Ahn, Keun-Seon ; Yoo, Changsik ; et al.
    In: International Journal of Circuit Theory and Applications, Jg. 43 (2014-03-05), S. 822-828
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    BDD-based synthesis for mixed CMOS/PTL logic
    Kao, Chi-Chou
    In: International Journal of Circuit Theory and Applications, Jg. 39 (2010-04-29), S. 923-932
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    A design example of a 65 nm CMOS operational amplifier
    Schlogl, F. ; Zimmermann, Horst
    In: International Journal of Circuit Theory and Applications, Jg. 35 (2007-05-01), S. 343-354
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    Synthesis of CMOS analog circuit VHDL-AMS descriptions using parameterizable macromodels
    José Ángel Díaz-Madrid ; Ruiz-Merino, Ramón ; et al.
    In: International Journal of Circuit Theory and Applications, Jg. 41 (2011-12-22), S. 732-742
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    Analytical estimation of propagation delay and short-circuit power dissipation in CMOS gates
    Chatzigeorgiou, Alexander ; Nikolaidis, Spiridon
    In: International Journal of Circuit Theory and Applications, Jg. 27 (1999-07-01), S. 375-392
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    New CMOS current mirrors with improved high-frequency response
    Stivala, S. ; Palumbo, Gaetano ; et al.
    In: International Journal of Circuit Theory and Applications, Jg. 21 (1993-09-01), S. 443-450
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    A new analytical/iterative approach to statistical delay characterization of cmos digital combinational circuits
    Aftab, Syed A. ; Styblinski, M.A.
    In: International Journal of Circuit Theory and Applications, Jg. 23 (1995), S. 23-47
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    Theory of Transmission Switches and Its Application to Design of CMOS Digital Circuits
    Wu, X.
    In: International Journal of Circuit Theory and Applications, Jg. 20 (1992-07-01), S. 349-356
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    Parametric yield optimization of CMOS analogue circuits by quadratic statistical circuit performance models
    Kang, Sung-Mo ; Yu, Tat-Kwan ; et al.
    In: International Journal of Circuit Theory and Applications, Jg. 19 (1991-11-01), S. 579-592
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    A global delay model for domino cmos circuits with application to transistor sizing
    Kang, Sung-Mo ; Chen, H. Y.
    In: International Journal of Circuit Theory and Applications, Jg. 18 (1990-05-01), S. 289-306
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    Gate-level body biasing technique for high-speed sub-threshold CMOS logic gates
    Perri, Stefania ; Lanuzza, Marco ; et al.
    In: International Journal of Circuit Theory and Applications, Jg. 42 (2012-08-01), S. 65-70
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    Efficient output waveform evaluation of a CMOS inverter based on short-circuit current prediction
    Nikolaidis, Spiridon ; Chatzigeorgiou, Alexander
    In: International Journal of Circuit Theory and Applications, Jg. 30 (2002), S. 547-566
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    Crosstalk-noise-aware bus coding with low-power ground-gated repeaters
    He, Yifan ; R Rui Wang ; et al.
    In: International Journal of Circuit Theory and Applications, Jg. 46 (2017-07-20), S. 280-289
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    A systematic class AB state space synthesis method based on MOSFET square law and translinear square-root cells
    Saziye Surav Yilmaz ; Tola, Abdullah T.
    In: International Journal of Circuit Theory and Applications, Jg. 43 (2015-01-12), S. 1989-2010
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    A framework for high-speed parallel-prefix adder performance evaluation and comparison
    Hobson, Richard F.
    In: International Journal of Circuit Theory and Applications, Jg. 43 (2014-09-09), S. 1474-1490
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    Gate-level body biasing for subthreshold logic circuits: analytical modeling and design guidelines
    Albano, Domenico ; Lanuzza, Marco ; et al.
    In: International Journal of Circuit Theory and Applications, Jg. 43 (2014-08-19), S. 1523-1540
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