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    A Novel Full Automatic Layout Generation Strategy For Static CMOS Circuits : Very large scale integration of system on chip; VLSI-SOC, IFIP TC 10/WG 10.5
    Lazzari, C. ; Domingues, C. ; et al.
    In: INTERNATIONAL FEDERATION FOR INFORMATION PROCESSING -PUBLICATIONS- IFIP, 2006, Heft NO 200, S. 197-212
    Konferenz
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    A Virtual CMOS Library Approach for Fast Layout Synthesis : Very large scale integration; VLSI
    Moraes, F. ; Robert, M. ; et al.
    Konferenz
    Wie komme ich dran?
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    Nonlinearity Analysis of a Short Channel CMOS Circuit for RFIC Applications : Very large scale integration; VLSI
    Wu, Y. ; Kim, H. s. ; et al.
    Konferenz
    Wie komme ich dran?
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    Single Ended Pass-Transistor Logic - A Comparison with CMOS and CPL : Very large scale integration; VLSI
    Munteanu, M. ; Ivey, P. A. ; et al.
    Konferenz
    Wie komme ich dran?
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    A Design of Operational Amplifier for Sigma Delta Modulators Using 0.35um CMOS Process : Very large scale integration; VLSI
    Li, B. ; Tenhunen, H.
    Konferenz
    Wie komme ich dran?
  6. Detailansicht für Treffer 6 öffnen
    A Low Power CMOS Micromixer for GHz Wireless Applications : Very large scale integration; VLSI
    Wu, Y. ; Li, S. ; et al.
    Konferenz
    Wie komme ich dran?
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    Efficient layout style for three-metal CMOS macro-cells : Very large scale integration
    Moraes, F. G. ; Reis, R. ; et al.
    Konferenz
    Wie komme ich dran?
  8. Detailansicht für Treffer 8 öffnen
    Accurate static timing analysis for deep submicronic CMOS circuits : Very large scale integration
    Dioury, K. ; Greiner, A. ; et al.
    Konferenz
    Wie komme ich dran?
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    E-TSPC: extended true single-phase-clock CMOS circuit technique : Very large scale integration
    Navarro, S. J. ; Van Noije, W. A.
    Konferenz
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    An architecture for a 12 bits low power integrated CMOS pressure sensor with thermal compensation : Very large scale integration
    Chavez, F. ; Olmos, A. ; et al.
    Konferenz
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  11. Detailansicht für Treffer 11 öffnen
    Current and Charge Estimation in CMOS Circuits : Asia and South Pacific design automation conference
    Dhar, S. ; Gurney, D. J.
    In: PROCEEDINGS OF ASP DAC, , S. 13-18
    Konferenz
    Wie komme ich dran?
  12. Detailansicht für Treffer 12 öffnen
    Transistor Reordering Rules for Power Reduction in CMOS Gates : Asia and South Pacific design automation conference
    Shen, W. Z. ; Lin, J. Y. ; et al.
    In: PROCEEDINGS OF ASP DAC, , S. 1-6
    Konferenz
    Wie komme ich dran?
  13. Detailansicht für Treffer 13 öffnen
    Ultra high speed CMOS design : VLSI 93
    Svensson, C. ; Yuan, J.
    In: IFIP TRANSACTIONS A COMPUTER SCIENCE AND TECHNOLOGY, , Heft 42, S. 273-282
    Konferenz
    Wie komme ich dran?
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