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    Design of Universal logic gates and Majority Gate Using One clock pulse based CMOS Capacitor Coupled Threshold Logic
    Dey, Arpita ; Sarkar, Mili ; et al.
    In: 2020 IEEE International IOT, Electronics and Mechatronics Conference (IEMTRONICS), 2020-09-01, S. 1-6
    Konferenz
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    AC — Clocked power supply DCVSL — Differential Cascode Voltage Switching Logic: Design guidelines for energy consumption optimization and CMOS layout
    de Araujo, H. X. ; Kretly, L. C.
    In: 2010 IEEE 26-th Convention of Electrical and Electronics Engineers in Israel, 2010-11-01, S. 991-995
    Konferenz
    Wie komme ich dran?
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    Low power, high precision and reduced size CMOS Comparator for high speed ADC design
    Nag, Amalan ; Baishnab, K. L. ; et al.
    In: 2010 5th International Conference on Industrial and Information Systems, 2010-07-01, S. 219-223
    Konferenz
    Wie komme ich dran?
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    2 GHz low power double edge triggered flip-flop in 65nm CMOS technology
    Khan, Imran Ahmed ; Shaikh, Danish ; et al.
    In: 2012 IEEE International Conference on Signal Processing, Computing and Control, 2012-03-01, S. 1-5
    Konferenz
    Wie komme ich dran?
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    A high throughput digital Rank Order Filter in 0.18um CMOS technology
    Toscano, George John ; Saha, Pran Kanai
    In: TENCON 2010 - 2010 IEEE Region 10 Conference, 2010-11-01, S. 1123-1128
    Konferenz
    Wie komme ich dran?
  6. Detailansicht für Treffer 6 öffnen
    Body-Bias-Driven Design Strategy for Area- and Performance-Efficient CMOS Circuits
    Meijer, M. ; Pineda de Gyvez, J.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 20 (2012), Heft 1, S. 42-51
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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    A CMOS Timer-Injector Integrated Circuit for Self-Powered Sensing of Time-of-Occurrence
    Zhou, L. ; Aono, K. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-05-01), Heft 5, S. 1539-1549
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
  8. Detailansicht für Treffer 8 öffnen
    A set of Virtual Instruments to simulate radiation effects in CMOS circuits
    Bartra, Walter Calienes ; Reis, Ricardo
    In: 2014 IEEE International Instrumentation and Measurement Technology Conference (I2MTC) Proceedings, 2014-05-01, S. 1643-1646
    Konferenz
    Wie komme ich dran?
  9. Detailansicht für Treffer 9 öffnen
    Minimum energy point tracking for sub-threshold digital CMOS circuits using an in-situ energy sensor
    Mehta, Nandish ; Makinwa, Kofi A. A.
    In: 2013 IEEE International Symposium on Circuits and Systems (ISCAS), 2013-05-01, S. 570-573
    Konferenz
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    Current adjustable CMOS startup circuit with low steady state current
    Lertsalee, Watcharaporn ; Parnklang, Jirawath
    In: 2010 10th International Symposium on Communications and Information Technologies, 2010-10-01, S. 330-333
    Konferenz
    Wie komme ich dran?
  11. Detailansicht für Treffer 11 öffnen
    Single Event Transients in Digital CMOS—A Review
    Ferlet-Cavrois, V. ; Massengill, L. W. ; et al.
    In: IEEE Transactions on Nuclear Science, Jg. 60 (2013-06-01), Heft 3, S. 1767-1790
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
  12. Detailansicht für Treffer 12 öffnen
    Function abstraction for sequential CMOS standard cell
    Ting, Gao ; Xiangqing, He
    In: ASIC, 2003. Proceedings. 5th International Conference on, Semiconductor manufacturing, Jg. 1 (2003), S. 360
    Konferenz
    Wie komme ich dran?
  13. Detailansicht für Treffer 13 öffnen
    A Comparitive Study of On-Chip Clock Generators Using a-IGZO TFTs for Flexible Electronic Systems
    Wadhwa, Nishtha ; Martins, Jorge ; et al.
    In: 2018 International Flexible Electronics Technology Conference (IFETC), 2018-08-01, S. 1-6
    Konferenz
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  14. Detailansicht für Treffer 14 öffnen
    Ultra Low Power Reversible Dual Edge Triggered Flip Flop-Design and Implementation
    Singh, Rupali ; Sharma, Devendra Kumar
    In: 2018 2nd International Conference on Micro-Electronics and Telecommunication Engineering (ICMETE), 2018-09-01, S. 264-270
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    A new design technique for low power dynamic feedthrough logic with delay element
    Dev, Arjun ; Sharma, R. K. ; et al.
    In: 2015 Global Conference on Communication Technologies (GCCT), 2015-04-01, S. 197-201
    Konferenz
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  16. Detailansicht für Treffer 16 öffnen
    Performance evaluation of CNTFET based dynamic dual edge triggered register
    Murotiya, Sneh Lata ; Gupta, Anu
    In: 2013 International Conference on Advanced Electronic Systems (ICAES), 2013-09-01, S. 180-183
    Konferenz
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  17. Detailansicht für Treffer 17 öffnen
    A design of adiabatic digital circuits for micro, nano and cube satellites: Four stage JK-FF binary counter using four-phase AC-clocked power-supply
    Salles, V. M. ; Barbin, S. E. ; et al.
    In: 2017 SBMO/IEEE MTT-S International Microwave and Optoelectronics Conference (IMOC), 2017-08-01, S. 1-4
    Konferenz
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  18. Detailansicht für Treffer 18 öffnen
    Fault modeling and mapping for quantum-dot cellular automata (QCA) designs
    Alam, Shabab F. ; Al-Assadi, Waleed K. ; et al.
    In: 2013 2nd International Conference on Advances in Electrical Engineering (ICAEE), 2013-12-01, S. 431-435
    Konferenz
    Wie komme ich dran?
  19. Detailansicht für Treffer 19 öffnen
    An efficient design technique for low power dynamic feedthrough logic with enhanced performance for wide fan-in gates
    Dev, Arjun ; Sharma, R. K
    In: 2015 2nd International Conference on Signal Processing and Integrated Networks (SPIN), 2015-02-01, S. 908-912
    Konferenz
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  20. Detailansicht für Treffer 20 öffnen
    Four phase clocking rule for energy efficient digital circuits — An adiabatic concept
    Yadav, Rakesh Kumar ; Rana, Ashwani K. ; et al.
    In: 2011 2nd International Conference on Computer and Communication Technology (ICCCT-2011), 2011-09-01, S. 209-214
    Konferenz
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