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    A reconfigurable architecture for hybrid CMOS/nanodevice circuits
    STRUKOV, Dmitri B ; LIKHAREV, Konstantin K
    In: FPGA 2006 (Fourteenth ACM/SIGDA International Symposium on Field-Programmable Gate Arrays), 2006, S. 131-140
    Konferenz
    Wie komme ich dran?
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    Nanoscale CMOS circuit leakage power reduction by double-gate device
    KIM, Keunwoo ; DAS, Koushik K ; et al.
    In: ISLPED'04 (proceedings of the 2004 International Symposium on Low Power Electronics and Design), 2004, S. 102-107
    Konferenz
    Wie komme ich dran?
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    Larger-than-Vdd forward body bias in sub-0.5V nanoscale CMOS
    ANANTHAN, Hari ; KIM, Chris H ; et al.
    In: ISLPED'04 (proceedings of the 2004 International Symposium on Low Power Electronics and Design), 2004, S. 8-13
    Konferenz
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    Post-layout leakage power minimization based on distributed sleep transistor insertion
    BABIAHIAN, Pietro ; BENINI, Luca ; et al.
    In: ISLPED'04 (proceedings of the 2004 International Symposium on Low Power Electronics and Design), 2004, S. 138-143
    Konferenz
    Wie komme ich dran?
  5. Detailansicht für Treffer 5 öffnen
    Constant impedance scaling paradigm for interconnect synthesis
    BALACHANDRAN, J ; BREBELS, S ; et al.
    In: Proceedings of SLIP '06 (2006 International Workshop on System Level Interconnect Prediction), 2006, S. 99-105
    Konferenz
    Wie komme ich dran?
  6. Detailansicht für Treffer 6 öffnen
    Tradeoffs between gate oxide leakage and delay for dual Toxcircuits
    ANUP KUMAR, SULTANIA ; SYLVESTER, Dennis ; et al.
    In: Design automation conference (proceedings 2004), 2004, S. 761-766
    Konferenz
    Wie komme ich dran?
  7. Detailansicht für Treffer 7 öffnen
    Leakage in nano-scale technologies : Mechanisms, impact and design considerations
    AGARWAL, Amit ; KIM, Chris H ; et al.
    In: Design automation conference (proceedings 2004), 2004, S. 6-11
    Konferenz
    Wie komme ich dran?
  8. Detailansicht für Treffer 8 öffnen
    Fast and accurate parasitic capacitance models for layout-aware synthesis of analog circuits
    AGARWAL, Anuradha ; SAMPATH, Hemanth ; et al.
    In: Design automation conference (proceedings 2004), 2004, S. 145-150
    Konferenz
    Wie komme ich dran?
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    Device optimization for ultra-low power digital sub-threshold operation
    PAUL, Bioul C ; RAVCHOWDHURV, Ariiit ; et al.
    In: ISLPED'04 (proceedings of the 2004 International Symposium on Low Power Electronics and Design), 2004, S. 96-101
    Konferenz
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    A methodology to improve timing yield in the presence of process variations
    RAI, Sreeia ; VRUDHULA, Sarma B. K ; et al.
    In: Design automation conference (proceedings 2004), 2004, S. 448-453
    Konferenz
    Wie komme ich dran?
  11. Detailansicht für Treffer 11 öffnen
    2.45 GHz power and data transmission for a low-power autonomous sensors platform
    GREGORI, Stefano ; YUNLEI, LI ; et al.
    In: ISLPED'04 (proceedings of the 2004 International Symposium on Low Power Electronics and Design), 2004, S. 269-273
    Konferenz
    Wie komme ich dran?
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