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    Design of Power Efficient Low-Offset Dynamic Latch Comparator using 90nm CMOS Process
    Varshney, Vikrant ; Dubey, Avaneesh K. ; et al.
    In: 2018 3rd International Innovative Applications of Computational Intelligence on Power, Energy and Controls with their Impact on Humanity (CIPECH), 2018-11-01, S. 229-233
    Konferenz
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    Design of a Low-Power Ultra High Speed Dynamic Latched Comparator in 90-nm CMOS Technology
    Rabbi, Fazle ; Das, Sajan ; et al.
    In: 2018 International Conference on Computer, Communication, Chemical, Material and Electronic Engineering (IC4ME2), 2018-02-01, S. 1-4
    Konferenz
    Wie komme ich dran?
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    A 8.7mW 5-Gb/s clock and data recovery circuit with 0.18-µm CMOS
    An, Taek-Joon ; Son, Kyung-Sub ; et al.
    In: 2014 IEEE International Symposium on Circuits and Systems (ISCAS), 2014-06-01, S. 2329-2332
    Konferenz
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    Design of a Low Power Flip-Flop Using CMOS Deep Sub Micron Technology
    Naik, Surya ; Chandel, Rajeevan
    In: 2010 International Conference on Recent Trends in Information, Telecommunication and Computing, 2010-03-01, S. 253-256
    Konferenz
    Wie komme ich dran?
  5. Detailansicht für Treffer 5 öffnen
    An implementation technique of dynamic CMOS circuit applicable to asynchronous/synchronous logic
    Yoshizawa, H. ; Taniguchi, K. ; et al.
    In: 1998 IEEE International Symposium on Circuits and Systems (ISCAS), Jg. 2 (1998), S. 145-148
    Konferenz
    Wie komme ich dran?
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    A novel high-performance low-power CMOS master-slave flip-flop
    Hsu, S. ; Lu, Shih-Lien
    In: Twelfth Annual IEEE International ASIC/SOC Conference (Cat. No.99TH8454), 1999, S. 340-343
    Konferenz
    Wie komme ich dran?
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    A CMOS pipelined carry-save array using true single-phase single-transistor-latch clocking
    Khoo, Kei-Yong ; Chen, Chao-Liang ; et al.
    In: 1999 IEEE International Symposium on Circuits and Systems (ISCAS), Jg. 1 (1999), S. 298-301
    Konferenz
    Wie komme ich dran?
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    Low-voltage low-power CMOS true-single-phase clocking scheme with locally asynchronous logic circuits
    Huang, Hong-Yi ; Cheng, Kuo-Hsing ; et al.
    In: 1995 IEEE International Symposium on Circuits and Systems (ISCAS), Jg. 3 (1995), S. 1572-1575
    Konferenz
    Wie komme ich dran?
  9. Detailansicht für Treffer 9 öffnen
    Low power CMOS clock buffer
    Khoo, Kei-Yong ; Willson, A.N., Jr.
    In: 1994 IEEE International Symposium on Circuits and Systems (ISCAS), Jg. 4 (1994), S. 355-358
    Konferenz
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    Analog operation in CMOS latch circuit for reducing dynamic power dissipation
    Dejhan, K. ; Cheevasuvit, F. ; et al.
    In: [1992] Proceedings of the 35th Midwest Symposium on Circuits and Systems, 1992, S. 544-547
    Konferenz
    Wie komme ich dran?
  11. Detailansicht für Treffer 11 öffnen
    CMOS TSPC latch circuits for pass-transistor logic
    Smith, J.C.
    In: Proceedings of 1994 37th Midwest Symposium on Circuits and Systems, Jg. 1 (1994), S. 33-37
    Konferenz
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  12. Detailansicht für Treffer 12 öffnen
    A low-power CMOS multi-modulus dynamic frequency divider
    Sharaf, Khaled M.
    In: 2008 National Radio Science Conference, 2008-03-01, S. 1
    Konferenz
    Wie komme ich dran?
  13. Detailansicht für Treffer 13 öffnen
    Design of 10 GHz, 2.6 mW frequency divider in 0.25 /spl mu/m CMOS
    He, Chengming ; Sun, Yi-he
    In: 2001 6th International Conference on Solid-State and Integrated Circuit Technology. Proceedings (Cat. No.01EX443), Jg. 2 (2001), S. 1136-1138
    Konferenz
    Wie komme ich dran?
  14. Detailansicht für Treffer 14 öffnen
    A 40-GHz Frequency Divider in 90-nm CMOS Technology
    Usama, M. ; Kwasniewski, T.A.
    In: 2006 IEEE North-East Workshop on Circuits and Systems, 2006-06-01, S. 41
    Konferenz
    Wie komme ich dran?
  15. Detailansicht für Treffer 15 öffnen
    A novel CMOS implementation of double-edge-triggered flip-flops
    Lu, S. L. ; Ercegovac, M.
    In: IEEE Journal of Solid-State Circuits, Jg. 25 (1990-08-01), Heft 4, S. 1008-1010
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
  16. Detailansicht für Treffer 16 öffnen
    type 2.5-Gb/s 0.25-/spl mu/m CMOS lower power 1:16 demultiplexer
    Wang, Zhigong ; Ding, Jingfeng ; et al.
    In: 2005 Asia-Pacific Microwave Conference Proceedings, Jg. 1 (2005), S. 1
    Konferenz
    Wie komme ich dran?
  17. Detailansicht für Treffer 17 öffnen
    An 11 Gb/s 2.4 mW Half-Rate Sampling 2-Tap DFE Receiver in 6Snm CMOS
    Rylyakov, Alexander
    In: 2007 IEEE Symposium on VLSI Circuits, 2007-06-01, S. 272
    Konferenz
    Wie komme ich dran?
  18. Detailansicht für Treffer 18 öffnen
    Ultra low power 2.4-GHz 0.35-μm CMOS dual-modulus prescaler design
    Ng, Chong-Chon ; Kwok-Keung M Cheng
    In: IEEE Microwave and Wireless Components Letters, Jg. 16 (2006-02-01), Heft 2, S. 75-77
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
  19. Detailansicht für Treffer 19 öffnen
    A 6 b 800 MSample/s CMOS A/D converter
    Sushihara, K. ; Kimura, H. ; et al.
    In: 2000 IEEE International Solid-State Circuits Conference. Digest of Technical Papers (Cat. No.00CH37056), 2000, S. 428-429
    Konferenz
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  20. Detailansicht für Treffer 20 öffnen
    NORA: a racefree dynamic CMOS technique for pipelined logic structures
    Goncalves, N.F. ; De Man, H.
    In: IEEE Journal of Solid-State Circuits, Jg. 18 (1983-06-01), Heft 3, S. 261-266
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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