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    A Fully Integrated 10-V Pulse Driver Using Multiband Pulse-Frequency Modulation in 65-nm CMOS
    Wu, Jiangchao ; Law, Man-Kay ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021-09-01), S. 1665-1669
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    A 35-GHz TX and RX Front End With High TX Output Power for Ka-Band FMCW Phased-Array Radar Transceivers in CMOS Technology
    Wu, Rui ; Jia, Haikun ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-10-01), S. 2089-2098
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    All-Digital Cost-Efficient CMOS Digital-to-Time Converter Using Binary-Weighted Pulse Expansion
    Hwang, Chorng-Sii ; Chang, Kai-Hsiang ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-04-01), S. 1094-1098
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    Logic IP for Low-Cost IC Design in Advanced CMOS Nodes
    Mehmet Meric Isgenc ; Martins, Mayler G. A. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-02-01), S. 585-595
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    Design of a 5.3-GHz 31.3-dBm Fully Integrated CMOS Power Amplifier Using Folded Splitting and Combining Architecture
    Tsai, Jeng-Han
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-07-01), S. 1527-1536
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    Very Fast, High-Performance 5-2 and 7-2 Compressors in CMOS Process for Rapid Parallel Accumulations
    Azizian, Sarkis ; Fathi, Amir ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 28 (2020-06-01), S. 1403-1412
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    A 43.6-dB SNDR 1-GS/s 3.2-mW SAR ADC With Background-Calibrated Fine and Coarse Comparators in 28-nm CMOS
    Gui, Ping ; Sun, Kexu ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-09-01), S. 1998-2007
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    A CMOS Majority Logic Gate and its Application to One-Step ML Decodable Codes
    Guo, Jing ; Liu, Shanshan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-11-01), S. 2620-2628
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    Configurable Logic Operations Using Hybrid CRS-CMOS Cells
    Shuai, Li ; Wang, Xiaoping ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-12-01), S. 2641-2647
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    A 10-Gb/s 20-ps Delay-Range Digitally Controlled Differential Delay Element in 45-nm SOI CMOS
    Ellinger, Frank ; Mohammad Mahdi Khafaji ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-05-01), S. 1233-1237
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    A 0.3-V 37-nW 53-dB SNDR Asynchronous Delta–Sigma Modulator in 0.18- <tex-math notation='LaTeX'>$\mu$ </tex-math> m CMOS
    Kulej, Tomasz ; Khateb, Fabian ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-02-01), S. 316-325
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    A 16-bit 2.0-ps Resolution Two-Step TDC in 0.18- <tex-math notation='LaTeX'>$\mu$ </tex-math> m CMOS Utilizing Pulse-Shrinking Fine Stage With Built-In Coarse Gain Calibration
    Asada, Kunihiro ; Nakura, Toru ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019), S. 11-19
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    Neuromorphic Vision Hybrid RRAM-CMOS Architecture
    Cho, Kyoung-Rok ; Herbert Ho-Ching Iu ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-12-01), S. 2816-2829
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    A 0.9-V 12-bit 100-MS/s 14.6-fJ/Conversion-Step SAR ADC in 40-nm CMOS
    Li, Jing ; Liu, Yang ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-10-01), S. 1980-1988
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    A Low-Power Forward and Reverse Body Bias Generator in CMOS 40 nm
    Wu, Chundong ; Wang, Lei ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-07-01), S. 1403-1407
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    A Hardware Architecture for Columnar-Organized Memory Based on CMOS Neuron and Memristor Crossbar Arrays
    Shamsi, Jafar ; Shokouhi, Shahriar B. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-12-01), S. 2795-2805
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    Input Offset Estimation of CMOS Integrated Circuits in Weak Inversion
    Moradi, Farshad ; Hashemipour, Omid ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-09-01), S. 1812-1816
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    A 5-to-8-GHz Wideband Miniaturized Dielectric Spectroscopy Chip With <tex-math notation='LaTeX'>$I/Q$ </tex-math> Mismatch Calibration in 65-nm CMOS
    Ma, Shunli ; Li, Ning ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-08-01), S. 1554-1564
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    A Continuous-Time MASH 1-1-1 Delta–Sigma Modulator With FIR DAC and Encoder-Embedded Loop-Unrolling Quantizer in 40-nm CMOS
    Edward, Alexander ; Zhou, Dadian ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-04-01), S. 756-767
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    A 16-mW 1-GS/s With 49.6-dB SNDR TI-SAR ADC for Software-Defined Radio in 65-nm CMOS
    Tang, Kai ; Zhu, Yan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-03-01), S. 572-583
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