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    A 0.004-mm2 3.65-mW 7-Bit 2-GS/s Single-Channel GRO-Based Time-Domain ADC Incorporating Dead-Zone Elimination and On-Chip Folding-Offset Calibration in 28-nm CMOS
    Zhang, C. ; Wei, J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 58 (2023-11-01), Heft 11, S. 3179-3193
    Online academicJournal
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    A Single-Channel Voltage-Scalable 8-GS/s 8-b >37.5-dB SNDR Time-Domain ADC With Asynchronous Pipeline Successive Approximation in 28-nm CMOS
    Chen, Q. ; Boon, C.C. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 58 (2023-06-01), Heft 6, S. 1610-1622
    Online academicJournal
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    Volltext
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    Improving Linearity in CMOS Phase Interpolators
    Mishra, A.K. ; Li, Y. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 58 (2023-06-01), Heft 6, S. 1623-1635
    Online academicJournal
    Zugriff:
    Volltext
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    A 5-GS/s 158.6-mW 9.4-ENOB Passive-Sampling Time-Interleaved Three-Stage Pipelined-SAR ADC With Analog–Digital Corrections in 28-nm CMOS
    Ramkaj, A.T. ; Pena Ramos, J.C. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-06-01), Heft 6, S. 1553-1564
    Online academicJournal
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    A 550- $\mu$ W 20-kHz BW 100.8-dB SNDR Linear- Exponential Multi-Bit Incremental $\Sigma\Delta$ ADC With 256 Clock Cycles in 65-nm CMOS
    Wang, B. ; Sin, S. W. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-04-01), Heft 4, S. 1161-1172
    Online academicJournal
    Zugriff:
    Volltext
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    A 66-dB SNDR Pipelined Split-ADC in 40-nm CMOS Using a Class-AB Residue Amplifier
    Akter, M.S. ; Sehgal, R. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-10-01), Heft 10, S. 2939-2950
    Online academicJournal
    Zugriff:
    Volltext
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    A 375 mW Multimode DAC-Based Transmitter With 2.2 GHz Signal Bandwidth and In-Band IM3 $ {58 dBc in 40 nm CMOS
    Spiridon, S. ; van der Tang, J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-07-01), Heft 7, S. 1595-1604
    Online academicJournal
    Zugriff:
    Volltext
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    A 2.8 GS/s 44.6 mW Time-Interleaved ADC Achieving 50.9 dB SNDR and 3 dB Effective Resolution Bandwidth of 1.5 GHz in 65 nm CMOS
    Stepanovic, D. ; Nikolic, B.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-04-01), Heft 4, S. 971-982
    Online academicJournal
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    A 2–11 GHz 7-Bit High-Linearity Phase Rotator Based on Wideband Injection-Locking Multi-Phase Generation for High-Speed Serial Links in 28-nm CMOS FDSOI
    Monaco, E. ; Anzalone, G. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-07-01), Heft 7, S. 1739-1752
    Online academicJournal
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    A 130 nm CMOS 6-bit Full Nyquist 3 GS/s DAC
    Wu, X. ; Palmers, P. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 43 (2008-11-01), Heft 11, S. 2396-2403
    Online academicJournal
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    An 800-MHz–6-GHz Software-Defined Wireless Receiver in 90-nm CMOS
    Bagheri, R. ; Mirzaei, A. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 41 (2006-12-01), Heft 12, S. 2860-2876
    Online academicJournal
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    A CMOS 15-bit 125-MS/s Time-Interleaved ADC With Digital Background Calibration
    Lee, Z. M. ; Wang, C. Y. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 42 (2007-10-01), Heft 10, S. 2149-2160
    Online academicJournal
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    A 14-b, 100-MS/s CMOS DAC designed for spectral performance
    Bugeja, A.R. ; Song, B. S. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 34 (1999-12-01), Heft 12, S. 1719-1732
    Online academicJournal
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    A high-performance multibit /spl Delta//spl Sigma/ CMOS ADC
    Geerts, Y. ; Steyaert, M.S.J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 35 (2000-12-01), Heft 12, S. 1829-1840
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    Design Techniques for a 60 Gb/s 173 mW Wireline Receiver Frontend in 65 nm CMOS Technology
    Han, J. ; Lu, Y. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016-04-01), Heft 4, S. 871-880
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    A 5-V CMOS line controller with 16-b audio converters
    Le Toumelin, L. ; Carbou, P. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 27 (1992-03-01), Heft 3, S. 332-342
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    An accurate CMOS sample-and-hold circuit
    Gatti, U. ; Maloberti, F. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 27 (1992), Heft 1, S. 120-122
    Online academicJournal
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    A 16-Gb/s Backplane Transceiver With 12-Tap Current Integrating DFE and Dynamic Adaptation of Voltage Offset and Timing Drifts in 45-nm SOI CMOS Technology
    Gangasani, G. R. ; Hsu, C. H. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-08-01), Heft 8, S. 1828-1841
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    A Predistortion-Less Digital MIMO Transmitter With DTC-Based Quadrature Imbalance Compensation
    Zanen, J. ; Klumperink, E. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 58 (2023-08-01), Heft 8, S. 2214-2225
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    An 8-MHz CMOS subranging 8-bit A/D converter
    Dingwall, A.G.F. ; Zazzu, V.
    In: IEEE Journal of Solid-State Circuits, Jg. 20 (1985-12-01), Heft 6, S. 1138-1143
    Online academicJournal
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