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    Design and Validation of a V-Gate n-MOSFET-Based RH CMOS Logic Circuit with Tolerance to the TID Effect.
    Ki, Donghan ; Lee, Minwoong ; et al.
    In: Electronics (2079-9292), Jg. 12 (2023-08-01), Heft 15, S. 3331-3342
    Online academicJournal
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    Full Text Finder (Volltext)
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    A Reliability-Enhanced Differential Sensing Amplifier for Hybrid CMOS/MTJ Logic Circuits.
    Wang, Chengzhi ; Yang, Tianqi ; et al.
    In: Electronics (2079-9292), Jg. 12 (2023-01-15), Heft 2, S. 447-455
    Online academicJournal
    Zugriff:
    Full Text Finder (Volltext)
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    Optimization of Photodiode Design Through Analysis of Full-Well Capacity and Image Lag in 0.5 μ m CMOS Image Sensors With Vertical Transfer Gates.
    Park, Jae Hyeon ; Suk, Chan Hee ; et al.
    In: IEEE Electron Device Letters, Jg. 43 (2022-10-01), Heft 10, S. 1697-1700
    Online academicJournal
    Zugriff:
    Volltext
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    Hybrid architecture based on two-dimensional memristor crossbar array and CMOS integrated circuit for edge computing.
    Kumar, Pratik ; Zhu, Kaichen ; et al.
    In: NPJ 2D Materials & Applications, Jg. 6 (2022-01-21), Heft 1, S. 1-10
    Online academicJournal
    Zugriff:
    View record at Springer (Volltext)
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    Island-Style Monolithic Three-Dimensional CMOS-Nanoelectromechanical Logic Circuits.
    Kwon, Hyug Su ; Ko, Ji Wang ; et al.
    In: IEEE Electron Device Letters, Jg. 41 (2020-08-01), Heft 8, S. 1257-1260
    Online academicJournal
    Zugriff:
    Volltext
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    Efficient 60-GHz Power Amplifier With Adaptive AM-AM and AM-PM Distortions Compensation in 65-nm CMOS Process.
    Jung, Kyung Pil ; Son, Hyuk Su ; et al.
    In: IEEE Transactions on Microwave Theory & Techniques, Jg. 68 (2020-07-01), Heft 7, S. 3045-3055
    Online academicJournal
    Zugriff:
    Volltext
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    Ambient Temperature-Induced Device Self-Heating Effects on Multi-Fin Si CMOS Logic Circuit Performance in N-14 to N-7 Scaled Technologies.
    Venkateswarlu, Sankatali ; Nayak, Kaushik
    In: IEEE Transactions on Electron Devices, Jg. 67 (2020-04-01), Heft 4, S. 1530-1536
    Online academicJournal
    Zugriff:
    Volltext
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    An Inductive-Neutralized 26-dBm $K$ -/ $K_{a}$ -Band Power Amplifier With 34% PAE in 90-nm CMOS.
    Huang, Wei-Cheng ; Wang, Huei
    In: IEEE Transactions on Microwave Theory & Techniques, Jg. 67 (2019-11-01), Heft 11, S. 4427-4440
    Online academicJournal
    Zugriff:
    Volltext
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  9. Detailansicht für Treffer 9 öffnen
    Transformer-Based Predistortion Linearizer for High Linearity and High Modulation Efficiency in mm-Wave 5G CMOS Power Amplifiers.
    Ali, Sheikh Nijam ; Agarwal, Pawan ; et al.
    In: IEEE Transactions on Microwave Theory & Techniques, Jg. 67 (2019-07-01), Heft 7, S. 3074-3087
    Online academicJournal
    Zugriff:
    Volltext
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  10. Detailansicht für Treffer 10 öffnen
    Accurate Calculation of Unreliability of CMOS Logic Cells and Circuits.
    Beg, Azam
    In: Journal of Circuits, Systems & Computers, Jg. 29 (2020-10-15), Heft 13, S. N.PAG- (22S.)
    academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    Design of a Wideband Variable-Gain Amplifier With Self-Compensated Transistor for Accurate dB-Linear Characteristic in 65 nm CMOS Technology.
    Kong, Lingshan ; Liu, Hang ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 67 (2020-12-01), Heft 12, S. 4187-4198
    Online serialPeriodical
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    A Subthreshold Biased CMOS Ring Oscillator Model Design in 180-nm Process.
    Geraldo Correa, Vinícius Henrique ; da Silva Braga, Rodrigo Aparecido ; et al.
    In: Journal of ICT Research & Applications, Jg. 17 (2023-05-01), Heft 2, S. 135-150
    Online academicJournal
    Zugriff:
    Volltext (PDF)
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    CMOS Implementation of a Novel High Speed 4:2 Compressor for Fast Arithmetic Circuits.
    Ghasemzadeh, M. ; Mohabbatian, N. ; et al.
    In: IETE Journal of Research, Jg. 69 (2023-05-01), Heft 5, S. 2392-2399
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    Polymorphic Hybrid CMOS-MTJ Logic Gates for Hardware Security Applications.
    Kumar, Rajat ; Divyanshu, Divyanshu ; et al.
    In: Electronics (2079-9292), Jg. 12 (2023-02-15), Heft 4, S. 902-915
    Online academicJournal
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    Design and Simulation of Reliable Low Power CMOS Logic Gates.
    Sharma, Vijay Kumar
    In: IETE Journal of Research, Jg. 69 (2023-02-01), Heft 2, S. 1022-1032
    Online academicJournal
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    VLSI Design Based on Block Truncation Coding for Real-Time Color Image Compression for IoT.
    Chen, Shih-Lun ; Chou, He-Sheng ; et al.
    In: Sensors (14248220), Jg. 23 (2023-02-01), Heft 3, S. 1573-1590
    Online academicJournal
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    Optimization Design on Active Guard Ring to Improve Latch-Up Immunity of CMOS Integrated Circuits.
    Chen, Chun-Cheng ; Ker, Ming-Dou
    In: IEEE Transactions on Electron Devices, Jg. 66 (2019-04-01), Heft 4, S. 1648-1655
    Online academicJournal
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    PAELib: A VHDL Library for Area and Power Dissipation Estimation of CMOS Logic Circuits.
    KIREI, Botond Sandor ; CHEREJA, Verginia-Iulia-Maria ; et al.
    In: Advances in Electrical & Computer Engineering, Jg. 19 (2019-02-01), Heft 1, S. 9-16
    Online academicJournal
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    Combined (Si) and (Ge) FinFET-CMOS Inverter Characterization Based on Driver to Load Transistor Ratio.
    Hashim, Yasir ; Hussein, Safwan Mawlood
    In: Journal of Nano- & Electronic Physics, Jg. 14 (2022-09-01), Heft 5, S. 1-6
    Online academicJournal
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    A 0.8-V Resistor-Based Temperature Sensor in 65-nm CMOS With Supply Sensitivity of 0.28 °C/V.
    Park, Hyunmin ; Kim, Jintae
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-03-01), Heft 3, S. 906-912
    Online academicJournal
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