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    Comparative Analysis of Modeling CMOS Majority Gates When Collecting a Charge from Tracks of Single Ionizing Particles
    V. Ya. Stenin ; Katunin, Yu. V.
    In: Russian Microelectronics, Jg. 50 (2021-07-01), S. 253-263
    Online unknown
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    Modeling the Characteristics of SOI CMOS Nanotransistors with an Asymmetric Surrounding Gate
    Masal’skii, N. V.
    In: Russian Microelectronics, Jg. 49 (2020-09-01), S. 324-331
    Online unknown
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    Extracting a Logic Gate Network from a Transistor-Level CMOS Circuit
    Cheremisinov, Dmitry I. ; Cheremisinova, Liudmila D.
    In: Russian Microelectronics, Jg. 48 (2019-05-01), S. 187-196
    Online unknown
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    Investigating the Dynamic Characteristics of High-Temperature SOI CMOS VLSIC Elements
    Ignatov, P. V. ; Shelepin, N. A. ; et al.
    In: Russian Microelectronics, Jg. 47 (2018-05-01), S. 197-200
    Online unknown
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    A System for Logical Design of Custom CMOS VLSI Functional Blocks with Reduced Power Consumption
    Kardash, S. N. ; Yu. Yu. Lankevich ; et al.
    In: Russian Microelectronics, Jg. 47 (2018), S. 65-81
    Online unknown
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    New CMOS circuit implementation of a one-bit full-adder cell
    Shubin, V. V.
    In: Russian Microelectronics, Jg. 40 (2011-03-01), S. 119-127
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    Fully depleted SOI CMOS logic gates for low-voltage applications
    Masal’skii, N. V.
    In: Russian Microelectronics, Jg. 37 (2008-11-01), S. 410-417
    Online unknown
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    Engineering Approach to CMOS-Logic Optimization Allowing for Internal Capacitances and On-Chip Interconnections
    Kristovskii, G. V. ; Butuzov, A. V.
    In: Russian Microelectronics, Jg. 34 (2005-09-01), S. 328-338
    Online unknown
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  9. Detailansicht für Treffer 9 öffnen
    Estimating energy consumption in logical CMOS circuits based on their switching activity
    Bibilo, P. N. ; Kirienko, N. A.
    In: Russian Microelectronics, Jg. 41 (2012), S. 59-70
    Online unknown
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