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    Design and implementation of a 1-V transformer magnetic feedback low-noise amplifier (LNA) at 5-6 GHz, in a 90 nm complementary metal-oxide-semiconductor (CMOS) process
    KYTONAKI, Eleni-Sotiria ; SIMITSAKIS, Paschalis ; et al.
    In: International journal of electronics, Jg. 98 (2011), Heft 1-3, S. 235-248
    academicJournal
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    Relationship between settling time and pole-zero placements for three-stage CMOS opamp
    CHANDRAWAT, Uday Bhanu Singh ; MISHRA, D. K
    In: International journal of electronics, Jg. 98 (2011), Heft 7-9, S. 901-922
    academicJournal
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    High speed, low power VLSI CMOS vision sensor for geometric centre object tracking
    HABIBI, Mehdi ; SAYEDI, Masoud
    In: International journal of electronics, Jg. 96 (2009), Heft 7-8, S. 821-836
    academicJournal
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    Design procedure for two-stage CMOS opamp with optimum balancing of speed, power and noise
    UDAY BHANU SINGH, CHANDRAWAT ; MISHRA, D. K
    In: International journal of electronics, Jg. 96 (2009), Heft 11-12, S. 1145-1159
    academicJournal
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    academicJournal
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    academicJournal
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    Power and area-optimised Carry-Select Adder architecture for standard cell-based design.
    Shanmugam, Muthukumar ; Choi, Goang ; et al.
    In: International Journal of Electronics, Jg. 102 (2015-08-01), Heft 8, S. 1348-1360
    academicJournal
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    Application of a sigma-delta modulator for adiabatic charging of an output stage capacitor.
    Amraee, Meysam ; Habibi, Mehdi
    In: International Journal of Electronics, Jg. 109 (2022-10-01), Heft 10, S. 1645-1660
    academicJournal
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    A low-voltage, low power divide-by-4 LC-tank injection-locked frequency divider
    JANG, Sheng-Lyang ; LIU, Cheng-Hsin ; et al.
    In: International journal of electronics, Jg. 98 (2011), Heft 4-6, S. 521-527
    academicJournal
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    A low-voltage ultra-wideband down-conversion mixer with improved power conversion gain
    CHEN, Jun-Da
    In: International journal of electronics, Jg. 98 (2011), Heft 7-9, S. 1055-1073
    academicJournal
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    academicJournal
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    Design and Evaluation of Clocked Differential Adiabatic Logic Families for Low Power Applications.
    Sasipriya, P ; Bhaaskaran, V S Kanchana
    In: International Journal of Electronics, Jg. 109 (2022-09-01), Heft 9, S. 1573-1590
    academicJournal
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    academicJournal
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    Automated performance evaluation of skew-tolerant clocking schemes.
    Guerrero, D. ; Bellido, M. J. ; et al.
    In: International Journal of Electronics, Jg. 93 (2006-12-01), Heft 12, S. 819-842
    academicJournal
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    An efficient design of CORDIC in Quantum-dot cellular automata technology.
    Gassoumi, Ismail ; Touil, Lamjed ; et al.
    In: International Journal of Electronics, Jg. 106 (2019-12-01), Heft 12, S. 2039-2056
    academicJournal
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    Three novel single-stage full swing 3-input XOR.
    Vijaya Lakshmi, P. ; Musala, Sarada ; et al.
    In: International Journal of Electronics, Jg. 105 (2018-08-01), Heft 8, S. 1416-1432
    academicJournal
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