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    A 31-dBm, high ruggedness power amplifier in 65-nm standard CMOS with high-efficiency stacked-cascode stages
    Leuschner, Stephan ; Pinarello, Sandro ; et al.
    In: 2010 IEEE Radio Frequency Integrated Circuits Symposium, 2010-05-01, S. 395-398
    Konferenz
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    A CMOS Sub-l-V nanopower current and voltage reference with leakage compensation
    Huang, Zhangcai ; Luo, Qin ; et al.
    In: 2010 IEEE International Symposium on Circuits and Systems (ISCAS), 2010-05-01, S. 4069-4072
    Konferenz
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    Design analysis of novel substrate-triggered GGNMOS in 65nm CMOS process
    Song, Bo ; Han, Yan ; et al.
    In: 2010 17th IEEE International Symposium on the Physical and Failure Analysis of Integrated Circuits, 2010-07-01, S. 1-4
    Konferenz
    Wie komme ich dran?
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    Compact low-voltage CMOS current-mode multiplier/divider
    Lopez-Martin, Antonio J. ; De La Cruz Bias, Carlos A. ; et al.
    In: 2010 IEEE International Symposium on Circuits and Systems (ISCAS), 2010-05-01, S. 1583-1586
    Konferenz
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    Zero-cost MTP high density NVM modules in a CMOS process flow
    Atrash, A. ; Cassuto, G. ; et al.
    In: 2010 IEEE International Memory Workshop, 2010-05-01, S. 1-4
    Konferenz
    Wie komme ich dran?
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    Programmable floating-gate CMOS resistors
    Ozalevli, E. ; Hasler, P.
    In: 2005 IEEE International Symposium on Circuits and Systems (ISCAS), 2005, S. 2168-2171
    Konferenz
    Wie komme ich dran?
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    Tunable CMOS resistor circuit with improved linearity based on the arithmetical mean computation
    Popa, Cosmin
    In: Melecon 2010 - 2010 15th IEEE Mediterranean Electrotechnical Conference, MELECON 2010 - 2010 15th IEEE Mediterranean Electrotechnical Conference, 2010-04-01, S. 1379-1382
    Konferenz
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    Modeling and optimization of mixed logic circuits: the CMOS/CPL combination
    Wan, Y. ; Shams, M.
    In: Proceedings. The 16th International Conference on Microelectronics, 2004. ICM, 2004, S. 421-424
    Konferenz
    Wie komme ich dran?
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    A circuit design based approach for 1/f-noise reduction in linear analog CMOS IC's
    Koh, J. ; Thewes, R. ; et al.
    In: 2004 Symposium on VLSI Circuits. Digest of Technical Papers (IEEE Cat. No.04CH37525), 2004, S. 222-225
    Konferenz
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    A precision CMOS analog cubing circuit
    Shearer, F. ; MacEachern, L.
    In: The 2nd Annual IEEE Northeast Workshop on Circuits and Systems, 2004. NEWCAS, 2004, S. 281-284
    Konferenz
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  11. Detailansicht für Treffer 11 öffnen
    Low Frequency Noise and Fluctuations in Sub 0.1um Bulk and SOI CMOS Technologies
    Ghibaudo, G. ; Jomaah, J.
    In: 2006 25th International Conference on Microelectronics, 2006, S. 516-520
    Konferenz
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  12. Detailansicht für Treffer 12 öffnen
    CMOS design techniques for 10 Gb/s optical transceivers
    Green, M.M.
    In: 2003 International Symposium on VLSI Technology, Systems and Applications. Proceedings of Technical Papers. (IEEE Cat. No.03TH8672), 2003, S. 209-212
    Konferenz
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  13. Detailansicht für Treffer 13 öffnen
    Design of high-voltage devices in a fully implanted twin-well CMOS process
    Santos, P.M. ; Quaresma, H. ; et al.
    In: ESSDERC '03. 33rd Conference on European Solid-State Device Research,, 2003, S. 343-346
    Konferenz
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  14. Detailansicht für Treffer 14 öffnen
    A new CMOS current conveyors based translinear loop for log-domain circuit design
    Dutta, D. ; Serdijn, W.A. ; et al.
    In: 18th International Conference on VLSI Design held jointly with 4th International Conference on Embedded Systems, 2005, S. 850-853
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    Low-voltage CMOS analog bootstrapped switch for sample-and-hold circuit: design and chip characterization
    Fayomi, C.J.B. ; Roberts, G.W. ; et al.
    In: 2005 IEEE International Symposium on Circuits and Systems (ISCAS), 2005, S. 2200-2203
    Konferenz
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  16. Detailansicht für Treffer 16 öffnen
    Novel and robust constant-g/sub m/ technique for rail-to-rail CMOS amplifier input stages
    Yan, Shouli ; Hu, Jingyu ; et al.
    In: 2005 IEEE International Symposium on Circuits and Systems (ISCAS), 2005, S. 2563-2566
    Konferenz
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  17. Detailansicht für Treffer 17 öffnen
    Delay modeling of CMOS/CPL logic circuits
    Wan, Yuanzhong ; Shams, M.
    In: 2005 IEEE International Symposium on Circuits and Systems (ISCAS), 2005, S. 5613-5616
    Konferenz
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  18. Detailansicht für Treffer 18 öffnen
    Logic circuit design based on MOS-NDR devices and circuits fabricated by CMOS process
    Gan, Kwang-Jow ; Hsiao, Chung-Chih ; et al.
    In: Fifth International Workshop on System-on-Chip for Real-Time Applications (IWSOC'05), 2005, S. 392-395
    Konferenz
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  19. Detailansicht für Treffer 19 öffnen
    A CMOS-based Multiple-Input Max/Mm Circuit
    Keawconthai, S. ; Wangwiwattana, C. ; et al.
    In: 2005 5th International Conference on Information Communications & Signal Processing, 2005, S. 54-58
    Konferenz
    Wie komme ich dran?
  20. Detailansicht für Treffer 20 öffnen
    Low noise operational amplifier design with current driving bulk in 0.25/spl mu/m CMOS technology
    Li, Zhiyuan ; Ma, Jianguo ; et al.
    In: 2005 6th International Conference on ASIC, Jg. 2 (2005), S. 630-634
    Konferenz
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