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    IIBLAST: Speeding Up Commercial FPGA Routing by Decoupling and Mitigating the Intra-CLB Bottleneck
    Shrivastava, Shashwat ; Nikolic, Stefan ; et al.
    In: 2023 IEEE/ACM International Conference on Computer Aided Design (ICCAD), 2023-10-28, S. 1-9
    Konferenz
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    A Scan-Chain Circuit Design for BRAM Test Based on CLB
    He, Wang ; Dayu, Zhang ; et al.
    In: 2019 IEEE 3rd International Conference on Circuits, Systems and Devices (ICCSD), 2019-08-01, S. 55-58
    Konferenz
    Wie komme ich dran?
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    A conventional design for CLB implementation of a FPGA in Quantum-dot Cellular Automata (QCA)
    Kianpour, Moein ; Sabbaghi-Nadooshan, Reza
    In: 2012 IEEE/ACM International Symposium on Nanoscale Architectures (NANOARCH), 2012-07-01, S. 36-42
    Online Konferenz
    Zugriff:
    Full Text Finder (Volltext)
    Wie komme ich dran?
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    Using island-style bi-directional intra-CLB routing in low-power FPGAs
    Ayorinde, Oluseyi ; Qi, He ; et al.
    In: 2015 25th International Conference on Field Programmable Logic and Applications (FPL), 2015-09-01, S. 1-7
    Konferenz
    Wie komme ich dran?
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    Patching circuit design based on reserved CLBs
    Matrosova, A. ; Ostanin, S. ; et al.
    In: 2016 IEEE International Conference on Automation, Quality and Testing, Robotics (AQTR), 2016-05-01, S. 1-5
    Konferenz
    Wie komme ich dran?
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    Increasing Manufacturing Yield Using Partially Programmable Circuits with CLB Implementation of Incompletely Specified Boolean Function of the Corresponding Sub-Circuit
    Matrosova, A. ; Ostanin, S. ; et al.
    In: 2015 IEEE 18th International Symposium on Design and Diagnostics of Electronic Circuits & Systems, 2015-04-01, S. 267-270
    Konferenz
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    QCA implementation of a MUX-Based FPGA CLB
    Amiri, Mohammad Amin ; Mahdavi, Mojdeh ; et al.
    In: 2008 International Conference on Nanoscience and Nanotechnology, 2008-02-01, S. 141
    Konferenz
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    A Testing Approach for Xilinx FPGA's CLB
    Ming, Tang ; Guo-ping, Zhang ; et al.
    In: 2006 8th International Conference on Solid-State and Integrated Circuit Technology Proceedings, 2006, S. 2158
    Konferenz
    Wie komme ich dran?
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    An area and configuration-bit optimized CLB architecture and timing-driven packing for FPGAs
    Garg, V. ; Chandrasekhar, V. ; et al.
    In: 19th International Conference on VLSI Design held jointly with 5th International Conference on Embedded Systems Design (VLSID'06), 2006, S. 1
    Konferenz
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    A survey on fault tolerance in FPGAs
    Harikrishna, B. ; Ravi, S.
    In: 2013 7th International Conference on Intelligent Systems and Control (ISCO), 2013, S. 265-270
    Konferenz
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    H-tree CMOS logic circuit
    Cheng, Shun-Wen
    In: 2008 15th IEEE International Conference on Electronics, Circuits and Systems, 2008-08-01, S. 542
    Konferenz
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    Configurable Logic Blocks and Memory Blocks for Beyond-CMOS FPGA-Based Embedded Systems
    Raj, M. ; Gopalakrishnan, L. ; et al.
    In: IEEE Embedded Systems Letters, Jg. 12 (2020-12-01), Heft 4, S. 113-116
    Online academicJournal
    Zugriff:
    Volltext
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  13. Detailansicht für Treffer 13 öffnen
    Design and implementation of Configurable Logic Block of an FPGA using quantum dot cellular automata
    Rani, D. Gracia Nirmala ; Mathumitha, C. ; et al.
    In: 2016 3rd International Conference on Devices, Circuits and Systems (ICDCS), 2016-03-01, S. 43-48
    Konferenz
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    A PFSCL based configurable logic block
    Pandey, Neeta ; Gupta, Maneesha ; et al.
    In: 2015 Annual IEEE India Conference (INDICON), 2015-12-01, S. 1-4
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    An efficient FPGA implementation in quantum-dot cellular automata
    Marciano, Abner Luis Panho ; Oliveira, Andre B. ; et al.
    In: 2013 26th Symposium on Integrated Circuits and Systems Design (SBCCI), 2013-09-01, S. 1-6
    Konferenz
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  16. Detailansicht für Treffer 16 öffnen
    Design of a nanoscale Quantum-dot Cellular Automata Configurable Logic Block for FPGAs
    Balijepalli, Hemant ; Niamat, Mohammed
    In: 2012 IEEE 55th International Midwest Symposium on Circuits and Systems (MWSCAS), 2012-08-01, S. 622-625
    Konferenz
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  17. Detailansicht für Treffer 17 öffnen
    A function generator-based reconfigurable system
    Garg, V. ; Chandrasekhar, V. ; et al.
    In: Proceedings of the ASP-DAC 2005. Asia and South Pacific Design Automation Conference, Jg. 2 (2005), S. 905-909
    Konferenz
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  18. Detailansicht für Treffer 18 öffnen
    An automatic testing technique for PLDs
    Elsayed, A. ; Elbably, M. ; et al.
    In: Proceedings of the Nineteenth National Radio Science Conference, 2002, S. 413-420
    Konferenz
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  19. Detailansicht für Treffer 19 öffnen
    Two-level MUX Design and Exploration in FPGA Routing Architecture
    Shen, Yuhang ; Qian, Jiadong ; et al.
    In: 2021 31st International Conference on Field-Programmable Logic and Applications (FPL), 2021-08-01, S. 234-241
    Konferenz
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  20. Detailansicht für Treffer 20 öffnen
    Testing carry logic modules of SRAM-based FPGAs
    Sun, Xiaoling ; Xu, Jian ; et al.
    In: Proceedings 2001 IEEE International Workshop on Memory Technology, Design and Testing, 2001, S. 91-98
    Konferenz
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