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    A 3.7 M-Pixel 1300-fps CMOS Image Sensor With 5.0 G-Pixel/s High-Speed Readout Circuit
    Okura, S. ; Nishikido, O. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-04-01), Heft 4, S. 1016-1024
    Online academicJournal
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    A 15–22 Gbps Serial Link in 28 nm CMOS With Direct DFE
    Balan, V. ; Oluwole, O. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-12-01), Heft 12, S. 3104-3115
    Online academicJournal
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    Volltext
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    A 2.1 M Pixels, 120 Frame/s CMOS Image Sensor With Column-Parallel $\Delta \Sigma$ ADC Architecture
    Chae, Y. ; Cheon, J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 46 (2011), Heft 1, S. 236-247
    Online academicJournal
    Zugriff:
    Volltext
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    A 0.5 V 1.1 MS/sec 6.3 fJ/Conversion-Step SAR-ADC With Tri-Level Comparator in 40 nm CMOS
    Shikata, A. ; Sekimoto, R. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-04-01), Heft 4, S. 1022-1030
    Online academicJournal
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    Low-Power CMOS Equalizer Design for 20-Gb/s Systems
    Ibrahim, S. ; Razavi, B.
    In: IEEE Journal of Solid-State Circuits, Jg. 46 (2011-06-01), Heft 6, S. 1321-1336
    Online academicJournal
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    A 69.5 mW 20 GS/s 6b Time-Interleaved ADC With Embedded Time-to-Digital Calibration in 32 nm CMOS SOI
    Chen, V. H. C. ; Pileggi, L.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-12-01), Heft 12, S. 2891-2901
    Online academicJournal
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    A Continuous-Time 0–3 MASH ADC Achieving 88 dB DR With 53 MHz BW in 28 nm CMOS
    Dong, Y. ; Yang, W. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-12-01), Heft 12, S. 2868-2877
    Online academicJournal
    Zugriff:
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    A Centimeter Resolution, 10 m Range CMOS Impulse Radio Radar for Human Motion Monitoring
    Park, P. ; Kim, S. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-05-01), Heft 5, S. 1125-1134
    Online academicJournal
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    Volltext
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    A 28 GHz Hybrid PLL in 32 nm SOI CMOS
    Ferriss, M. ; Rylyakov, A. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-04-01), Heft 4, S. 1027-1035
    Online academicJournal
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  10. Detailansicht für Treffer 10 öffnen
    A 10-Bit 800-MHz 19-mW CMOS ADC
    Chiang, S.-H. W. ; Sun, H. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-04-01), Heft 4, S. 935-949
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    A CMOS Class-D Line Driver Employing a Phase-Locked Loop Based PWM Generator
    Lu, J. ; Song, H. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-03-01), Heft 3, S. 729-739
    Online academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    A 3.1 mW 8b 1.2 GS/s Single-Channel Asynchronous SAR ADC With Alternate Comparators for Enhanced Speed in 32 nm Digital SOI CMOS
    Kull, L. ; Toifl, T. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-12-01), Heft 12, S. 3049-3058
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    An 0.8-mm$^2$ 9.6-mW Iterative Decoder for Faster-Than-Nyquist and Orthogonal Signaling Multicarrier Systems in 65-nm CMOS
    Dasalukunte, D. ; Rusek, F. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-07-01), Heft 7, S. 1680-1688
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    A 0.54 pJ/b 20 Gb/s Ground-Referenced Single-Ended Short-Reach Serial Link in 28 nm CMOS for Advanced Packaging Applications
    Poulton, J. W. ; Dally, W. J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-12-01), Heft 12, S. 3206-3218
    Online academicJournal
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    A 6-b 4.1-GS/s Flash ADC With Time-Domain Latch Interpolation in 90-nm CMOS
    Kim, J. I. ; Sung, B.-R. S. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-06-01), Heft 6, S. 1429-1441
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  16. Detailansicht für Treffer 16 öffnen
    HermesE: A 96-Channel Full Data Rate Direct Neural Interface in 0.13 $\mu$ m CMOS
    Gao, H. ; Walker, R. M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-04-01), Heft 4, S. 1043-1055
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    A 4.5 mW/Gb/s 6.4 Gb/s 22+1-Lane Source Synchronous Receiver Core With Optional Cleanup PLL in 65 nm CMOS
    Reutemann, R. ; Ruegg, M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010-12-01), Heft 12, S. 2850-2860
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    A 60 V Auto-Zero and Chopper Operational Amplifier With 800 kHz Interleaved Clocks and Input Bias Current Trimming
    Kusuda, Y.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-12-01), Heft 12, S. 2804-2813
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    Analysis and Design of a High-Order Discrete-Time Passive IIR Low-Pass Filter
    Tohidian, M. ; Madadi, I. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-11-01), Heft 11, S. 2575-2587
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    A Continuous Time Multi-Bit $\Delta \Sigma$ ADC Using Time Domain Quantizer and Feedback Element
    Dhanasekaran, V. ; Gambhir, M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 46 (2011-03-01), Heft 3, S. 639-650
    Online academicJournal
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