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    'Porous Silicon Relaxation Medium For Dislocation Free Cmos Devices' in Patent Application Approval Process (USPTO 20200043811)
    In: Technology Business Journal, 2020-02-25, S. 1707
    Zeitungsartikel
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    Patent Issued for Gate Stack Designs For Analog And Logic Devices In Dual Channel Si/SiGe CMOS (USPTO 10,535,517)
    In: Technology Business Journal, 2020-01-28, S. 4069
    Zeitungsartikel
    Wie komme ich dran?
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    Patent Issued for CMOS VFET Contacts With Trench Solid And Liquid Phase Epitaxy (USPTO 10,510,617)
    In: Technology Business Journal, 2019-12-31, S. 3203
    Zeitungsartikel
    Wie komme ich dran?
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    'Source And Drain Isolation For CMOS Nanosheet With One Block Mask' in Patent Application Approval Process (USPTO 20190295899)
    In: Technology Business Journal, 2019-10-15, S. 2220
    Zeitungsartikel
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    'Improved Fully-Depleted Cmos Transistors With U-Shaped Channel' in Patent Application Approval Process (USPTO 20190267490)
    In: Technology Business Journal, 2019-09-17, S. 1273
    Zeitungsartikel
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    'Mixed Signal Cmos Rpu With Digital Weight Storage' in Patent Application Approval Process (USPTO 20190251430)
    In: Technology Business Journal, 2019-09-03, S. 1532
    Zeitungsartikel
    Wie komme ich dran?
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    'Artificial Synapse With Hafnium Oxide-Based Ferroelectric Layer In CMOS Front-End' in Patent Application Approval Process (USPTO 20190252500)
    In: Technology Business Journal, 2019-09-03, S. 896
    Zeitungsartikel
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    'Source And Drain Isolation For CMOS Nanosheet With One Block Mask' in Patent Application Approval Process (USPTO 20190214314)
    In: Technology Business Journal, 2019-07-30, S. 1716
    Zeitungsartikel
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    Patent Issued for Artificial Synapse With Hafnium Oxide-Based Ferroelectric Layer In CMOS Front-End (USPTO 10,319,818)
    In: Technology Business Journal, 2019-06-25, S. 3383
    Zeitungsartikel
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    Patent Issued for CMOS Compatible Fuse Or Resistor Using Self-Aligned Contacts (USPTO 10,290,633)
    In: Technology Business Journal, 2019-05-28, S. 3600
    Zeitungsartikel
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    Patent Issued for Dual Work Function CMOS Devices (USPTO 10,256,161)
    In: Technology Business Journal, 2019-04-23, S. 4001
    Zeitungsartikel
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    Patent Issued for Packaging Optoelectronic Components And CMOS Circuitry Using Silicon-On-Insulator Substrates For Photonics Applications (USPTO 10,229,898)
    In: Journal of Physics Research, 2019-03-26, S. 5068
    Zeitungsartikel
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    Patent Issued for Porous Silicon Relaxation Medium For Dislocation Free CMOS Devices (USPTO 10,204,836)
    In: Technology Business Journal, 2019-02-26, S. 1706
    Zeitungsartikel
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    Patent Issued for Enhancing Robustness Of SOI Substrate Containing A Buried N.Sup.+ Silicon Layer For CMOS Processing (USPTO 10,204,823)
    In: Technology Business Journal, 2019-02-26, S. 1439
    Zeitungsartikel
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    Researchers Submit Patent Application, 'Dual Channel Cmos Having Common Gate Stacks', for Approval (USPTO 20180337097)
    In: Computer Weekly News, 2018-12-12
    Zeitungsartikel
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    Patent Issued for Vertical CMOS Devices With Common Gate Stacks (USPTO 10,141,232)
    In: Computer Weekly News, 2018-12-12
    Zeitungsartikel
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    Patent Issued for Strained CMOS On Strain Relaxation Buffer Substrate (USPTO 10,141,338)
    In: Computer Weekly News, 2018-12-12
    Zeitungsartikel
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    Patent Issued for Low Resistance Source/Drain Contacts For Complementary Metal Oxide Semiconductor (CMOS) Devices (USPTO 10,141,308)
    In: Information Technology Newsweekly, 2018-12-11
    Zeitungsartikel
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    Researchers Submit Patent Application, 'Fabricating Contacts Of A Cmos Structure', for Approval (USPTO 20180294193)
    In: Computer Weekly News, 2018-10-31, S. 7775
    Zeitungsartikel
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    Researchers Submit Patent Application, 'Nanosheet Cmos Transistors', for Approval (USPTO 20180277630)
    In: Computer Weekly News, 2018-10-17, S. 8957
    Zeitungsartikel
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