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    A 40-nm Cryo-CMOS Quantum Controller IC for Superconducting Qubit
    Kang, K. ; Minn, D. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-11-01), Heft 11, S. 3274-3287
    Online academicJournal
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    A 7.6 mW, 414 fs RMS-Jitter 10 GHz Phase-Locked Loop for a 40 Gb/s Serial Link Transmitter Based on a Two-Stage Ring Oscillator in 65 nm CMOS
    Bae, W. ; Ju, H. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016-10-01), Heft 10, S. 2357-2368
    Online academicJournal
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    A 7-nm FinFET CMOS PLL With 388-fs Jitter and −80-dBc Reference Spur Featuring a Track-and-Hold Charge Pump and Automatic Loop Gain Control
    Ko, C. ; Kuan, T. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-04-01), Heft 4, S. 1043-1050
    Online academicJournal
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    A Second-Order Purely VCO-Based CT $\Delta\Sigma$ ADC Using a Modified DPLL Structure in 40-nm CMOS
    Zhong, Y. ; Li, S. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-02-01), Heft 2, S. 356-368
    Online academicJournal
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    A 10-Gb/s, 0.03-mm2, 1.28-pJ/bit Half-Rate Injection-Locked CDR With Path Mismatch Tracking Loop in a 28-nm CMOS Technology
    Choo, M. ; Park, K. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-10-01), Heft 10, S. 2812-2822
    Online academicJournal
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    A 0.016 mm2 0.26- $\mu$ W/MHz 60–240-MHz Digital PLL With Delay-Modulating Clock Buffer in 65 nm CMOS
    Zhu, J. ; Choi, W. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-08-01), Heft 8, S. 2186-2194
    Online academicJournal
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    A 3.8 mW/Gbps Quad-Channel 8.5–13 Gbps Serial Link With a 5 Tap DFE and a 4 Tap Transmit FFE in 28 nm CMOS
    Kocaman, N. ; Ali, T. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 51 (2016-04-01), Heft 4, S. 881-892
    Online academicJournal
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    A 14-GHz Bang-Bang Digital PLL With Sub-150-fs Integrated Jitter for Wireline Applications in 7-nm FinFET CMOS
    Pfaff, D. ; Abbott, R. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-03-01), Heft 3, S. 580-591
    Online academicJournal
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    A 0.5-V 1.6-mW 2.4-GHz Fractional-N All-Digital PLL for Bluetooth LE With PVT-Insensitive TDC Using Switched-Capacitor Doubler in 28-nm CMOS
    Pourmousavian, N. ; Kuo, F. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-09-01), Heft 9, S. 2572-2583
    Online academicJournal
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  10. Detailansicht für Treffer 10 öffnen
    An 8-Core MIPS-Compatible Processor in 32/28 nm Bulk CMOS
    Hu, W. ; Yang, L. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014), Heft 1, S. 41-49
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    Complex IF Harmonic Rejection Mixer for Non-Contiguous Dual Carrier Reception in 65 nm CMOS
    Sundstrom, L. ; Ek, S. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-07-01), Heft 7, S. 1659-1668
    Online academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    A 3 Watt 39.8–44.6 Gb/s Dual-Mode SFI5.2 SerDes Chip Set in 65 nm CMOS
    Nedovic, N. ; Kristensson, A. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010-10-01), Heft 10, S. 2016-2029
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    A 5GHz Digital Fractional- $N$ PLL Using a 1-bit Delta–Sigma Frequency-to-Digital Converter in 65 nm CMOS
    Talegaonkar, M. ; Anand, T. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-09-01), Heft 9, S. 2306-2320
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    An 8.0-Gb/s HyperTransport Transceiver for 32-nm SOI-CMOS Server Processors
    Loke, A. L. S. ; Doyle, B. A. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-11-01), Heft 11, S. 2627-2642
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  15. Detailansicht für Treffer 15 öffnen
    A 500 mW ADC-Based CMOS AFE With Digital Calibration for 10 Gb/s Serial Links Over KR-Backplane and Multimode Fiber
    Cao, J. ; Zhang, B. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010-06-01), Heft 6, S. 1172-1185
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  16. Detailansicht für Treffer 16 öffnen
    A Phase-Selecting Digital Phase-Locked Loop With Bandwidth Tracking in 65-nm CMOS Technology
    Hsieh, P. H. ; Maxey, J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010-04-01), Heft 4, S. 781-792
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  17. Detailansicht für Treffer 17 öffnen
    A 21-Gb/s 87-mW Transceiver With FFE/DFE/Analog Equalizer in 65-nm CMOS Technology
    Wang, H. ; Lee, J.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010-04-01), Heft 4, S. 909-920
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  18. Detailansicht für Treffer 18 öffnen
    A Versatile 90-nm CMOS Charge-Pump PLL for SerDes Transmitter Clocking
    Loke, A.L.S. ; Barnes, R.K. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 41 (2006-08-01), Heft 8, S. 1894-1907
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  19. Detailansicht für Treffer 19 öffnen
    A Pulse-Based Ultra-Wideband Transmitter in 90-nm CMOS for WPANs
    Demirkan, M. ; Spencer, R. R.
    In: IEEE Journal of Solid-State Circuits, Jg. 43 (2008-12-01), Heft 12, S. 2820-2828
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  20. Detailansicht für Treffer 20 öffnen
    A compact triple-band low-jitter digital LC PLL with programmable coil in 130-nm CMOS
    Da Dalt, N. ; Thaller, E. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 40 (2005-07-01), Heft 7, S. 1482-1490
    Online academicJournal
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