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    Split-path skewed (SPS) CMOS buffer for high performance and low power applications
    Stan, Mircea R. ; Hamzaoglu, Fatih
    In: IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing, Jg. 48 (2001), S. 998-1002
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    Wie komme ich dran?
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    A 3-V 230-MHz CMOS decimation subsampler
    Lindfors, Saska ; Parssinen, Aarno ; et al.
    In: IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing, Jg. 50 (2003-03-01), S. 105-117
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    Speed-power-accuracy tradeoff in high-speed CMOS ADCs
    Steyaert, Michiel ; Uyttenhove, K.
    In: IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing, Jg. 49 (2002-04-01), S. 280-287
    Online unknown
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    Repeater design to reduce delay and power in resistive interconnect
    Friedman, Eby G. ; Adler, V.
    In: IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing, Jg. 45 (1998-05-01), S. 607-616
    Online unknown
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    Ultra low-voltage/low-power digital floating-gate circuits
    Tor Sverre Lande ; Wisland, Dag T. ; et al.
    In: IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing, Jg. 46 (1999-07-01), S. 930-936
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    Clock-controlled neuron-MOS logic gates
    Ohmi, Tadahiro ; Shibata, Tadashi ; et al.
    In: IEEE Transactions on Circuits and Systems II: Analog and Digital Signal Processing, Jg. 45 (1998-04-01), S. 518-522
    Online unknown
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    Wie komme ich dran?
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