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    A Low-Power Column-Parallel ΣΔ ADC With Shared OTAs and Single-Bit-BWI Decimation Filter for CMOS Image Sensor.
    Wang, Zhongjie ; Ma, Qiyun ; et al.
    In: IEEE Transactions on Electron Devices, Jg. 69 (2022-06-01), Heft 6, S. 2979-2985
    Online academicJournal
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    A Low-Power Indirect Time-of-Flight CMOS Image Sensor With Fixed Depth Noise Compensation and Dual-Mode Imaging for Depth Dynamic Range Enhancement.
    Piao, Canxing ; Ahn, Yeonsoo ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 69 (2022-10-01), Heft 10, S. 3989-3999
    Online serialPeriodical
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    The Merged Voltage Follower: A Class-AB CMOS Follower With Enhanced Bandwidth to Drive Loads With Low Resistance and Large Capacitance Le suiveur de tension fusionné: un suiveur CMOS de classe AB avec une bande passante améliorée pour piloter des charges avec une faible résistance et une grande capacité
    Ocampo-Hidalgo, Juan Jesus ; Molinar-Solis, Jesus Ezequiel ; et al.
    In: IEEE Canadian Journal of Electrical & Computer Engineering, Jg. 44 (2021), Heft 1, S. 30-40
    Online academicJournal
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    An 8-Bit 1-GS/s Asynchronous Loop-Unrolled SAR-Flash ADC With Complementary Dynamic Amplifiers in 28-nm CMOS.
    Oh, Dong-Ryeol ; Moon, Kyoung-Jun ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-04-01), Heft 4, S. 1216-1226
    Online academicJournal
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    Island-Style Monolithic Three-Dimensional CMOS-Nanoelectromechanical Logic Circuits.
    Kwon, Hyug Su ; Ko, Ji Wang ; et al.
    In: IEEE Electron Device Letters, Jg. 41 (2020-08-01), Heft 8, S. 1257-1260
    Online academicJournal
    Zugriff:
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    Ultra-Low Power CMOS Image Sensor With Two-Step Logical Shift Algorithm-Based Correlated Double Sampling Scheme.
    Park, Keunyeol ; Yeom, Seonwoo ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 67 (2020-11-01), Heft 11, S. 3718-3727
    Online serialPeriodical
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    Design of E- and W-Band Low-Noise Amplifiers in 22-nm CMOS FD-SOI.
    Gao, Li ; Wagner, Eric ; et al.
    In: IEEE Transactions on Microwave Theory & Techniques, Jg. 68 (2020), Heft 1, S. 132-143
    Online academicJournal
    Zugriff:
    Volltext
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    A 65-nm CMOS 6-bit 2.5-GS/s 7.5-mW 8 $\times$ Time-Domain Interpolating Flash ADC With Sequential Slope-Matching Offset Calibration.
    Oh, Dong-Ryeol ; Kim, Jong-In ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019), Heft 1, S. 288-297
    Online academicJournal
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    A Dual-Imaging Speed-Enhanced CMOS Image Sensor for Real-Time Edge Image Extraction.
    Kim, Hyeon-June ; Hwang, Sun-Il ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-09-01), Heft 9, S. 2488-2497
    Online academicJournal
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  10. Detailansicht für Treffer 10 öffnen
    A Low-Power Digitizer for Back-Illuminated 3-D-Stacked CMOS Image Sensor Readout With Passing Window and Double Auto-Zeroing Techniques.
    Liu, Qiyuan ; Edward, Alexander ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-06-01), Heft 6, S. 1591-1604
    Online academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    A Power-Efficient CMOS Multi-Band Phased-Array Receiver Covering 24–71-GHz Utilizing Harmonic-Selection Technique With 36-dB Inter-Band Blocker Tolerance for 5G NR.
    Zhang, Yi ; Pang, Jian ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-12-01), Heft 12, S. 3617-3630
    Online academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    Low Consumption Balanced Front-End Amplifiers Robust to Load Variations in 65nm PD-SOI CMOS Technology for 60 GHz Short-Range Wireless Applications.
    Berthier, Alexandre ; Ghiotto, Anthony ; et al.
    In: IEEE Transactions on Circuits & Systems. Part II: Express Briefs, Jg. 69 (2022-10-01), Heft 10, S. 4098-4102
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    A 1.1- \mu \textm 33-Mpixel 240-fps 3-D-Stacked CMOS Image Sensor With Three-Stage Cyclic-Cyclic-SAR Analog-to-Digital Converters.
    Arai, Toshiki ; Yasue, Toshio ; et al.
    In: IEEE Transactions on Electron Devices, Jg. 64 (2017-12-01), Heft 12, S. 4992-5000
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  14. Detailansicht für Treffer 14 öffnen
    Josephson-CMOS Hybrid Memory With Nanocryotrons.
    Tanaka, Masamitsu ; Suzuki, Masato ; et al.
    In: IEEE Transactions on Applied Superconductivity, Jg. 27 (2017-06-01), Heft 4, Part 1, S. 1-4
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  15. Detailansicht für Treffer 15 öffnen
    A 1.2-GS/s 8-bit Two-Step SAR ADC in 65-nm CMOS With Passive Residue Transfer.
    Huang, Hai ; Du, Ling ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-06-01), Heft 6, S. 1551-1562
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  16. Detailansicht für Treffer 16 öffnen
    An Area-Efficient and Low-Power 12-b SAR/Single-Slope ADC Without Calibration Method for CMOS Image Sensors.
    Kim, Min-Kyu ; Hong, Seong-Kwan ; et al.
    In: IEEE Transactions on Electron Devices, Jg. 63 (2016-09-01), Heft 9, S. 3599-3604
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  17. Detailansicht für Treffer 17 öffnen
    Picowatt, 0.45–0.6 V Self-Biased Subthreshold CMOS Voltage Reference.
    de Oliveira, Arthur Campos ; Cordova, David ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 64 (2017-12-01), Heft 12, S. 3036-3046
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  18. Detailansicht für Treffer 18 öffnen
    A 2.5–5.0-GHz Clock Multiplier With 3.2–4.5-mUI rms Jitter and 0.98–1.06 mW/GHz in 65-nm CMOS.
    Bandarupalli, Jaya Deepthi ; Saxena, Saurabh
    In: IEEE Transactions on Circuits & Systems. Part II: Express Briefs, Jg. 69 (2022-09-01), Heft 9, S. 3714-3718
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    A CMOS Complementary Common Gate Capacitive Cross-Coupled Frequency Doubler.
    Jang, Junyoung ; Lim, Hyunwoong ; et al.
    In: IEEE Transactions on Circuits & Systems. Part II: Express Briefs, Jg. 69 (2022-09-01), Heft 9, S. 3694-3698
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    A 12-GHz Reconfigurable Multicore CMOS DCO, With a Time-Variant Analysis of the Impact of Reconfiguration Switches on Phase Noise.
    Tomasin, Lorenzo ; Andreani, Pietro ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-09-01), Heft 9, S. 2802-2811
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