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    BFP-CIM: Runtime Energy-Accuracy Scalable Computing-in-Memory-Based DNN Accelerator Using Dynamic Block-Floating-Point Arithmetic
    Chang, C. ; Huang, C. ; et al.
    In: IEEE Transactions on Circuits and Systems I: Regular Papers, Jg. 71 (2024-05-01), Heft 5, S. 2079-2092
    Online academicJournal
    Zugriff:
    Volltext
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    BFP-CIM: Data-Free Quantization with Dynamic Block-Floating-Point Arithmetic for Energy-Efficient Computing-In-Memory-based Accelerator
    Chang, Cheng-Yang ; Huang, Chi-Tse ; et al.
    In: 2024 29th Asia and South Pacific Design Automation Conference (ASP-DAC), 2024-01-22, S. 545-550
    Konferenz
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    Stochastic Computing-based Computation-in-Memory (SC CiM) Architecture for DNNs and Hierarchical Evaluations of Non-volatile Memory Error and Defect Tolerance
    Nishimura, Takuto ; Ichikawa, Yuya ; et al.
    In: 2023 IEEE International Memory Workshop (IMW), 2023-05-01, S. 1-4
    Konferenz
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    IMPACT: A 1-to-4b 813-TOPS/W 22-nm FD-SOI Compute-in-Memory CNN Accelerator Featuring a 4.2-POPS/W 146-TOPS/mm2 CIM-SRAM With Multi-Bit Analog Batch-Normalization
    Kneip, A. ; Lefebvre, M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 58 (2023-07-01), Heft 7, S. 1871-1884
    Online academicJournal
    Zugriff:
    Volltext
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  5. Detailansicht für Treffer 5 öffnen
    E-UPQ: Energy-Aware Unified Pruning-Quantization Framework for CIM Architecture
    Chang, C. ; Chou, K. ; et al.
    In: IEEE Journal on Emerging and Selected Topics in Circuits and Systems, Jg. 13 (2023-03-01), Heft 1, S. 21-32
    Online academicJournal
    Zugriff:
    Volltext
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    SSM-CIM: An Efficient CIM Macro Featuring Single-Step Multi-bit MAC Computation for CNN Edge Inference
    Zhang, H. ; He, S. ; et al.
    In: IEEE Transactions on Circuits and Systems I: Regular Papers, Jg. 70 (2023-11-01), Heft 11, S. 4357-4368
    Online academicJournal
    Zugriff:
    Volltext
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  7. Detailansicht für Treffer 7 öffnen
    Framework and Quantization Method Design for CIM
    Pai, Hsin-Yi ; Cheng, Wei-Kai
    In: 2023 International Conference on Consumer Electronics - Taiwan (ICCE-Taiwan), 2023-07-17, S. 307-308
    Konferenz
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  8. Detailansicht für Treffer 8 öffnen
    Non-volatile Memory Application to Quantum Error Correction with Non-uniformly Quantized CiM
    Ichikawa, Yuya ; Goda, Akira ; et al.
    In: 2022 IEEE International Memory Workshop (IMW), 2022-05-01, S. 1-4
    Konferenz
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  9. Detailansicht für Treffer 9 öffnen
    MARS: Multimacro Architecture SRAM CIM-Based Accelerator With Co-Designed Compressed Neural Networks
    Sie, S. ; Lee, J. ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 41 (2022-05-01), Heft 5, S. 1550-1562
    Online academicJournal
    Zugriff:
    Volltext
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  10. Detailansicht für Treffer 10 öffnen
    Spike-CIM: A 290TOPS/W Spike-Encoding Sparsity-Adaptive Computing-in-Memory Macro with Differential Charge-Domain Integrate-and-Fire
    Song, Jiahao ; Tang, Xiyuan ; et al.
    In: 2022 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2022-11-06, S. 1-3
    Konferenz
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  11. Detailansicht für Treffer 11 öffnen
    BR-CIM: An Efficient Binary Representation Computation-In-Memory Design
    Yue, Z. ; Wang, Y. ; et al.
    In: IEEE Transactions on Circuits and Systems I: Regular Papers, Jg. 69 (2022-10-01), Heft 10, S. 3940-3953
    Online academicJournal
    Zugriff:
    Volltext
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  12. Detailansicht für Treffer 12 öffnen
    MLFlash-CIM: Embedded Multi-Level NOR-Flash Cell based Computing in Memory Architecture for Edge AI Devices
    Zeng, Sitao ; Zhang, Yuxin ; et al.
    In: 2021 IEEE 3rd International Conference on Artificial Intelligence Circuits and Systems (AICAS), 2021-06-06, S. 1-4
    Konferenz
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  13. Detailansicht für Treffer 13 öffnen
    LIORAT: NN Layer I/O Range Training for Area/Energy-Efficient Low-Bit A/D Conversion System Design in Error-Tolerant Computation-in-Memory
    Yamada, Ayumu ; Misawa, Naoko ; et al.
    In: 2023 IEEE/ACM International Conference on Computer Aided Design (ICCAD), 2023-10-28, S. 1-9
    Konferenz
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  14. Detailansicht für Treffer 14 öffnen
    Exploring Bit-Level Sparsity for Partial Sum Quantization in Computing-In-Memory Accelerator
    Bai, Jinyu ; Sun, Sifan ; et al.
    In: 2023 IEEE 12th Non-Volatile Memory Systems and Applications Symposium (NVMSA), 2023-08-01, S. 32-37
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    In-Memory Transposable Multibit Multiplication Based on Diagonal Symmetry Weight Block
    Tong, Z. ; Zhao, Y. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 31 (2023-09-01), Heft 9, S. 1454-1458
    Online academicJournal
    Zugriff:
    Volltext
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  16. Detailansicht für Treffer 16 öffnen
    A/D Alleviator: Reducing Analog-to-Digital Conversions in Compute-In-Memory with Augmented Analog Accumulation
    Cao, Weidong ; Zhang, Xuan
    In: 2023 IEEE International Symposium on Circuits and Systems (ISCAS), 2023-05-21, S. 1-5
    Konferenz
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  17. Detailansicht für Treffer 17 öffnen
    TT@CIM: A Tensor-Train In-Memory-Computing Processor Using Bit-Level-Sparsity Optimization and Variable Precision Quantization
    Guo, R. ; Yue, Z. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 58 (2023-03-01), Heft 3, S. 852-866
    Online academicJournal
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  18. Detailansicht für Treffer 18 öffnen
    A 1-to-4b 16.8-POPS/W 473-TOPS/mm2 6T-based In-Memory Computing SRAM in 22nm FD-SOI with Multi-Bit Analog Batch-Normalization
    Kneip, Adrian ; Lefebvre, Martin ; et al.
    In: ESSCIRC 2022- IEEE 48th European Solid State Circuits Conference (ESSCIRC), 2022-09-19, S. 157-160
    Konferenz
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  19. Detailansicht für Treffer 19 öffnen
    An Energy-Efficient Mixed-Bit CNN Accelerator With Column Parallel Readout for ReRAM-Based In-Memory Computing
    Liu, D. ; Zhou, H. ; et al.
    In: IEEE Journal on Emerging and Selected Topics in Circuits and Systems, Jg. 12 (2022-12-01), Heft 4, S. 821-834
    Online academicJournal
    Zugriff:
    Volltext
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  20. Detailansicht für Treffer 20 öffnen
    A 3-8bit Reconfigurable Hybrid ADC Architecture with Successive-approximation and Single-slope Stages for Computing in Memory
    Fan, Wuyu ; Li, Yuandong ; et al.
    In: 2022 IEEE International Symposium on Circuits and Systems (ISCAS), 2022-05-28, S. 3393-3397
    Konferenz
    Wie komme ich dran?
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