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    A Low-Power Forward and Reverse Body Bias Generator in CMOS 40 nm
    Wu, Chundong ; Wang, Lei ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-07-01), S. 1403-1407
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    A 170-dB $\Omega $ CMOS TIA With 52-pA Input-Referred Noise and 1-MHz Bandwidth for Very Low Current Sensing
    Rezaee-Dehsorkh, Hamidreza ; Taherzadeh-Sani, Mohammad ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-05-01), S. 1756-1766
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    A 65-nm CMOS Constant Current Source With Reduced PVT Variation
    Wang, Dong ; Pak Kwong Chan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-04-01), S. 1373-1385
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    A 0.13- <tex-math notation='LaTeX'>$\mu $ </tex-math>m CMOS Current-Mode All-Pass Filter for Multi-GHz Operation
    Ahmadi, Peyman ; Taghavi, M. H. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 23 (2015-12-01), S. 2813-2818
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    A Performance-Aware MOSFET Threshold Voltage Measurement Circuit in a 65-nm CMOS
    Pak Kwong Chan ; Xiao Liang Tan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-04-01), S. 1430-1440
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    An Ultralow Power Subthreshold CMOS Voltage Reference Without Requiring Resistors or BJTs
    Zhan, Chenchang ; Wang, Lidan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018), S. 201-205
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    A 2-MHz BW 82-dB DR Continuous-Time Delta–Sigma Modulator With a Capacitor-Based Voltage DAC for ELD Compensation
    Na, Seung-in ; Kim, Suhwan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 26 (2018-10-01), S. 1999-2006
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    An R2R-DAC-Based Architecture for Equalization-Equipped Voltage-Mode PAM-4 Wireline Transmitter Design
    Lee, Jeffrey ; Du, Yuan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-11-01), S. 3260-3264
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    A Flexible Continuous-Time $\Delta \Sigma $ ADC With Programmable Bandwidth Supporting Low-Pass and Complex Bandpass Architectures
    Chi, Baoyong ; Xu, Yang ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-03-01), S. 872-880
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    A 1-GS/s 9-bit Zero-Crossing-Based Pipeline ADC Using a Resistor as a Current Source
    Kim, Young-Hwa ; Cho, SeongHwan
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-07-01), S. 2570-2579
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    Using the Gate–Bulk Interaction and a Fundamental Current Injection to Attenuate IM3 and IM2 Currents in RF Transconductors
    Asghari, Meysam ; Yavari, Mohammad
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016), S. 223-232
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    A Comparator-Based Rail Clamp
    Venkatasubramanian, Ramachandran ; Ozev, Sule ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-04-01), S. 1493-1502
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    A 5-Gb/s Digital Clock and Data Recovery Circuit With Reduced DCO Supply Noise Sensitivity Utilizing Coupling Network
    Lee, Taeho ; Kim, Yong-Hun ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017), S. 380-384
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    Wide-Locking Range Divide-by-3 Injection-Locked Frequency Divider Using Sixth-Order <tex-math notation='LaTeX'>$RLC$ </tex-math> Resonator
    Jang, Sheng-Lyang ; Cheng, Wei-Chung ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-07-01), S. 2598-2602
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    A Reference Voltage Interpolation-Based Calibration Method for Flash ADCs
    Chang, Hsuan-Yu ; Yang, Ching-Yuan
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-05-01), S. 1728-1738
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