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    Physical Modeling of Perimeter-Gated SPADs in Standard Deep Submicron CMOS Processes
    Hasan, Sajid ; Shawkat, Shamim Ara
    In: 2024 IEEE 17th Dallas Circuits and Systems Conference (DCAS), 2024-04-19, S. 1-5
    Konferenz
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    Thin Gate Oxide CMOS DC-DC Buck Converter with Floating Gate Drivers
    Gak, Joel ; Marin, Jorge ; et al.
    In: 2024 Argentine Conference on Electronics (CAE), 2024-03-07, S. 120-123
    Konferenz
    Wie komme ich dran?
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    Comparison of Hysteresis margin and Hysteresis width Schmitt Trigger Oscillators using logic gates in 28nm CMOS Technology
    Lakhara, Nisha Kumari ; Trikey, Sukeshni
    In: 2024 IEEE International Students' Conference on Electrical, Electronics and Computer Science (SCEECS), 2024-02-24, S. 1-4
    Konferenz
    Wie komme ich dran?
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    A 200-GHz Power Amplifier With 18.7-dBm Psat in 45-nm CMOS SOI: A Model-Based Large-Signal Approach on Cascaded Series-Connected Power Amplification
    Hassanzadehyamchi, S. ; Alizadeh, A. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 59 (2024-06-01), Heft 6, S. 1631-1642
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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    RISC-V SoC Physical Implementation in 180 nm CMOS with a Quark Core Based on FemtoRV32
    Nascimento, Felipe F. ; Wuerdig, Rodrigo N. ; et al.
    In: 2023 IEEE Seventh Ecuador Technical Chapters Meeting (ECTM), 2023-10-10, S. 1-6
    Konferenz
    Wie komme ich dran?
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    Cryogenic Small Dimension Effects and Design-Oriented Scalable Compact Modeling of a 65-nm CMOS Technology
    Gatti, A. ; Tavernier, F.
    In: IEEE Journal of the Electron Devices Society, Jg. 12 (2024), S. 369-378
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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    Randomized Bulk-Voltages: A Countermeasure to Mask Side-Channel Leakage of CMOS Logic Gates
    Amble, Magnus ; Aunet, Snorre ; et al.
    In: 2023 IEEE 66th International Midwest Symposium on Circuits and Systems (MWSCAS), 2023-08-06, S. 708-712
    Konferenz
    Wie komme ich dran?
  8. Detailansicht für Treffer 8 öffnen
    Cryogenic CMOS as an Enabler for Low Power Dynamic Logic
    Saligram, Rakshith ; Datta, Suman ; et al.
    In: 2023 IEEE/ACM International Symposium on Low Power Electronics and Design (ISLPED), 2023-08-07, S. 1-6
    Konferenz
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  9. Detailansicht für Treffer 9 öffnen
    Implementation of Ambipolar CNTFET based logic gates and their performance comparison with CNTFET and CMOS based logic gates
    Basnat, Som Kumar ; Akram, Md. Waseem ; et al.
    In: 2023 International Conference on Recent Advances in Electrical, Electronics & Digital Healthcare Technologies (REEDCON), 2023-05-01, S. 56-61
    Konferenz
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    A 120-GHz Class-F Frequency Doubler With 7.8-dBm POUT in 55-nm Bulk CMOS
    Yang, Z. ; Ma, K. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 58 (2023-08-01), Heft 8, S. 2173-2188
    Online academicJournal
    Zugriff:
    Volltext
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  11. Detailansicht für Treffer 11 öffnen
    Timing Analysis beyond Complementary CMOS Logic Styles
    Lappas, Jan ; Riahi, Mohamed Amine ; et al.
    In: 2024 29th Asia and South Pacific Design Automation Conference (ASP-DAC), 2024-01-22, S. 189-194
    Konferenz
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  12. Detailansicht für Treffer 12 öffnen
    Design of CMOS Memristor Emulator and Logic Gates For Neuromorphic Circuits
    Swaroop, K. ; Shabd ; et al.
    In: 2023 International Symposium on Devices, Circuits and Systems (ISDCS), Jg. 1 (2023-05-29), S. 1-6
    Konferenz
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  13. Detailansicht für Treffer 13 öffnen
    Design and Simulation of Fault Tolerances in Combinational Circuits Using CMOS 45nm Technology
    Reddy, Vanga Karunakar ; Kumar AV, Ravi
    In: 2023 Second International Conference on Electrical, Electronics, Information and Communication Technologies (ICEEICT), 2023-04-05, S. 1-5
    Konferenz
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  14. Detailansicht für Treffer 14 öffnen
    Two-Bit Magnitude Comparator Design Using Gate Diffusion Input Technique and Static CMOS Logic
    Joy, Upal Barua ; Chakraborty, Avishek ; et al.
    In: 2023 3rd International Conference on Robotics, Electrical and Signal Processing Techniques (ICREST), 2023-01-07, S. 17-21
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    Design, Analysis and Optimization of CMOS Full Adder Based FinFET 10 nm
    Abdelaziz, Lazzaz ; Khaled, Bousbahi ; et al.
    In: 2023 13th International Symposium on Advanced Topics in Electrical Engineering (ATEE), 2023-03-23, S. 1-5
    Konferenz
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  16. Detailansicht für Treffer 16 öffnen
    An Energy Efficient High-Performance CMOS Transmission Gate Full Adder Circuit
    Keerthi, Chippe ; Krishna, K. ; et al.
    In: 2023 International Conference on Sustainable Computing and Data Communication Systems (ICSCDS), 2023-03-23, S. 973-978
    Konferenz
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  17. Detailansicht für Treffer 17 öffnen
    Performance Evaluation and Comparative Analysis of Logic Gates based on CNTFET and CMOS
    Redwan, Rahat ; Ganguly, Chamak ; et al.
    In: 2023 26th International Conference on Computer and Information Technology (ICCIT), 2023-12-13, S. 1-5
    Konferenz
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  18. Detailansicht für Treffer 18 öffnen
    Design and Validation of Domino CMOS D Flip Flop at 16nm Regime
    Kishore, Pinninti ; Kacharla, Sanjay ; et al.
    In: 2023 3rd International Conference on Advancement in Electronics & Communication Engineering (AECE), 2023-11-23, S. 440-444
    Konferenz
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  19. Detailansicht für Treffer 19 öffnen
    Low-Frequency Noise of 4H-SiC CMOS Technology for Analog ICs
    Masunaga, M.
    In: IEEE Transactions on Electron Devices, Jg. 70 (2023-06-01), Heft 6, S. 3228-3233
    Online academicJournal
    Zugriff:
    Volltext
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  20. Detailansicht für Treffer 20 öffnen
    Comparative Analysis of CNTFET and CMOS based NCL Asynchronous Circuits: A Study of Scaling Trends
    Bodoh, Alexander C. ; Sakib, Ashiq A.
    In: 2022 IEEE 13th Annual Ubiquitous Computing, Electronics & Mobile Communication Conference (UEMCON), 2022-10-26, S. 407-412
    Konferenz
    Wie komme ich dran?
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