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    A Hybrid CMOS-Memristor Spiking Neural Network Supporting Multiple Learning Rules
    Florini, Davide ; Gandolfi, Daniela ; et al.
    In: IEEE Transactions on Neural Networks and Learning Systems ; volume 35, issue 4, page 5117-5129 ; ISSN 2162-237X 2162-2388, 2024
    Online academicJournal
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    A Neuromorphic CMOS Circuit With Self-Repairing Capability
    Linares-Barranco, Bernabe ; Parvizi-Fard, Adel ; et al.
    In: IEEE Transactions on Neural Networks and Learning Systems, Jg. 33 (2022-05-01), S. 2246-2258
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    An In-Field Programmable Adaptive CMOS LNA for Intelligent IoT Sensor Node Applications
    Ozev, Sule ; Shafiee, Maryam
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 41 (2022-02-01), S. 201-210
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    A 68-GHz Loss Compensated Distributed Amplifier Using Frequency Interleaved Technique in 65-nm CMOS Technology
    Wu, Yue-Ming ; Chu, Ta-Shun ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022), S. 29-39
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    A 40-nm CMOS Multifunctional Computing-in-Memory (CIM) Using Single-Ended Disturb-Free 7T 1-Kb SRAM
    Lean Karlo S. Tolentino ; Yeh, Chia-Hung ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021-12-01), S. 2172-2185
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    A Spurious and Oscillator Pulling Free CMOS Quadrature LO-Generator for Cellular NB-IoT
    Kim, Nam-Seog ; Choi, Jaewon
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021-12-01), S. 2098-2109
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    A 5-V Switch for Analog Multiplexers With 2.5-V Transistors in 28-nm CMOS Technology
    Biccario, Giuseppe E. ; Vitrenko, Oleg ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 31 (2023-05-01), S. 636-643
    Online unknown
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    A 10-Gb/s Inductorless Low-Power TIA With a 400-fF Low-Speed Avalanche Photodiode Realized in CMOS Process
    Ding, Haofan ; Dai, Haiyan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 31 (2023-04-01), S. 512-521
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    A 0.1–9-GHz Frequency Synthesizer for Avionic SDR Applications in 0.13-μm CMOS Technology
    Zakaria I. El Alaoui ; Gagnon, Francois ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021-12-01), S. 2119-2129
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    Efficient Performance Modeling for Automated CMOS Analog Circuit Synthesis
    Zhang, Lihong ; Zhao, Zhenxin
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021-11-01), S. 1824-1837
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    A Fully Integrated 10-V Pulse Driver Using Multiband Pulse-Frequency Modulation in 65-nm CMOS
    Wu, Jiangchao ; Law, Man-Kay ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021-09-01), S. 1665-1669
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    A 32-Gb/s Dual-Mode Transceiver With One-Tap FIR and Two-Tap IIR RX Only Equalization in 65-nm CMOS Technology
    Song, Junyoung ; Kim, Chulwoo ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021-08-01), S. 1567-1574
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    Cascode Cross-Coupled Stage High-Speed Dynamic Comparator in 65 nm CMOS
    Krishna, Komala ; Nambath, Nandakumar
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, 2023, S. 1-4
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    An All-MOSFET Voltage Reference-Based PUF Featuring Low BER Sensitivity to VT Variations and 163 fJ/Bit in 180-nm CMOS
    Cao, Yuan ; Gan, Peizhou ; et al.
    In: IEEE Transactions on Computer-Aided Design of Integrated Circuits and Systems, Jg. 40 (2021-06-01), S. 1172-1182
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    Wide-Range Many-Core SoC Design in Scaled CMOS: Challenges and Opportunities
    Krishnamurthy, Harish K. ; Hsu, Steven K. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021-05-01), S. 843-856
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    A 6-Bit 1.5-GS/s SAR ADC With Smart Speculative Two-Tap Embedded DFE in 130-nm CMOS for Wireline Receiver Applications
    Mahmoudi, Azad ; Torkzadeh, Pooya ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021-05-01), S. 871-882
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    CMOS-GAN: Semi-Supervised Generative Adversarial Model for Cross-Modality Face Image Synthesis
    Yu, Shikang ; Han, Hu ; et al.
    In: IEEE Transactions on Image Processing, Jg. 32 (2023), S. 144-158
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    Low-Overhead Triple-Node-Upset-Tolerant Latch Design in 28-nm CMOS
    Chen, Xin ; Bai, Yuxin ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, 2023, S. 1-12
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  19. Detailansicht für Treffer 19 öffnen
    0.4-1 GHz Subsampling Mixer-First RF Front-End With 50-dB HRR, $+$10-dBm IB-IIP3 in 65-nm CMOS
    Rakesh Varma Rena ; Kammari, Raviteja ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, 2023, S. 1-13
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    Implementation of a Multipath Fully Differential OTA in 0.18-μm CMOS Process
    Akbari, Meysam ; Safwan Mawlood Hussein ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 31 (2023), S. 147-151
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