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    A 28.9–38.8 μW dual-mode 10-bit column parallel single-slope ADC with minimum voltage feedback for CMOS image sensors.
    Yuan, Shengping ; Li, Zhoudeng ; et al.
    In: Microelectronics Journal, Jg. 145 (2024-03-01), S. N.PAG
    academicJournal
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    A low offset low power CMOS dynamic comparator for analog to digital converters.
    Huijing, Yang ; Shichang, Li ; et al.
    In: Integration: The VLSI Journal, Jg. 91 (2023-07-01), S. 136-143
    academicJournal
    Wie komme ich dran?
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    2μs row time 12-bit column-parallel single slope ADC for high-speed CMOS image sensor.
    Wang, Gaoyuan ; Chen, Quanmin ; et al.
    In: Microelectronics Journal, Jg. 135 (2023-05-01), S. N.PAG
    academicJournal
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    A 9-bit 8.3 MS/s column SAR ADC with hybrid RC DAC for CMOS image sensors.
    Liu, Mengyu ; Zhu, Sihui ; et al.
    In: Microelectronics Journal, Jg. 131 (2023), S. N.PAG
    academicJournal
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    An 8 bit-ENOB Sampling-rate Reconfigurable Asynchronous SAR ADC with Metastability Watchdog Circuit for Activity-driven Multi-Channel CMOS Readout ASICs for Space Applications.
    Karim, Rashid ; Grassi, Marco ; et al.
    In: AEU: International Journal of Electronics & Communications, Jg. 173 (2024), S. N.PAG
    Online academicJournal
    Zugriff:
    View record from ScienceDirect (Volltext)
    Wie komme ich dran?
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    Design and analysis of a high-speed low-power comparator with regeneration enhancement and through current suppression techniques from 4 K to 300 K in 65-nm Cryo-CMOS.
    Pai, Chia-Wei ; Uchida, Ken ; et al.
    In: Microelectronics Journal, Jg. 144 (2024-02-01), S. N.PAG
    academicJournal
    Wie komme ich dran?
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    An 11.36-Bit 405 μW SAR-VCO ADC with single-path differential VCO-based quantizer in 65 nm CMOS.
    Dong, Siwan ; Yuan, Menghan ; et al.
    In: Microelectronics Journal, Jg. 147 (2024-05-01), S. N.PAG
    academicJournal
    Wie komme ich dran?
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    A 1.25-GS/s 10-bit single-channel ring amplifier-based pipelined ADC in 28-nm CMOS.
    Zhang, Heng ; Guo, Xuan ; et al.
    In: Microelectronics Journal, Jg. 146 (2024-04-01), S. N.PAG
    academicJournal
    Wie komme ich dran?
  9. Detailansicht für Treffer 9 öffnen
    A low power 16-bit 50 MS/s pipeline ADC with 104 dB SFDR in 0.18 μm CMOS.
    Zhou, Xiaodan ; He, Weipeng ; et al.
    In: Microelectronics Journal, Jg. 146 (2024-04-01), S. N.PAG
    academicJournal
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    A 10-bit 50-MS/s SAR ADC with 1 fJ/Conversion in 14 nm SOI FinFET CMOS.
    Wang, Aili ; Shi, C.-J. Richard
    In: Integration: The VLSI Journal, Jg. 62 (2018-06-01), S. 246-257
    academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    Design of CMOS fully differential multipath two-stage OTA with boosted slew rate and power efficiency.
    Hashemi, Zahra ; Yargholi, Mostafa
    In: Integration: The VLSI Journal, Jg. 97 (2024-07-01), S. N.PAG
    academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    A fast correlated multiple sampling technique based on 12-bit SAR ADC with digital calibration for low-noise CMOS image sensor.
    Nie, Kaiming ; Yin, Zhaoyang ; et al.
    In: Microelectronics Journal, Jg. 59 (2017), S. 47-54
    academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    A 12-bit, 100 kS/s, PVT robust SAR ADC in 65 nm CMOS process.
    Ahmadlou, Mohammad ; Dundar, Gunhan ; et al.
    In: Microelectronics Journal, Jg. 149 (2024-07-01), S. N.PAG
    academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    High-speed cascode cross-coupled CMOS dynamic comparator with auxiliary inverter pair.
    Krishna, Komala ; Nambath, Nandakumar
    In: Microelectronics Journal, Jg. 149 (2024-07-01), S. N.PAG
    academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    A self-compensated approach for ramp kickback noise in CMOS image sensor column parallel single slope ADC.
    Guo, Zhongjie ; Yu, Ningmei ; et al.
    In: Microelectronics Journal, Jg. 120 (2022-02-01), S. N.PAG
    academicJournal
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  16. Detailansicht für Treffer 16 öffnen
    A 1.8 V 98.6 dB SNDR discrete-time CMOS delta-sigma ADC.
    Wei, Cong ; Chen, Chengying ; et al.
    In: Microelectronics Journal, Jg. 144 (2024-02-01), S. N.PAG
    academicJournal
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  17. Detailansicht für Treffer 17 öffnen
    A 10-bit 33.3-kS/s 3.2-fJ/conversion-step single-ended counter-type SAR ADC with dual 5-bit CDAC arrays and counters in 65-nm CMOS.
    Tehranian, Armin ; Peiravi, Ali
    In: AEU: International Journal of Electronics & Communications, Jg. 175 (2024-02-01), S. N.PAG
    Online academicJournal
    Zugriff:
    View record from ScienceDirect (Volltext)
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  18. Detailansicht für Treffer 18 öffnen
    A 102.1-dB SNDR oversampling merge-mismatch-error-shaping SAR ADC in 180 nm CMOS.
    Xiao, Jinghong ; Song, Jiajun ; et al.
    In: Microelectronics Journal, Jg. 143 (2024), S. N.PAG
    academicJournal
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  19. Detailansicht für Treffer 19 öffnen
    Column amplification stages in CMOS image sensors based on incremental sigma-delta ADCs.
    Freitas, Luis Miguel C. ; Morgado-Dias, F.
    In: Microelectronics Journal, Jg. 113 (2021-07-01), S. N.PAG
    academicJournal
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  20. Detailansicht für Treffer 20 öffnen
    A 0.4-to-0.8 V 0.1-to-5 MS/s 10 b two-step SAR ADC with TDC-based fine quantizer in 40-nm CMOS.
    Zhang, Chengcheng ; Hu, Ang ; et al.
    In: Microelectronics Journal, Jg. 141 (2023-11-01), S. N.PAG
    academicJournal
    Wie komme ich dran?
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