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    A low offset low power CMOS dynamic comparator for analog to digital converters.
    Huijing, Yang ; Shichang, Li ; et al.
    In: Integration: The VLSI Journal, Jg. 91 (2023-07-01), S. 136-143
    academicJournal
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    A 10-bit 50-MS/s SAR ADC with 1 fJ/Conversion in 14 nm SOI FinFET CMOS.
    Wang, Aili ; Shi, C.-J. Richard
    In: Integration: The VLSI Journal, Jg. 62 (2018-06-01), S. 246-257
    academicJournal
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    Design of CMOS fully differential multipath two-stage OTA with boosted slew rate and power efficiency.
    Hashemi, Zahra ; Yargholi, Mostafa
    In: Integration: The VLSI Journal, Jg. 97 (2024-07-01), S. N.PAG
    academicJournal
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    A 10-bit 50 MS/s SAR ADC in 65 nm CMOS with on-chip reference voltage buffer.
    Harikumar, Prakash ; Wikner, J. Jacob
    In: Integration: The VLSI Journal, Jg. 50 (2015-06-01), S. 28-38
    academicJournal
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    High-resolution calibrated successive-approximation-register analog-to-digital converter.
    Cao, Chao ; Guo, Haijun
    In: Integration: The VLSI Journal, Jg. 87 (2022-11-01), S. 205-210
    academicJournal
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    Picowatt 0.3-V MOS-only voltage reference based on a picoamp cascode current generator.
    Aminzadeh, Hamed ; Valinezhad, Mohammad Mahdi
    In: Integration: The VLSI Journal, Jg. 87 (2022-11-01), S. 284-292
    academicJournal
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    A 0.2-V 1.2 nW 1-KS/s SAR ADC with a novel comparator structure for biomedical applications.
    Vafaei, M. ; Hosseini, M.R. ; et al.
    In: Integration: The VLSI Journal, Jg. 88 (2023), S. 362-370
    academicJournal
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    A low power offset voltage calibration method for flash ADCs.
    Chatterjee, Shatadal ; Roy, Sounak
    In: Integration: The VLSI Journal, Jg. 88 (2023), S. 58-69
    academicJournal
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    Novel gate-overlap tunnel FET based innovative ultra-low-power ternary flash ADC.
    Vidhyadharan, Sanjay ; Dan, Surya Shankar ; et al.
    In: Integration: The VLSI Journal, Jg. 73 (2020-07-01), S. 101-113
    academicJournal
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    New approach for digital calibration of pipelined analog to digital converters based on secant method.
    Zia, Ehsan ; Shamsi, Alireza ; et al.
    In: Integration: The VLSI Journal, Jg. 82 (2022), S. 89-95
    academicJournal
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    Reference-free power supply monitor with enhanced robustness against process and temperature variations.
    Aparicio, Hernán ; Ituero, Pablo ; et al.
    In: Integration: The VLSI Journal, Jg. 82 (2022), S. 127-135
    academicJournal
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    Dual split-three segment capacitor array Design Based Successive approximation ADC for Io-T ecosystem.
    Savitha, M. ; Reddy, R. Venkat Siva
    In: Integration: The VLSI Journal, Jg. 69 (2019-11-01), S. 279-288
    academicJournal
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    A real-time pseudo-background gain calibration strategy for residue amplifiers of pipeline ADCs.
    Kazeminia, Sarang
    In: Integration: The VLSI Journal, Jg. 65 (2019-03-01), S. 51-73
    academicJournal
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    An NTF-enhanced incremental ΣΔ modulator using a SAR quantizer.
    Hojati, Zeinab ; Yavari, Mohammad
    In: Integration: The VLSI Journal, Jg. 55 (2016-09-01), S. 212-219
    academicJournal
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