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    A 9-bit 500-MS/s 2-bit/cycle SAR ADC With Error-Tolerant Interpolation Technique.
    Song, Jaegeun ; Park, Yunsoo ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-05-01), Heft 5, S. 1492-1503
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    An 8-bit 10-GHz 21-mW Time-Interleaved SAR ADC With Grouped DAC Capacitors and Dual-Path Bootstrapped Switch.
    Swindlehurst, Eric ; Jensen, Hunter ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 56 (2021-08-01), Heft 8, S. 2347-2359
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    A 1 mW 71.5 dB SNDR 50 MS/s 13 bit Fully Differential Ring Amplifier Based SAR-Assisted Pipeline ADC.
    Lim, Yong ; Flynn, Michael P.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-12-01), Heft 12, S. 2901-2911
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    A Time-Interleaved SAR ADC With Bypass-Based Opportunistic Adaptive Calibration.
    Fan, Qingjun ; Hong, Yi ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-08-01), Heft 8, S. 2082-2093
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    A 14 Bit 1 GS/s RF Sampling Pipelined ADC With Background Calibration.
    Ali, Ahmed M. A. ; Dinc, Huseyin ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-12-01), Heft 12, S. 2857-2867
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    A 1.5 mW 68 dB SNDR 80 Ms/s 2\times Interleaved Pipelined SAR ADC in 28 nm CMOS.
    van der Goes, Frank ; Ward, Christopher M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-12-01), Heft 12, S. 2835-2845
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    A 10-mW 16-b 15-MS/s Two-Step SAR ADC With 95-dB DR Using Dual-Deadzone Ring Amplifier.
    ElShater, Ahmed ; Venkatachala, Praveen Kumar ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-12-01), Heft 12, S. 3410-3420
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    A 0.6 V 1.63 fJ/c.-s. Detective Open-Loop Dynamic System Buffer for SAR ADC in Zero-Capacitor TDDI System.
    Hu, Yao-Sheng ; Huang, Li-Yu ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-10-01), Heft 10, S. 2680-2690
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    A 12-Bit, 300-MS/s Single-Channel Pipelined-SAR ADC With an Open-Loop MDAC.
    Wu, Chao ; Yuan, Jie
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-05-01), Heft 5, S. 1446-1454
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    A 12-Bit 31.1- $\mu$ W 1-MS/s SAR ADC With On-Chip Input-Signal-Independent Calibration Achieving 100.4-dB SFDR Using 256-fF Sampling Capacitance.
    Shen, Junhua ; Shikata, Akira ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-04-01), Heft 4, S. 937-947
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    A 44-fJ/Conversion Step 200-MS/s Pipeline ADC Employing Current-Mode MDACs.
    Briseno-Vidrios, Carlos ; Zhou, Dadian ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-11-01), Heft 11, S. 3280-3292
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    A 0.4-V 13-bit 270-kS/s SAR-ISDM ADC With Opamp-Less Time-Domain Integrator.
    Hsieh, Sung-En ; Hsieh, Chih-Cheng
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019-06-01), Heft 6, S. 1648-1656
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    A 12-bit 300-MS/s SAR ADC With Inverter-Based Preamplifier and Common-Mode-Regulation DAC in 14-nm CMOS FinFET.
    Luu, Danny ; Kull, Lukas ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-11-01), Heft 11, S. 3268-3279
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    A 0.5-V 12-bit SAR ADC Using Adaptive Time-Domain Comparator With Noise Optimization.
    Hsieh, Sung-En ; Kao, Chen-Che ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-10-01), Heft 10, S. 2763-2771
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    A Nyquist Rate SAR ADC Employing Incremental Sigma Delta DAC Achieving Peak SFDR = 107 dB at 80 kS/s.
    AlMarashli, Ahmad ; Anders, Jens ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-05-01), Heft 5, S. 1493-1507
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